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ddr设置拓扑结构时出现不匹配?

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发表于 2015-2-3 16:13 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 zcl2012 于 2015-2-3 16:14 编辑 2 K( `  k6 _; h3 D
" f* y6 a& `# f- p5 p! u
. _/ A& {: w% W2 I" m+ M& r: L
相同的拓扑结构,为何有两根线没通过,大家有遇到这种情况么?. ]: x5 v+ p* I& H6 S+ p
原理图没问题,拓扑都是一样的" {$ ]7 |) H: L0 c- s- ^6 ?
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发表于 2015-2-3 16:53 | 只看该作者
连接的芯片也是一样的吗?

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是的,都是一样的  详情 回复 发表于 2015-2-3 18:51

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 楼主| 发表于 2015-2-3 18:51 | 只看该作者
dzkcool 发表于 2015-2-3 16:53
$ v, `' {% G8 d9 H, r连接的芯片也是一样的吗?
1 |2 z, b/ _' d, J7 R% H
是的,都是一样的

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其实这个约束很少用,呵呵,方便的话把文件放上来大家看看吧。  详情 回复 发表于 2015-2-3 18:56

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发表于 2015-2-3 18:56 | 只看该作者
zcl2012 发表于 2015-2-3 18:51
7 w$ p* P, z" j' H$ J4 k, i3 ?是的,都是一样的

5 C$ B4 c8 F3 X) J其实这个约束很少用,呵呵,方便的话把文件放上来大家看看吧。

点评

谢谢指教,文件还是不方便上传的 还想请教下这种约束不常用,那我在设置ddr2的t型连接是用那种约束规则呢?  详情 回复 发表于 2015-2-4 08:54
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 楼主| 发表于 2015-2-4 08:54 | 只看该作者
dzkcool 发表于 2015-2-3 18:56
. o$ |7 G) I+ t6 s) ^其实这个约束很少用,呵呵,方便的话把文件放上来大家看看吧。
, u+ a1 }7 b" a& ?; h3 a8 n0 b
谢谢指教,文件还是不方便上传的2 E2 @# c4 x0 m
还想请教下这种约束不常用,那我在设置ddr2的t型连接是用那种约束规则呢?
8 }( U; n, {% O! Q: V9 O* a& @

点评

一般是走线的时候就规划好,设置相对延时等长约束(Relative Propagation Delay)后,在人工绕等长时也能发现是否按T型拓扑走线,如果有拓扑不一样的网络,其等长是很难绕出来的。  详情 回复 发表于 2015-2-4 09:02

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发表于 2015-2-4 09:02 | 只看该作者
zcl2012 发表于 2015-2-4 08:54% F6 G/ b3 B  Z1 B  p4 ~
谢谢指教,文件还是不方便上传的
% G1 _5 k6 N. x, F( U# f/ z! w/ |. O还想请教下这种约束不常用,那我在设置ddr2的t型连接是用那种约束规 ...

+ B" G! ~" U' n  u2 x1 N! @8 [一般是走线的时候就规划好,设置相对延时等长约束(Relative Propagation Delay)后,在人工绕等长时也能发现是否按T型拓扑走线,如果有拓扑不一样的网络,其等长是很难绕出来的。- \, }9 A+ B7 e4 P

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我是设置Relative Propagation Delay相对延迟的啊,我先将地址线设置成一个bus,然后编辑拓扑结构,更新到约束管理器中,软件自动匹配bus内的信号线,  详情 回复 发表于 2015-2-5 08:52
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发表于 2015-2-4 10:16 | 只看该作者
又不是精品。。。。还不方便各种借口。

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呵呵,不是精品好不好的问题,公司的项目,怎么可以随便传上网呢  详情 回复 发表于 2015-2-5 08:46

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发表于 2015-2-4 15:30 | 只看该作者
我有遇到过,和你的一样,我的解决办法是把没有通过的单独设置拓扑,一般就都通过了,我也不知道是什么原因导致的拓扑不一样6 l* J. ~7 t. }9 d$ F9 c# _/ t

点评

你好,再请教下,你具体是如何做的呢? 在不匹配的信号线右击sigxploer下编辑下,然后在哪里更新呢?  详情 回复 发表于 2015-2-5 11:08

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 楼主| 发表于 2015-2-5 08:46 | 只看该作者
yangjinxing521 发表于 2015-2-4 10:165 {0 w7 `0 e2 J8 b' t
又不是精品。。。。还不方便各种借口。
0 |& t) a$ q* z; s* L2 P
呵呵,不是精品好不好的问题,公司的项目,怎么可以随便传上网呢! n$ R( R3 p" R+ e9 r! {

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 楼主| 发表于 2015-2-5 08:52 | 只看该作者
dzkcool 发表于 2015-2-4 09:029 L1 X* o, D9 Q
一般是走线的时候就规划好,设置相对延时等长约束(Relative Propagation Delay)后,在人工绕等长时也能发 ...
  D* p/ Y4 I, Y, j; {. p
我是设置Relative Propagation Delay相对延迟的啊,我先将地址线设置成一个bus,然后编辑拓扑结构,更新到约束管理器中,软件自动匹配bus内的信号线,7 |5 ~6 x* U" s% a# f. i. }( E

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 楼主| 发表于 2015-2-5 11:08 | 只看该作者
ggbingjie 发表于 2015-2-4 15:309 \5 h  e& w& ?
我有遇到过,和你的一样,我的解决办法是把没有通过的单独设置拓扑,一般就都通过了,我也不知道是什么原因 ...
5 a; x" w  J% l3 n+ ~  S2 r) u
你好,再请教下,你具体是如何做的呢?* I$ [; B" K* h+ K2 I5 Z! R3 F
在不匹配的信号线右击sigxploer下编辑下,然后在哪里更新呢?
) N4 C, T8 ]7 w- y9 o

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 楼主| 发表于 2015-2-5 11:38 | 只看该作者
谢谢各位解答,问题已经解决了

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发表于 2016-8-22 16:07 | 只看该作者
这个问题 是怎么解决的?; Y( b2 F: }9 ]; P) _. [
可以说说嘛?
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