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楼主: 逍遥剑客
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原理图上有几个没有PCB Footprint属性的元件,怎样处理才能导出网表?

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发表于 2017-1-22 14:24 | 只看该作者
我就不明白为啥 但凡下载附件都需要威望 求助的附件也需要 拒绝

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发表于 2017-2-14 14:35 | 只看该作者
如果只为导出netlist,随便加个名字就行,如果是要导入PCB使用,一定要注意pin数与元器件pin数对应起来(封装尺寸不对都行,后期画PCB可以在更改),否则你在PCB导入netlist时,就会报错,必须去重新设置正确的封装才能解决。6 U0 ^, B+ r, U; d. F4 W0 o# h

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EDA365特邀版主

"學會了" 就簡單了.

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发表于 2017-2-15 11:45 | 只看该作者
批次 替換/增加 PCB Footprint 屬性,請參考圖片。

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学到了,谢谢啦  详情 回复 发表于 2017-2-15 17:42

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 楼主| 发表于 2017-2-15 17:42 | 只看该作者
jacklee_47pn 发表于 2017-2-15 11:45
7 T& u2 X0 l6 k: j2 v批次 替換/增加 PCB Footprint 屬性,請參考圖片。
2 y3 F' E7 U5 {! A) p
学到了,谢谢啦
% s; W4 \4 R; ?8 [

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 楼主| 发表于 2017-2-15 17:51 | 只看该作者
附件绝对不是骗子附件哈。问题解决了,好像由于建库不规范导致的device问题,在环境变量增加了这个值就OK了。谢谢大家的帮助,但是不是解决问题的答案,所以我就把赏金给回答最用心的同学吧。
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