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再发Constraint Manager疑难杂症,高手请进!!!

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发表于 2011-6-8 17:03 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x

9 C6 }. q/ a" [- W  R
% z/ M2 t/ t: h2 l. n( c# w$ x如图中所示,数据线都是一对一的,凭空跑出来很多没用的线,黄色所示,都是其他引脚已经连接的。检查原理图没有问题,没用这些连接关系都是一对一的。' x5 c" N7 D3 b% y) ~6 A
前两天发帖有朋友说是模型问题,我用的是排阻,4个一起的。模型都用的一样的,总共64条线别的都没问题,单单这几个有问题,请教高手有遇到过这种情况的吗,该如何解决。先谢了% ]' w* x+ @& i
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发表于 2011-6-8 21:48 | 只看该作者
是的,需要重设模型!

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发表于 2011-6-8 22:46 | 只看该作者
你确定一对一?
7 n0 g1 B# S0 q4 m) `pin pair改longest或者手动设pin pair试试~

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发表于 2011-6-9 08:38 | 只看该作者
pin pair下清空 scope选择global

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发表于 2011-6-9 08:49 | 只看该作者
关于pin pair下的选项help里面的说明是3 ~$ ^% `" G, F, f' z% F
Match Group. In the Pin Pairs column of the Relative Propagation Delay worksheet, you can guide the generation of pin pairs with the following options:
4 d: ^2 e9 `  Y1 R
" I& K$ P' ?3 ?9 }8 d* Q8 s' G; Y. ~8 `& t5 l  V1 }; n; K
Choosing this option . . .
' S8 F6 H& B& ]3 i3 X+ g& [* k" DGenerates pin pairs based on . . . 4 @2 W; n, Y7 k% l: T

3 E; b0 F9 s, b8 tAll Drivers/All Receivers% p0 F% b  O2 w4 n
All combinations of drivers and receivers.
8 k, X" I% N3 q- _
9 P* b! H  Z3 g, PLongest Driver/Receiver7 r% H% ~( g0 {2 U0 g, _
The longest driver-receiver pin pair. Uses the longest pin pair when there are not any drivers or receivers.
$ _& W* q, @9 |2 {9 o
0 l" q( O8 j. e  C# yLongest Pin Pair" ?$ B( |% |: d; J0 G5 p
The longest pin pair. 8 S' I5 Z9 v4 X9 ~5 v" I# F, u

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发表于 2011-6-9 09:29 | 只看该作者
建模的时候pin number 12345678对应错了是不是?

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 楼主| 发表于 2011-6-9 19:24 | 只看该作者
回复 wangjing 的帖子
5 t7 O# n. q( j1 K
$ V. E2 F, r* u- V* f没错啊 对应关系也对着呢 一样的模型 有的是对的 有的是错的

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 楼主| 发表于 2011-6-9 19:25 | 只看该作者
回复 wangxs_song 的帖子
# n1 r5 K1 f+ V; K. E
/ O+ M5 P; |; g( Y模型都没问题啊

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发表于 2011-6-10 09:11 | 只看该作者
回复 mcu200689 的帖子
5 Y3 z/ h! p% T; e, f% Y: `( M* p% c  u" |3 ?% b) N: c4 e
你的排阻是不是上拉或下拉?就是一端是电源或者地?而并非两端都是信号。

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 楼主| 发表于 2011-6-10 09:54 | 只看该作者
本帖最后由 mcu200689 于 2011-6-10 10:03 编辑   h+ \. S) [2 e+ x
9 O7 z; F# `5 G. h
今天找到问题的所在了,DDR2组内8跟数据线是可以互换的,为了布线方便就把原来的一组内的8跟数据线做了调换,约束里边的两条线是换前和换后的(一条绿的是现在的连接关系,黄的是原来的),应该是生成网表的的时候,新的连接关系没有替换掉原来的,造成两根线同时共存,这种情况应该就是OrCad画原理图时的问题了,不知道这种情况怎么解决??

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发表于 2011-6-10 10:30 | 只看该作者
回复 mcu200689 的帖子+ V% X0 ~0 d# U4 p" v2 ]
1 n8 L- `3 m" ~7 r0 f
调整原理图再导网表啊

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 楼主| 发表于 2011-6-10 10:58 | 只看该作者
回复 wangjing 的帖子
4 Q0 x& ]/ z: i5 U
, j3 u3 ~" B- w( n  C: A  H) Z怎么调?原理图连接关系对着呢啊
! x3 D3 w% P& v# \. F

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发表于 2011-6-10 11:01 | 只看该作者
回复 mcu200689 的帖子& b1 X4 g- H% o+ R$ U* l8 W

' Z/ a+ P5 w7 `8 ?& `1 d4 u对着呢怎么会这样,重导网表。" B! O( J: z3 s" y! B

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 楼主| 发表于 2011-6-10 12:08 | 只看该作者
回复 wangjing 的帖子7 b0 R+ N$ X' I- x$ P( Y& B

3 ~4 Q3 g- U! k# V7 ^导啦 我改了连接关系就重新生成网表 导到PCB了 约束关系还是显示两条线 不知道咋回事

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发表于 2011-6-10 13:03 | 只看该作者
回复 mcu200689 的帖子: D; z7 G/ a/ ~# F$ E  B

# R2 [6 m4 D* T3 o4 p6 ^不应该会这样 你的原理图没改好吧 再检查一下。换个路径再导一下
, V6 j: T4 q7 \+ X: J( m" T
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