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2017年10月20日QA检查报告节选

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发表于 2017-10-24 11:32 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 EDA365QA 于 2017-10-24 11:34 编辑
% |0 s) V2 @. q3 `
' Q; S* e  b( }' I- ?1.电源没加粗
8 [1 Z& x, N- g, ]- V7 j5 U ! A6 P8 [/ v! w! n; ~, D, Z
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 楼主| 发表于 2017-10-24 11:32 | 只看该作者
2.钢网层有多余的线
0 b6 r& e6 Z' ~8 x' Y$ l$ g
, Y6 Q- G7 s; E* r

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 楼主| 发表于 2017-10-24 11:35 | 只看该作者
3.周边螺孔与器件干涉
5 p. |, x) F) o9 N: j6 x9 F / s# W' m6 |6 ]$ b3 s- k* F

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 楼主| 发表于 2017-10-24 11:36 | 只看该作者
4.变压器前后隔离1 g" q4 i# l) K) X  q+ o
. w/ o) \+ y+ q7 M* B# P0 X% j. G

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 楼主| 发表于 2017-10-24 11:38 | 只看该作者
5.电源VIA只有1个,另有三个没网络过孔VIA。
& O  C! k5 L, A6 E$ d; l, ]- X6 K 9 G' T+ N7 O& w  e- S& L' _

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 楼主| 发表于 2017-10-24 11:44 | 只看该作者
6.DVI线对间等长
1 |* L& {; c3 ^/ l* @" {( ]& K 1 l. [' O: l+ d7 {, f! [- _) j6 m

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 楼主| 发表于 2017-10-24 11:44 | 只看该作者
7.电源没加粗
  Q2 J0 z1 M- d! L4 a * t* T% a4 I0 m' P8 R

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 楼主| 发表于 2017-10-24 11:45 | 只看该作者
8.flash拓扑不一致
. ]; \& i# ]1 o* I$ s " a$ J" m1 O7 }9 a! e1 Z

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 楼主| 发表于 2017-10-24 11:45 | 只看该作者
9.变压器中间挖空不过线前后隔离
# o6 \& T2 L' M! c2 y + c/ x" L) {" ?+ j0 F

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 楼主| 发表于 2017-10-24 11:46 | 只看该作者
10.共LAYOUT不要出现残端1 c" J# @8 K7 P: V* n

0 m$ n+ M' o4 w+ p

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EDA365QA 发表于 2017-10-24 11:45' S9 ]2 s. x% C( ^$ U! \. n3 d2 s
8.flash拓扑不一致

# {) y' g3 ~7 P8 e, x3 M/ @1 |! W2 F; b8 G0 ^7 o7 w" {
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