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2017年7月19日公益PCB评审报告节选

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发表于 2017-7-20 08:51 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.  音频模拟线加粗走类差分.
1 q2 F5 m" Q/ o5 h. q9 R+ Z8 m4 M+ X! C 1 X. N1 y/ p9 z+ F2 i
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发表于 2017-7-25 09:28 | 只看该作者
junieya 发表于 2017-7-24 16:32
% a2 P( _7 c8 L8 h; B( }请问这条如何理解? pcb小白求教
' s1 s' N' I9 H( _- ~
1.平面铜只有一个VIA,肯定的说这块铜没有作用.. V  i4 e: I+ X2 v
2.电源被VIA隔小了,电源通路太细.
7 \5 S' U! k1 @+ r' J. U: p

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发表于 2017-7-24 16:32 | 只看该作者
EDA365QA 发表于 2017-7-20 08:58
5 `: J$ [# K) T* t+ k1 x10.  平面铜只有一个VIA,电源被VIA隔小了.
/ B% z/ T* z3 s& u
请问这条如何理解? pcb小白求教5 ~, H! J* B5 `

点评

pcb
1.平面铜只有一个VIA,肯定的说这块铜没有作用. 2.电源被VIA隔小了,电源通路太细.[/backcolor]  详情 回复 发表于 2017-7-25 09:28

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 楼主| 发表于 2017-7-20 08:56 | 只看该作者
7.  天线部分加粗控50OHM,陶瓷天下要挖空按DATASHEET处理.- X: o7 z6 {1 r/ [: m; J
5 a7 Y3 J4 Q, ^4 b

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 楼主| 发表于 2017-7-20 08:52 | 只看该作者
2.  信号线应走阻抗线./ W" d5 Q* m; b: Y; k
# \6 [% X5 Z3 K5 ]( E" r

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 楼主| 发表于 2017-7-20 08:53 | 只看该作者
3.  ESD应靠近接口.% r2 K% b9 z! f8 H* W

# ~# Z4 W# e: @% j$ [1 z3 K# I

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 楼主| 发表于 2017-7-20 08:54 | 只看该作者
4.  电源PIN脚加宽.
" S0 G) T9 ?" ?3 I) _; W+ e* Q 0 o% q3 j, g1 J! Y. q1 Z# U5 v, B$ p

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 楼主| 发表于 2017-7-20 08:55 | 只看该作者
5.  带变压器的网口下挖空处理.6 ?4 r) |% V  R

6 [- ]7 A# ^* {, F2 `

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 楼主| 发表于 2017-7-20 08:55 | 只看该作者
6.  晶体电容不要放后面出现残端.7 b; M% M; Y5 R, k* d# W3 W

/ @' S0 g) ^/ `0 Z! }5 a4 a3 z/ R

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啥意思?没看懂  详情 回复 发表于 2017-11-4 11:27

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 楼主| 发表于 2017-7-20 08:57 | 只看该作者
8.  升压电路应缩小回流路径./ _0 M* v6 K* a& X& z
: o8 {, L: I9 r% y& k7 d

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 楼主| 发表于 2017-7-20 08:57 | 只看该作者
9.  有线在挖空区.  b5 g; \) X# _+ ?; V( E

2 j# U$ w' F% J+ N. q

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 楼主| 发表于 2017-7-20 08:58 | 只看该作者
10.  平面铜只有一个VIA,电源被VIA隔小了.
5 ?, ?3 n% i9 P3 q5 Q- v% I9 y4 i1 h ' X2 [0 A8 R" J8 r: I, l9 |

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请问这条如何理解? pcb小白求教  详情 回复 发表于 2017-7-24 16:32

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发表于 2017-7-20 17:47 | 只看该作者
厉害,啥时候才能有QA的水平啊
$ B1 u$ V& a0 ~: t2 |8 c6 a* U1 F' x

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发表于 2017-7-21 08:43 | 只看该作者
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