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2D line 如元件外框 為什麼設于all layer ? 期待大家討論關注..

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发表于 2008-8-29 18:56 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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情況說明:
# L. L- T  k* ]7 L9 v我在DECAL DEIT環境下分別在primary component layer & silkscreen top & all layer 用2d line畫元件邊線.后保存為part type.
/ `- X& D! c. m- ^5 B9 s8 k. v- P調入pcb layout后,經板層色彩設置后,三個邊線均正常顯示.(當然,在silkscreen top上的邊線顯示為黃色,其餘兩個邊線顯示則一致為灰色).但在導出cam時,我只應用默認設置導出.發現在cam中打開后,唯獨不見primary component layer的邊線顯示..
7 m8 Y0 V7 R2 J7 S經本人苦思冥想,終于知道為何...原來在cam輸出設置時,不可應用默認設置(我指的是如果你的邊線設在了top layer的話).在select items中設置primary component side的items on primary 要勾選outlines一項,如此作previw便可發現設置在primary component layer的元件邊線終於露出了可愛的面目.如下所示:6 m: j4 h. k8 T) b( N

8 b8 V% U" v8 v$ c! A+ X* p. t以上只是自己摸索出的一些設置,但可惜的是只是解決了具體的問題,卻無法總結出真正的原由....4 H6 F+ U  Z9 x# R3 X
於是便不可避免地產生了以下問題,希望版主可以指點一二.....
/ _" `9 N5 C, [3 M1 [7 u2D line 如元件外框 為什麼設于top layer ?設于all layer為什麼也是在layout中可以顯示的?4 U$ f. |8 z8 }, A: p
兩者有區別嗎?. G& j' Q! s0 B9 Y2 }
為什麼又可以設於silkscreen layer? ' b1 U1 d2 v, a* D. ~0 [$ g: ~( V7 t
且以上三种設置均是可以輸出gerber的?1 a! ^8 v1 G6 d2 h1 {
它們各自的分工究竟是怎樣的?8 r! s! X6 q/ c( O8 C6 U5 i- y$ ]
以上菜鳥問題,還請高人指點.謝謝.( V2 V1 p. Q" W$ J3 [# R- @9 ?

1 t: @2 n3 y) R( P# G! P; j[ 本帖最后由 stqw1987 于 2008-8-29 20:36 编辑 ]
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发表于 2008-8-29 20:12 | 只看该作者
元件外框建议设于all layer
9 D7 ~6 ~2 C$ q$ @- g+ t( {1 D, l2 i) Y( D2 g" b' h
之所以不设在screen或top,是因为出丝印层的gerber时,系统默认是all layer.
. H7 E( N9 `$ V' _! ]( d# m9 m" @( z# T; }! p. c# K  V
当然,你也可以设在screnn或top层,但是出gerber时要添加进来.
2 _7 O: a: u" s6 C
# F& c$ M; b% T% w建议:做元件封装时外框统一设置在同一层。
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发表于 2008-9-2 10:02 | 只看该作者
https://www.eda365.com/viewthread.php?tid=4756&page=1#pid40952
% J# x5 E  {$ `  Z4 o3 b# B8 _& X10#,希望对LZ理解有所帮助。
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 楼主| 发表于 2008-9-2 21:46 | 只看该作者
我看了,不過覺得不知所以然....
$ U& z5 k3 K* z: Z5 h這不,在導入時也碰到了各那個LZ一樣的問題,可是我的這個可能更難一點啊....
7 r! P- ^( Q7 n2 s' rhttps://www.eda365.com/thread-10203-1-1.html
7 r8 ^% `: U' s/ h( E, U" N還請高人指點.* v0 R6 ]2 B, {8 Z0 o

' ]8 B  \2 [! s[ 本帖最后由 stqw1987 于 2008-9-2 21:48 编辑 ]
Not necessarily to be strong , but to feel strong!

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发表于 2008-9-3 09:29 | 只看该作者
Original posted by stqw1987 at 2008-9-2 21:46 ( ], l2 Y0 L/ i
我看了,不過覺得不知所以然....
( b" l0 f1 v/ C4 {) D* D這不,在導入時也碰到了各那個LZ一樣的問題,可是我的這個可能更難一點啊....
/ H" k9 A: }4 E# U' n: Lhttps://www.eda365.com/thread-10203-1-1.html, W" m# e! [% @! I4 G
還請高人指點.
) m# Q  w9 H" ^4 B8 B$ ]% {9 u, ]! R; \- `' `: Q, d: j3 U
[ 本帖最后由 stqw1987 于 2008-9-2 21: ...

3 U* a' U" z0 |# \3 F0 R可能是我表达问题,哈哈,如果实在看不明白,咱们可以通过邮件慢慢讨论,我的邮箱请见签名档。+ a! t( P" ?& U7 z2 Z2 {
难怪有这么多人在问这问题最近,唉。。。。。
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发表于 2008-9-3 17:42 | 只看该作者
元件外框设为ALL LAYER层,就说明在任何一层,外框都能显示出来,而元件封装本身有个属性,TOP/BOTTOM,而外框是属于元件封装的,所以元件封装在哪层,也就跟着是哪层了。 总之就是将外框设为ALL LAYER层的好处就是外框始终是与封装在同一层。不知我的理解正确与否。

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发表于 2008-9-6 15:44 | 只看该作者
正确!就是如果在封装里标注字符如:1脚orVCC等就会在DRC时出错的。

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发表于 2008-9-6 19:14 | 只看该作者
怎么是繁体字呢

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发表于 2008-9-6 22:54 | 只看该作者
个人认为这个比较灵活    也就自已灵活处理
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