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再发Constraint Manager疑难杂症,高手请进!!!

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发表于 2011-6-8 17:03 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
; Z& l$ j$ i; E! M) l/ ~" l

: X6 P. k$ O9 C7 y% d如图中所示,数据线都是一对一的,凭空跑出来很多没用的线,黄色所示,都是其他引脚已经连接的。检查原理图没有问题,没用这些连接关系都是一对一的。- B5 x2 v# Q- |$ M, v
前两天发帖有朋友说是模型问题,我用的是排阻,4个一起的。模型都用的一样的,总共64条线别的都没问题,单单这几个有问题,请教高手有遇到过这种情况的吗,该如何解决。先谢了
$ _! }: U: `; R2 o; C( H+ D& N
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发表于 2011-6-8 21:48 | 只看该作者
是的,需要重设模型!

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发表于 2011-6-8 22:46 | 只看该作者
你确定一对一?
* z. G! q$ i9 r7 `4 _pin pair改longest或者手动设pin pair试试~

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发表于 2011-6-9 08:38 | 只看该作者
pin pair下清空 scope选择global

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发表于 2011-6-9 08:49 | 只看该作者
关于pin pair下的选项help里面的说明是0 ]/ z2 _3 v$ p% D' i0 Y  s0 X" b" e
Match Group. In the Pin Pairs column of the Relative Propagation Delay worksheet, you can guide the generation of pin pairs with the following options:
( F; y/ Y/ Q3 [8 g1 f# F. n  Y+ q* ], t% E& q

, |* F) ]4 b9 l+ k: V4 aChoosing this option . . .- A1 J, F* x( t# d. A
Generates pin pairs based on . . .
2 I& L( ]/ e9 {
+ R& X8 V1 z9 J  \! y  NAll Drivers/All Receivers; Q- A8 c8 n- g) J  S
All combinations of drivers and receivers.4 Q8 m! M6 Q9 [& d; l# g; p

8 Z/ s; a9 o: c& cLongest Driver/Receiver3 j9 X0 G# F# T, r: V3 U
The longest driver-receiver pin pair. Uses the longest pin pair when there are not any drivers or receivers. 9 O6 q% w+ L6 Z; D( b9 Y0 ]7 U

, N/ n; h1 `6 K0 L" QLongest Pin Pair" ?- U( _) w6 b- K
The longest pin pair.
- T$ p% Z) q0 j. y. I

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发表于 2011-6-9 09:29 | 只看该作者
建模的时候pin number 12345678对应错了是不是?

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 楼主| 发表于 2011-6-9 19:24 | 只看该作者
回复 wangjing 的帖子
# S( i7 a3 b1 r0 ?8 ^) c6 a
/ O- E! m3 n. k5 K" i& ]- d没错啊 对应关系也对着呢 一样的模型 有的是对的 有的是错的

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 楼主| 发表于 2011-6-9 19:25 | 只看该作者
回复 wangxs_song 的帖子
. U& P) f% u' ^
3 n8 M) x8 A0 y模型都没问题啊

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发表于 2011-6-10 09:11 | 只看该作者
回复 mcu200689 的帖子& ^# n/ O. t* j+ {, D# o0 r

4 w9 Q! P" i' N$ Y8 I" i你的排阻是不是上拉或下拉?就是一端是电源或者地?而并非两端都是信号。

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 楼主| 发表于 2011-6-10 09:54 | 只看该作者
本帖最后由 mcu200689 于 2011-6-10 10:03 编辑 3 r9 \/ T9 T  j& U

' H4 T% q, y# Y5 R& w今天找到问题的所在了,DDR2组内8跟数据线是可以互换的,为了布线方便就把原来的一组内的8跟数据线做了调换,约束里边的两条线是换前和换后的(一条绿的是现在的连接关系,黄的是原来的),应该是生成网表的的时候,新的连接关系没有替换掉原来的,造成两根线同时共存,这种情况应该就是OrCad画原理图时的问题了,不知道这种情况怎么解决??

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发表于 2011-6-10 10:30 | 只看该作者
回复 mcu200689 的帖子
( y; E$ ^( b$ q6 M9 S" t
' ~+ V5 E6 N! I$ ^9 Z! T5 ^$ @调整原理图再导网表啊

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 楼主| 发表于 2011-6-10 10:58 | 只看该作者
回复 wangjing 的帖子! k" @# D& g+ Z" Z7 l/ F* Y
! M: O, A( l4 m" Q( T
怎么调?原理图连接关系对着呢啊3 `0 m- M! |+ l+ B# S, m# `9 l7 E

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发表于 2011-6-10 11:01 | 只看该作者
回复 mcu200689 的帖子
" P! R2 \, l# i1 J5 u- X* V: D, U' u& O- m* S
对着呢怎么会这样,重导网表。
2 E: D! c- ]5 h/ t2 N9 ^0 d! I

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 楼主| 发表于 2011-6-10 12:08 | 只看该作者
回复 wangjing 的帖子) [7 E  _: [' R
+ j9 S+ p; ~9 i
导啦 我改了连接关系就重新生成网表 导到PCB了 约束关系还是显示两条线 不知道咋回事

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发表于 2011-6-10 13:03 | 只看该作者
回复 mcu200689 的帖子: Q5 y8 \1 x( T6 T0 R' N/ o7 L1 S
7 s& [6 }5 Y+ w
不应该会这样 你的原理图没改好吧 再检查一下。换个路径再导一下
- |* y8 Q. B) h) t7 L! X
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