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ddr3等长问题

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发表于 2017-9-2 21:14 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
1.fly-by拓扑的ddr3的dqs跟其对应的clk需要等长否,如需等长,等长做到多少?(如颗粒1的dqs1根其对应的时钟(控制器-颗粒1)5 F8 X2 g& K$ S$ n. V! ?
2.一个控制的两个通道,两个通道的clk是否需要对应等长,就是控制到两个通道对应的颗粒的那段clk,如需要等长做到多少?
( t7 H$ E; L9 {) n% r9 w/ @& r1 Z7 S0 Q3 v/ Y0 W9 V* r
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发表于 2017-9-3 07:49 | 只看该作者
1,支持flyby基本意味着控制器支持write leveling,dqs与clk无等长要求,但两者的时间差会有一个范围要求

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150ps  详情 回复 发表于 2017-9-4 09:35

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发表于 2017-9-4 09:35 | 只看该作者
xxzouzhichao 发表于 2017-9-3 07:49
: \& ~& H' s0 i, h1,支持flyby基本意味着控制器支持write leveling,dqs与clk无等长要求,但两者的时间差会有一个范围要求

1 }& r8 q7 g3 t0 K8 e3 l$ Q! @. y150ps( P' ~% _" s. [2 t3 L8 j& \

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具体换算到mil怎么换算呢  详情 回复 发表于 2017-10-20 14:34

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发表于 2017-9-5 18:53 | 只看该作者
我冒泡来解释一下:
& j) C0 Q1 O, H8 C/ q7 z$ X1、tDQSCK,这个指标在SCB15H1G这个datasheet中看到(-225,225)ps@1600,(-195,195)@1866,南亚NT5CB128M16HP要求(-225,225)ps@1333,布线需要综合考虑实际跑多少的频率,还有兼容不同颗粒的要求,取一个保守值最好,能做到+/-100ps以内最好
+ z7 l1 S3 t+ q2、flyby的拓扑结构,不需要走等长,这个靠初始化序列校验来保证。但要保证tDQSCLK在规范之内。( i. |8 C% W$ M/ f( x0 g/ U/ R" y, q

# w! c; {7 r( j9 J  W! y

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你好,有点不太明白的地方想问一下,这个±150ps,这个指标是时间么,那么这个时间如何来控制呢?我理解的是走线长度的等长就是控制时间的一致性,那么这个150ps这个时间在长度上应该如何计算呢?  详情 回复 发表于 2017-9-6 10:12

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发表于 2017-9-6 10:12 | 只看该作者
hagelee 发表于 2017-9-5 18:531 B4 c% c+ h3 c
我冒泡来解释一下:
, d# |, j/ a6 I* o3 C6 I+ Y$ x1、tDQSCK,这个指标在SCB15H1G这个datasheet中看到(-225,225)ps@1600,(-195,19 ...
8 w) T/ I" ]" j5 o6 i0 P
你好,有点不太明白的地方想问一下,这个±150ps,这个指标是时间么,那么这个时间如何来控制呢?我理解的是走线长度的等长就是控制时间的一致性,那么这个150ps这个时间在长度上应该如何计算呢?
# Y( Y9 L- l% ^) {1 y

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一个ps 6mil ,150ps ,900mil  详情 回复 发表于 2017-9-6 11:17

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发表于 2017-9-6 10:43 | 只看该作者
控制等长的目的也是为了保证timing的余量;走线和延迟的计算公式 V=C/sqrt(Er) , h- B) F/ E' I- i
1.内层周围介质均匀,Er取4.2-4.5,C光速约12inch/ns,计算后为V=166ps/inch;7 g1 b( b' F4 H* D7 f
2.表层由于暴露在空气中,Er小于4,传输速度比内层快,大约 140ps/inch;
+ t0 Z4 F. i6 o% V考虑到温度,电压,颗粒的差异,预留一定的余量可以避免问题的产生,我认为能控制在+/-1inch之内,基本能够保证时序的要求了。  q8 s  n0 s  D6 u9 ~' H

  D. @0 @# G0 k1 E. ]% _% ^还有一种情况是板子结构特殊,布板确实无法做到1inch范围之内,可以考虑通过绕线增加1个ck的周期;这个主要是跟芯片设计的DDR PHY有很大关系,当然这个需要厂家确认。
* |. u3 I# m: f0 o) e5 E

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发表于 2017-9-6 11:17 | 只看该作者
cewtf 发表于 2017-9-6 10:12
& n7 q2 n4 Y0 H/ l你好,有点不太明白的地方想问一下,这个±150ps,这个指标是时间么,那么这个时间如何来控制呢?我理解 ...

8 b5 z- y; U( h& R; u+ c: I一个ps  6mil   ,150ps   ,900mil! g7 a; v: j4 S' X

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 楼主| 发表于 2017-9-6 20:52 来自手机 | 只看该作者
各位,我那个项目的控制器不支持读写平衡,导致我走的fly-by拓扑的ddr3跑不起来,现在我打算改成t形拓扑,dqs跟时钟是不是是要完全等长呢,只有一个clk

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位宽多少?  详情 回复 发表于 2017-9-8 18:08

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发表于 2017-9-7 11:34 | 只看该作者
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发表于 2017-9-7 16:05 | 只看该作者
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发表于 2017-9-8 16:57 | 只看该作者
dqs与数据做等长,clk走t型,地址线走t型做等长

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ann_wz 发表于 2017-9-6 20:52$ V% F0 `1 N, ^2 s; a
各位,我那个项目的控制器不支持读写平衡,导致我走的fly-by拓扑的ddr3跑不起来,现在我打算改成t形拓扑,d ...

+ q/ G! D0 W& {. T# [位宽多少?

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 楼主| 发表于 2017-9-9 07:47 来自手机 | 只看该作者
8片+ecc 72位数据,跑800m速率

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居然还有这么蛋疼的内存控制器,也是醉了,板子画大一点,慢慢绕时序吧,估计800Mhz(1600bps)是跑不下了  详情 回复 发表于 2017-9-9 21:11

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发表于 2017-9-9 21:11 | 只看该作者
ann_wz 发表于 2017-9-9 07:47' ~$ S  X# u. v% b* }4 X4 {/ q
8片+ecc 72位数据,跑800m速率
; d7 S2 s. T$ Z" u- }$ L+ x; C
居然还有这么蛋疼的内存控制器,也是醉了,板子画大一点,慢慢绕时序吧,估计800Mhz(1600bps)是跑不下了
  i' a! p: q) ^( Q

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发表于 2017-10-20 14:34 | 只看该作者
chen.che.ch.c. 发表于 2017-9-4 09:35
# x9 B1 @) }6 t0 y9 ~8 m: p150ps
0 m9 }7 I; C, \  M
具体换算到mil怎么换算呢* i/ i  P! v" W$ Z8 V0 a) H
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