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[仿真讨论] 各階段的SI仿真的重要性.

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发表于 2014-3-3 15:43 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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各階段的SI仿真的重要性.
9 d4 g7 R! Y. I- ~1 M+ K) C" O8 }6 O- y; X
SI仿真一般被分為兩大階段, 大家耳熟能詳的$ j) \5 H) E" \# t, k) }5 h
1) Pre-simulation (circuit simulator)
2 V: g) Q$ k! n  C! `2) Post-simulation (2.5D, 3D simulator)5 H, O, _: W* [0 o
6 c5 i* P' i+ B: P2 v6 v" c$ T
至於各個仿真階段的定義及作用小弟在此就不多作贅述.+ U4 P5 ]& @" G1 B2 `2 S2 G0 L/ l1 C

' p  Z7 o' y( g2 t$ F最近, 有些開發商開始議論Pre仿真的實用性. 認為Pre仿真不能完全反映電路板的實況.& {/ c- B! \& s- c
以DDR3拓譜為例, 即使在Pre仿真階段進行parameter sweep後所總結成的layout design guide, 在很多實際layout情況下是無法被採用的.; m5 `  Y3 t. _3 c  e( P" Y9 V& E* c0 C
而且DDR3,PCIe等高速interface是屬於相當成熟的技術, 不論採用什麼樣的拓譜也無需從新仿真.
9 Z/ s( v$ b! v( b
: y; J2 \: `% z- n1 A4 f+ `基於上述原因,一些開發商放棄Pre仿真而改用另一種更接近實際情況的Simulation, 稱為Interactive Simulation. 即使用2.5D Simulator來仿真worst-case,從而產生layout design guideline. 最後再run一次總的Post仿真(全程不涉及circuit simulation)0 P" c8 h' J% o. E
純屬小弟的愚見,照這樣的情況而言,ANSYS Designer,Agilent ADS等擁有circuit simulator的仿真軟件不就慘了??!' G- X& q4 Q* Z
我總覺得Pre仿真circuit simulation有一定的存在價值, 才疏學淺無法說出一個所以然...
/ s" ~' q2 v& _' J' d) u1 r( s# W! e
各位大俠對此有何高見還望不吝賜教!
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发表于 2014-4-2 20:41 | 只看该作者
一般系统设计中负责把关决策的,会同时重视前仿和后仿,前期投入精力也会比较大。
" V9 m5 j! K: v4 n) e2 |7 ~负责软件操作的工程师,后仿真工作量可能较大,负责决策的人会追着要结果的。
5 @9 m1 S. {+ P* H! z怎么布线、走哪一层、怎么走、怎么做阻抗优化,电源GND平面怎么安排、去耦电容放多少、磁珠滤波器怎么设计。。。。等等N多东西布线前都要定了下来,要不然布线结束后很难办,尤其是走线比较密的板子,布完线再改,简直就是一场噩梦。

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发表于 2014-3-22 10:22 | 只看该作者
早期的仿真速率低,拓扑结构复杂,通常通过前仿真来定层叠,定布局。
7 S% y2 u& \) K" t. ^仿真起步都大约从cadence开始。所以先入为主,大家都有前仿,后仿的概论。
( m0 j% d. |, `# k现在芯片速率高,高速信号大多都是点对点,在设计PCB之前,有专门的工艺工程师8 R# ^' W5 X, R1 v5 [3 a! M2 o
帮你确定了叠层。所以前仿是做的越来越少,多是布完线直接去仿真套规范。
8 ~9 D! q# t( E8 zOK就直接做PCB了。所以不必拘泥于前后,你想做,前后都是可以做的。

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 楼主| 发表于 2014-3-4 17:22 | 只看该作者
稍作一點贅述...  Y9 S+ Q7 j& r4 J8 N( z8 h( g
1) 在系統總體設計之初, 進行關鍵信號分析: 如I/O, 連接器選型4 n2 o0 B' R# T, ?+ V7 c# n( E7 s& f
2) 在原圖設計中, 根據信號完整性問題的起源和減小這些問題的總體仿真, 給出布綫的指導規則, 并設計噪聲与時序裕量
7 p% y- e  a7 h$ @5 c3) 在布局与物理實現時, 進行時序和拓扑結構設計, 端子調整, 串擾, 反射, SSN分析与仿真. Q% Z! l' A( K6 P" w( @
4) 在完成布局後, 進行系統級仿真驗證
& _9 a: ^3 J7 s" o: p4 D, I7 Y" t1 u+ M
Cousins的意思是1)能去掉?

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发表于 2014-4-2 20:44 | 只看该作者
布线前怎么做SI,相当考验功力的一件事,初学者还是先做好后仿真吧,一步一步来,这种事急不得!

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 楼主| 发表于 2014-3-5 15:02 | 只看该作者
Cousins說得非常有道理...) f( \' i0 j5 j6 H# G5 J+ Z  L; p, [3 p
我會盡量學起來的!
, j9 y6 g) s& d1 ]. H3 V9 e6 s7 j, p( ~9 @* Z! u
感謝!

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发表于 2014-3-5 12:28 | 只看该作者
你的理由再充分也没用,公司有自己的考量,不会为了你一个人的意见改变大局,除非你的在公司影响力够大。多做一段时间吧,只有碰到问题才能证明你的观点。没有碰到问题的话,那就把设计规则总结起来,也是宝贵的知识。
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 楼主| 发表于 2014-3-5 06:44 | 只看该作者
可惜沒有呢... 都是新手入門, 能否分享一下為何得一起做Pre和Post, 而且缺一不可的一些有力的理由...& d% H2 d/ Q: K, E" n- r
如果有實例分享, 小弟實在無以為報了....

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发表于 2014-3-4 19:40 | 只看该作者
只要你们公司有自己的技术沉淀,跳过是可以的
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 楼主| 发表于 2014-3-4 18:07 | 只看该作者
可我公司想直接跳過pre啊... 我又沒能力說服...* W7 ^1 ?; y9 K$ S& I" v

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发表于 2014-3-4 17:59 | 只看该作者
我可没说能去掉。
4 I( J1 x- e" {9 z  @0 b- U! F8 K4 _我的意思是post所做部分是实际模型的pre,pre则为理想拓补加模型。post所做的内容和pre是一个包含的关系。6 \# I# W( y4 S* C- u4 z6 k2 W
至于完整的设计递进流程,是肯定要做pre的,pre能生成初期的布线约束。( x# g5 B6 J$ R8 ]

8 x9 a- h# J3 C: M8 Y
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 楼主| 发表于 2014-3-4 17:10 | 只看该作者
成熟的高速通道如DDR, PCIe等等

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 楼主| 发表于 2014-3-4 17:09 | 只看该作者
我上傳了一個圖, 希望能更好得表達我的意思../ u6 w  w$ @' v$ t  s. M7 O

: S$ q" w! O, N: `" ~2 M5 _按照cousins的意思, 成熟的高速通道設計不需要遵循一般的設計流程而直接跳到post分析?$ ]- i1 T6 r6 _$ N- J
還望指教...

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发表于 2014-3-4 16:22 | 只看该作者
当然可以2 [( T6 R5 c3 ?+ N4 a. a/ X
pre是layout前布局拓补加布线约束分析
4 A; L3 q: V; B9 ?post是都完成后的分析,准确度更高- O& H$ M8 Y* G: O/ J- e$ _
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 楼主| 发表于 2014-3-4 16:17 | 只看该作者
弱弱地問一下, 那沒有了pre的話, post能成立嗎??
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