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音频芯片的SDA和SCL接上拉电阻?

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发表于 2013-11-6 20:48 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式

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前边接的22.1Ω的电阻是限流的吗?那为什么又接上拉电阻呢,不是又拉高了,还是我理解错了?请高人指点

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发表于 2013-11-8 22:18 | 只看该作者
weihuaping118 发表于 2013-11-8 00:56
. B$ v0 q* f6 u1 q( g/ [* b唉,这么多的鸟,版主也不解释下,呵呵。现在太晚了,睡觉了

) J: U' h# C' `/ C. P% n呵呵,这个要了解I2C通讯的本质是什么!或者串口通讯等,做为保护IO的作用,准确说是限流,还有就是对信号的上升边沿有所平滑,准确说是消过冲,阻值不能过大,不然会和I2c的总线电容形成RC滤波,那样就成了积分电路了,也就是三角波,总线通讯就错误了,呵呵,7 H  w' E/ m0 f
% m8 t" ]  D' S% m6 v/ b8 x' S% i
在下随口说一下;我觉得很多人总是一上来就问人,这样的学习方式不太好,首先要自己摸索了,实在不懂才问,要问就要问出意义所在嘛,简单的随便说下,没有人会愿意回答的,什么是高手?高手都是解决高水平的问题或者是比较有技术的,不是这样问问题的呢,我觉得哈,这样问的结果就是告诉你加了总比不加好,呵呵,满意吗?个人觉得没有啥意义。不知道有人赞同不。

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发表于 2014-2-7 17:34 | 只看该作者
I2C 規範上的說明︰/ s7 s$ X+ {3 D% C- [! O4 x

7 F. n/ a. P5 ]$ G( t" vRp min is shown in Fig.37. The required noise mrgin of 0.1VDD for the LOW level, limits the maximum value of Rs. Rs max as a function of Rp is shown in Fig.38. The bus capacitance is the total capacitance of wire, connections and pins. This capacitance limits the maximum value of Rp due to the specified rise time. Fig.39 shows Rp max as a function of bus capacitance. The maximum HIGH level input current of each input/output connection has a specified maximum value of 10 mA. Due to the required noise margin of 0.2 VDD for the HIGH level, this input current limits the maximum value of Rp. This limit depends on VDD. The total HIGH level input current is shown as a function of Rp max in Fig.40.- W& Y3 t& V# V' B( i: X5 N2 O5 Z

9 }4 U& r' Q" X, Z( ]- [& m1 _) J: i! O; r$ I
Series resistors Rs are optional. They protect the I/O stages of the I2C-bus devices from high-voltage spikes on the bus lines, and minimize crosstalk and undershoot of the bus line signals. The maximum value of Rs is determined by the maximum permitted voltage drop across this resistor when the bus line is switched to the LOW level in order to switch off Rp2.& _5 N6 b2 m$ `  K6 M) s. C0 x

: \; B7 ^) d  m# Y/ i- ?1 A

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正解  发表于 2014-2-8 12:37
哈士奇是一種連主人都咬的爛狗!

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发表于 2014-2-7 15:24 | 只看该作者
其實 I2C 的規範都有寫啦!
, C, G7 k' X7 _) t# p4 E  g* s0 _5 r7 c% v0 C# M/ B

I2C Rs and Rp.jpg (313.79 KB, 下载次数: 24)

I2C Rs and Rp.jpg
哈士奇是一種連主人都咬的爛狗!

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发表于 2015-6-5 14:45 | 只看该作者
学习学习

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发表于 2015-5-26 18:05 | 只看该作者
感謝分享~~

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发表于 2015-5-15 17:53 | 只看该作者
根据I2C协议规定:上拉电阻最大值由总线负载电容决定,最小值由输出低电平允许最高输出决定,串联电阻为了防止浪涌损坏器件,串联电阻最大值由输入高电平允许最低输出决定。

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发表于 2015-5-15 10:15 | 只看该作者
本帖最后由 北漂的木木 于 2015-5-15 10:20 编辑 6 m  \9 |1 }/ J- I! [
tgwfcc 发表于 2013-11-7 09:34
& f/ i3 w5 k/ w) b楼上的我信哪个呢?一个说抑制反射,一个说为了调试?
- U. X0 C' x6 U4 x* `1 Y, ?
22.1的电阻是EMC的措施,起到缓冲作用。不是为了调试。- J) Q  n; {3 X
不要痴迷于阅读成功人士的传记,从中寻找经验,这些书大部分经过了精致的包装,没有人会随随便便成功。更不要痴迷哥,哥还没成功!

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发表于 2015-5-15 10:07 | 只看该作者
jacklee_47pn 发表于 2013-11-7 09:52
" V( o# ]" n- |+ P4 l" C3 }"为了放反射" ???  d4 K- U- Z+ }8 M$ }+ C7 Z

0 Y7 K2 c2 @% Q1 L0 I8 z, U速度要達到 《數十MHz》 等級以上才會發生嚴重的反射問題,I2C 通常最快也只有 《400K ...
- [9 |% ^$ Q4 {) q; u
I2C虽然低速,但通常是一驱多,如果仿真或测试过菊花链电路就会发现,回沟和振铃是很常见的。对于事先没有仿真的同学来说,调节这两个电阻是重要的手段。但我一般把这两个电阻放在芯片侧,也就是芯片与上拉电阻之间
0 _' B$ a' e! g

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发表于 2015-5-14 22:46 | 只看该作者
I2C的是OC门输出,你google下OC output就理解了。% u; [8 B' a# o6 M& i/ a: b7 t

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 楼主| 发表于 2014-3-25 18:01 | 只看该作者
byj922 发表于 2014-3-25 16:06
' u! T; X( s& J6 e. `4 t. N上拉电阻是必需的,我还没见过不需要上拉电阻的I2C电路。至于上拉阻值多大,则取决于速率和接口的输入电容 ...
* `4 d( O3 G3 ^7 i/ K" z2 O; l
恩 ,多谢

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发表于 2014-3-25 16:06 | 只看该作者
上拉电阻是必需的,我还没见过不需要上拉电阻的I2C电路。至于上拉阻值多大,则取决于速率和接口的输入电容大小,一般上拉的电阻在1.5K~4.7K之间。串联电阻不是必需的,但有的人出于EMI考虑,或是为了电平匹配,就串联一个电阻,这样有调整的余地,不用的话就贴0R,反正没有坏处。

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发表于 2014-2-10 17:14 | 只看该作者
jacklee_47pn 发表于 2013-11-7 09:524 ]* W3 o- a# k% Z3 s4 B3 I6 L
"为了放反射" ???; x* r5 l  E$ e: b
* B) Q2 F# F% v' c
速度要達到 《數十MHz》 等級以上才會發生嚴重的反射問題,I2C 通常最快也只有 《400K ...
; K, g! ?, Q8 i2 _* z. b! ?
高频信号不等于高速信号,只要是高速信号,就需要考虑SI

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发表于 2014-2-8 08:43 | 只看该作者
串联电阻R是可选的。他们保护总线上的高电压尖峰的I2C总线器件以防损坏。

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发表于 2014-2-7 13:49 | 只看该作者
如果确实要去查找I2C中的电阻的话,那么I2C中电阻确实也有一定的要求,一般I2C的上拉电阻计算如下:
; N: C, Z+ Z/ h9 ?3 g; \! x/ ERmin=(VDD-0.4)V/3mA,(这里注意下单位),* c( {3 q5 G* t9 p( g2 Z: G& d
Rmax =(T/0.874)*C,   (T为总线一个周期时间,C为总线上的负载电容,一般为300pF)

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发表于 2013-12-11 17:26 | 只看该作者
其实一般应用可以不接的22欧的,这样做就是楼上说的抑制反射,这样对EMC很有用。。
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