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请教jimmy老师 很急在线等

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发表于 2013-2-21 11:03 | 只看该作者 |只看大图 回帖奖励 |正序浏览 |阅读模式

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DDR2 等长           clock 1453mil                      DQS and DQ 1250~1300mil                      ADD and ctl 1580~1951mil# G4 H6 P8 l. j6 R
顶层DDR2布线的周围做keepout处理了
5 b4 h2 j$ z2 }5 {5 F" Z1 z这种能跑到1G的要求吗?

QQ截图20130221104559.png (62.51 KB, 下载次数: 1)

QQ截图20130221104559.png

点评

我给楼主几点建议: 1.上版频率多高?2.串阻位置有无问题;3.时钟终端匹配有吗?4.你给的信息太少,频率不仅仅是走线、等长,stackup,电源的处理,屏蔽,有无高低温等都需要关注。  发表于 2013-2-25 17:08
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发表于 2013-2-21 11:48 | 只看该作者
chuxuepcb 发表于 2013-2-21 11:31
& [: Z* m# b. V" i以前的人画的图是这样的,走线方式和我的不一样什么方向的都有,我想问问我们那种走线方式比较好呢? 3 b1 l4 f+ h7 N  H4 e
' g% b3 F. S+ G2 j
...

. Z& A, _9 k- y% z- S2 @你以前的同事充分利用了空间。走线方式比你的要好。
专业服务:(价格面议)
代写作业
拉等长
调丝印
喂猪
欺负同学
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 楼主| 发表于 2013-2-21 11:31 | 只看该作者
jimmy 发表于 2013-2-21 11:23 9 X& n6 o: |& h+ A  m1 X
如果你想万无一失的话,就将误差控制再严格一点:# p* H) t# L; [/ w4 r' K
DDR2 等长:  i- N: Z4 S0 R4 ~. V
clock 1453mil                      DQS  ...

# R  v' \6 ]! n1 k以前的人画的图是这样的,走线方式和我的不一样什么方向的都有,我想问问我们那种走线方式比较好呢? ! [+ M( ?' p0 ~. T/ p; c$ {
2 \8 n: L/ j$ L% {* }; i

8 [5 n1 [1 A6 b7 ~) X5 f: l; l$ W8 f" I) y+ O1 [9 b
8 }; F( Y3 o5 g5 y8 v0 |3 j

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发表于 2013-2-21 11:23 | 只看该作者
如果你想万无一失的话,就将误差控制再严格一点:
' l' T" D& Q+ x& _. g' F; w! ^DDR2 等长:
1 d, N# f# O5 i& C- Mclock 1453mil                      DQS and DQ 1250~1300mil                      ADD and ctl 1580~1951mil0
1 c  Y9 ^! z; ]* t4 S) ?3 k6 ^4 J$ A+ v5 D5 d' ]; o( Q2 ~
改成:
: d; [/ f! U8 x& O
+ s2 e, p. R: P; A  f4 r2 Uclock 1580mil                      DQS and DQ 1530~1580mil                      ADD and ctl 1580~1951mil04 m/ N6 D8 }  v/ A7 e* m
专业服务:(价格面议)
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拉等长
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