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导入网络表问题

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发表于 2008-3-18 13:29 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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请高手解答一下我这个问题,就是我在ORCAD里产生网络表有:pstxnet.dat   pstxprt.dat  pstchip.dat三个文件,
+ G: \9 q  `8 J& c* `; g! R9 a由于我是新手,所以在导入到PCB时就不知措了,因以前一直用的是PADS,所以好多习惯都改不过来,总以为导网表! r6 s: U: B; ^/ v
都是差不多的,但没想到ALLEGRO这么多步骤,烦请教各位高手解答,谢谢!

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发表于 2009-7-9 12:40 | 只看该作者
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- Y0 q) ?6 w5 \; M2 U$ \导进去什么都没有,用viewlog查看提示以下错误,是怎么回事啊?& ]0 ~$ x$ `0 H+ a$ [

" c0 u8 C8 p& E2 v$ ^9 c. Q$ B6 ZCadence Design Systems, Inc. netrev 15.5 Thu Jul 09 11:25:57 2009. n, o: X! _4 D7 ?
(C) Copyright 2002 Cadence Design Systems, Inc.
0 h1 ]5 d8 i& j% U6 s  H" ~' F------ Directives ------6 P6 }3 H3 b0 X, f+ D
RIPUP_ETCH FALSE;
) \' u7 N: C! `  l' uRIPUP_SYMBOLS ALWAYS;
1 S& l* w7 ~" T- j* o8 T/ m  BMISSING SYMBOL AS ERROR FALSE;
) V# m' Q" l# y! g" @$ [6 R( tSCHEMATIC_DIRECTORY 'C:/Documents and Settings/Administrator/桌面/现场信息记录仪资料09.4.19/Project';' `! u8 x0 I/ ~4 y5 n$ F% T
BOARD_DIRECTORY '';. f- g" T" _4 J0 d* l
OLD_BOARD_NAME 'C:/Documents and Settings/Administrator/桌面/现场信息记录仪资料09.4.19/Project/cmos原理图/allegro/mt9d111.brd';
+ F7 O4 e5 c+ D) BNEW_BOARD_NAME 'C:/Documents and Settings/Administrator/桌面/现场信息记录仪资料09.4.19/Project/cmos原理图/allegro/mt9d111.brd';/ v4 D- C& s  }$ h0 p* ~% l4 q
CmdLine: netrev -$ -5 -i C:/Documents and Settings/Administrator/桌面/现场信息记录仪资料09.4.19/Project -y 1 C:/Documents and Settings/Administrator/桌面/现场信息记录仪资料09.4.19/Project/cmos原理图/allegro/#Taaaaaa03240.tmp& Z2 i4 ]( A& l6 {. R6 I; C
------ Preparing to read pst files ------
8 Y9 t$ _: p  |( v6 P- o2 p1 o9 }- J8 u1 u& k' v/ G6 z8 d
#1   ERROR(24) File not found
$ x% J: D1 K% S- L" U+ [$ p% E: E9 p" p     Packager files not found* X) r* R- i; |# Z: i
#2   ERROR(102) Run stopped because errors were detected* Z3 L. k  K" j5 a, x0 v
netrev run on Jul 9 11:25:57 2009
* B0 x. f/ p3 ^3 R+ R) f   COMPILE 'logic'! T. M; H, k, X$ J9 i3 J
   CHECK_PIN_NAMES OFF0 I& G' X" f3 u) T5 A- \  v, f$ ^2 v
   CROSS_REFERENCE OFF% t; n9 l5 q3 v$ ]8 E: b
   FEEDBACK OFF
* D, s" l  s1 G4 w. r   INCREMENTAL OFF( b# i2 Y+ n2 V
   INTERFACE_TYPE PHYSICAL8 a: P5 m9 q. |+ U9 N: \& |
   MAX_ERRORS 500
' t- K& t3 F! W1 J' C   MERGE_MINIMUM 5
  f8 r) L! w2 L/ }4 ?8 z6 T   NET_NAME_CHARS '#%&()*+-./:=>?@[]^_`|'
( h7 _4 d# z4 g* S   NET_NAME_LENGTH 242 D  L5 w& i5 k; m3 g8 @
   OVERSIGHTS ON, D9 e3 s  Y: g6 X5 s( o1 W7 `8 S
   REPLACE_CHECK OFF
0 w! E, g. a; J; ~" v- ~0 a   SINGLE_NODE_NETS ON
( F$ g% P. L; X# _8 t5 v) _   SPLIT_MINIMUM 07 V/ v# ]$ G+ A( i
   SUPPRESS   20
) ]% J& X* k8 L5 E0 J* t. I6 ?   WARNINGS ON1 X) Q# T& N' i9 D0 s! M
  2 errors detected. N; e  }' Z5 S% {% G* |
No oversight detected1 u0 {* M& r1 n0 W
No warning detected- s( B- t% i. u( [0 ^1 y7 F8 t# D! S
cpu time      0:00:044 U8 B4 A  b2 n: z
elapsed time  0:00:00

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发表于 2009-6-23 18:15 | 只看该作者
我也没搞明白呀,烦

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发表于 2008-11-14 08:06 | 只看该作者
Cadence导出的文件就是有那三个,分别对应了零件的封装形式等

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发表于 2008-11-14 08:04 | 只看该作者
3楼的说的对,就是那样倒,倒进去是看不到零件的,再点Place-Quickplace,摆放零件就看见了

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发表于 2008-11-13 19:54 | 只看该作者
我看到的是txt文件!

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发表于 2008-11-13 19:53 | 只看该作者

tel????

需要设置什么才可以生成tel文件?
Allen 该用户已被删除
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发表于 2008-3-19 22:29 | 只看该作者
提示: 作者被禁止或删除 内容自动屏蔽

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发表于 2008-3-19 20:35 | 只看该作者
记得大约在10年前在生成网表的选项上是选取telisis格式就可以生成tel文件了。

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发表于 2008-3-18 15:18 | 只看该作者
我一上来学的就是这个,感觉也头大.
6 A& ~- }8 G: o: v; K4 g0 |! X3 s才学了一个月,就让 我画六层板.差不多要崩溃了

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 楼主| 发表于 2008-3-18 15:15 | 只看该作者
哎,是不是用习惯了PADS再学这个感觉很难啊,感觉和以前的思路大不一样,有没有初学者有同样的感受啊

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发表于 2008-3-18 15:07 | 只看该作者
封装要自己再拖进来的,你看下file-viewlog
) V3 m" q, v! _" [7 Z若没有错误,就说明已经导入了) z& g, d+ F/ H6 l
place-manually里可以手工摆放元件

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 楼主| 发表于 2008-3-18 15:01 | 只看该作者
原帖由 kxx27 于 2008-3-18 14:42 发表
0 c. {; I/ m5 a! B* n可能是你的原理图或BRD档有问题根本就没办法导,先检查一下吧。记得这个问题在本论坛里有讨论过,请楼主仔细找找相关贴子也许有收获。
  l, q# g! E9 S. |. _1 f4 W

( i) N7 B' j# M现在可以了,刚才是我的路径没设置好,但是现在通过你刚才说的那种方法打开的PCB里面却什么东东也没有,是不是我的
8 z7 H+ V7 @7 k6 o  K2 k- GPCB封装库没有加载进去?

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发表于 2008-3-18 14:46 | 只看该作者
奇怪了,我的可以啊: Y% C* r! }. q: \/ m
不过试了下,要在cadence选项下按import cadence才可以,不然也报错.不知道是什么原因
kxx27 该用户已被删除
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发表于 2008-3-18 14:42 | 只看该作者
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