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Allegro导入网表到PCB中所需文件?

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发表于 2009-3-26 09:36 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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从capture生成网络表,导入到ALLEGRO PCB中,需要准备哪些文件?
+ A' ^: O) o7 f1 n5 ?$ n+ J5 I  A: O5 d+ G- H
在进入Allegro PCB中进行Place Manually时,Components by refdes、package symbols、mechanical symbols这些菜单下什么都没有,是怎么回事?
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发表于 2009-3-27 15:53 | 只看该作者
每一次用到不同的器件,都得重做封装?
- C. Q) @3 M' ?' l) d如果不重做,哪里能知道库里哪些pads有,哪些footprint和pads又没有呢
% y: T3 A9 c! v1 K% d7 csslxr 发表于 2009-3-27 14:35

! k/ I0 N! `+ C6 ~$ v4 l& X每种独立的footprint都要有独立的封装,如果你没有自己的封装库,请用系统自带的元件库画图,那基本上只调用自带的封装库。

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发表于 2009-3-27 14:58 | 只看该作者
Error会有提示呀,出错的就代表你没有

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 楼主| 发表于 2009-3-27 14:35 | 只看该作者
每一次用到不同的器件,都得重做封装?
2 x2 ~8 }( s' @, L, q如果不重做,哪里能知道库里哪些pads有,哪些footprint和pads又没有呢
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 楼主| 发表于 2009-3-27 14:33 | 只看该作者
怀疑库你都没有  路径也没设置
2 R  u" Z. N3 ~5 k6 x4 ^superlish 发表于 2009-3-26 19:44
" s/ Y; k% Q9 Y* V" o- K  g
+ W. F$ x& r; D+ r7 X* m0 p0 p
难道每画一次原理图,都得建一次footprint吗?
; P- W1 D% O$ F- u0 dfootprint和pads从哪里调入,怎么用原有的footprint将capture和Allegro PCB建立联系呢?
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发表于 2009-3-26 19:44 | 只看该作者
怀疑库你都没有  路径也没设置

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 楼主| 发表于 2009-3-26 16:19 | 只看该作者
看下session log,里面会有提示。3 A2 d! k8 i' f8 ~2 j/ O/ r
deargds 发表于 2009-3-26 15:42

: B3 w4 ~/ b! P. v% {" N$ z恩,提示以下信息:2 N1 ?. l1 ]5 ^
#1 Error   [ALG0012] Property "PCB Footprint" missing from instance U3A: HALFADD, HALFADD (3.30, 2.20).
) b2 R5 W1 w' L0 z% k% |1 g& j, \. n( t/ i1 H# L/ N

3 {- H. [; W+ W( L; J% C$ N( U
3 D# E( `5 K# a# M( E6 @- E#13 Error   [ALG0012] Property "PCB Footprint" missing from instance U2D: HALFADD, HALFADD (4.30, 1.80).$ q* D4 m4 {3 V8 }3 F) t; ~
#14 Aborting Netlisting... Please correct the above errors and retry.7 J, N8 [: x$ @+ w  I" G

( M2 D4 _9 o' ~, N问题在于create a netlist之前,you must ensure that all the Allegro PCB Editor footprints are in path
+ X2 E2 p) Z8 h! Q怎样将Footprint in path呢?
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发表于 2009-3-26 15:42 | 只看该作者
看下session log,里面会有提示。
谁画出这天地 又画下我和你

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 楼主| 发表于 2009-3-26 11:34 | 只看该作者
是因为缺失了什么步骤(比如什么文件之前要先准备好的,我没有做)导致的吗?" i& u7 W/ X4 c& C8 g* J' o
我的原理图是系统自带的,直接调出来,想试验它与PCB之间怎么链接的
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 楼主| 发表于 2009-3-26 11:12 | 只看该作者
我在原理图里选用的Cadence-Allegro功能,(直接跳转到打开Allegro PCB界面),3 m7 ^7 C) z2 S5 Q6 G, @$ j
在progress
& U: n$ u; m% F9 P8 fnetlisting the design+ T7 D4 y# W) r2 G! B8 ~: C5 `9 l( Z0 a
updating Allegro PCB Editor Board过程中提示
$ ^' |  l# q0 w0 [# Qerror:
, ~/ V, X4 g4 v( N; W: ^Netlist failed! F+ b) Z* o4 ]* p8 R9 n5 d
Please refer to session log or netlist log for details
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发表于 2009-3-26 10:37 | 只看该作者
那 你是不是网表没有导成功啊

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 楼主| 发表于 2009-3-26 10:08 | 只看该作者
library勾上了,但是只有库元件,Placement List下的Components by refdes还是空的
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发表于 2009-3-26 09:53 | 只看该作者
要把library勾上
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