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[仿真讨论] DDR4减小信号延迟时间,是增加还是减小DK值

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发表于 2017-1-6 08:14 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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DDR4设计时,如果要减小信号延迟时间,在布线不变的情况下,是增加基板的DK值还是减小DK值???
- x- f9 I* t9 ^* i! w) I6 G8 ?
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发表于 2018-7-16 18:39 | 只看该作者
嗯,是的

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发表于 2018-1-15 13:25 | 只看该作者
:):):):):):)

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发表于 2017-4-9 10:27 | 只看该作者
减小DK值,传播速度增加,延时减小

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发表于 2017-4-6 17:43 | 只看该作者
了解微带线和带状线的区别就知道了,应该减小DK,信号传输速率才快

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发表于 2017-3-29 17:19 | 只看该作者
这个是一个比较复杂的问题,如果是从理论上存数学的分析的话,延时减小,相应dk也减小,信号传输速度变快,但是对于同一个设计,不能仅仅的只改变介质来解决,因为改变介质后其他设计不变 的话会带来更多的信号完整性问题,这样实际的延时可能由于信号完整性问题反而增加,纯粹提醒下

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发表于 2017-3-24 16:20 | 只看该作者
dk越小,带来信号在介质中传输速率变大。

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发表于 2017-1-11 10:18 | 只看该作者
tencome 发表于 2017-1-11 09:50
' D$ U) ?/ ^. {这个公式是经验公式?
0 d4 W* h% r1 i* \2 u
- U/ F( J) M3 k$ g% M& p( \: n减少延迟,就增加DK吧。
& f$ T* \' B* K, c- {
对啊 经验公式 减小传输延迟不就是要增大传输速率吗,减小dk吧
, r8 ?4 W0 O) O  ~

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 楼主| 发表于 2017-1-11 09:50 | 只看该作者
banrx 发表于 2017-1-6 14:33
2 Y) T' k2 Y9 [/ `+ V& b5 b失误 写错了 减小dk
& [& j0 L% f+ X% [- h0 q/ U; }
这个公式是经验公式?1 ?# `2 }" S1 `; X9 k5 x- r
" v/ ]' z" x  R3 m& D1 g" y0 o% o
减少延迟,就增加DK吧。$ w7 o4 q* [3 |* [, o% |8 G* [

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对啊 经验公式 减小传输延迟不就是要增大传输速率吗,减小dk吧  详情 回复 发表于 2017-1-11 10:18

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发表于 2017-1-6 14:33 | 只看该作者
banrx 发表于 2017-1-6 14:32, u; g& D$ Q( _' J: K$ P& F
传输速度约等于C/(sqrt(dk)),所以减小延迟,增大dk
( l: S5 B0 C& {) z0 H! B& O
失误 写错了 减小dk" C' b9 H& r$ N3 p0 _8 e! T' ^

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这个公式是经验公式? 减少延迟,就增加DK吧。  详情 回复 发表于 2017-1-11 09:50

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发表于 2017-1-6 14:32 | 只看该作者
传输速度约等于C/(sqrt(dk)),所以减小延迟,增大dk

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失误 写错了 减小dk  详情 回复 发表于 2017-1-6 14:33
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