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请教一些仿真的问题

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发表于 2008-11-4 16:16 | 只看该作者 回帖奖励 |正序浏览 |阅读模式

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最近刚开始学习PCB仿真,遇到很多不懂的地方,特来请教各位大虾~
( N9 {- V  r% Z# V3 p9 G$ a* L/ d) L5 Z8 X# w
1.信号的过冲和下冲:0 z9 b! ^; x. w0 h1 O
假设是一个3.3V电压工作的芯片,那么输入高电平信号VIH的MAX值一般是VDD+0.3V,在芯片的DATASHEET中有时候有附加说明允许小于3ns的5V多的脉冲,那么信号的正向过冲允许值应该是3.6V还是3.9V(电源范围3~3.6V)还是5V多的那个值?
1 A- T+ [/ \4 g" V/ m& y下冲的要求是不是以不跨越阀值为标准?# P. [- ], D4 j2 q& o9 b
$ Z, ^3 T; y5 f: Y
2.时序问题:
( `, T  D; ]6 S. \- h7 E( GSDRAM的时钟信号一般是从ARM或FPGA等CPU芯片提供,而CPU芯片的时钟又是由晶振或钟振提供,那么提供给SDRAM的时钟和CPU的时钟是什么关系呢?两者之间有延时吗?
2 o: m" J8 ]0 {' l8 Y# H& w+ _1 y( k; g( x( X$ {) ~
用HyperLynx仿真得到时钟信号驱动端的波形里能看出来Tco吗?驱动端到接收端的Tflight多少才是合格的呢?  f% B- z$ [% b$ A8 C. e

5 j: C- X' e1 X$ D- t数据总线和地址总线的延时多少才是合格呢?是要建立时间裕量和保持时间裕量大于0就可以吗?
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 楼主| 发表于 2008-11-6 09:27 | 只看该作者
谢谢两位斑竹的解答~

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发表于 2008-11-5 20:34 | 只看该作者
hyperlynx所能得到的就是buffer delay。( k* g# U7 m' \8 p
Tco是由包含内部逻辑延时的。IBIS反映的只有buffer信息。
! ?! a6 N) J0 n; p9 r9 ], p/ Y/ b; p不仅hyperlynx不能仿真出Tco,其他SI仿真工具也不行
. i9 }  D5 I' z, A当然如果你有spice模型就可以得到Tco。而芯片厂商提供的Tco参数是通过实际测试校准得到的。
sagarmatha

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发表于 2008-11-4 18:08 | 只看该作者
假设是一个3.3V电压工作的芯片,那么输入高电平信号VIH的MAX值一般是VDD+0.3V,在芯片的DATASHEET中有时候有附加说明允许小于3ns的5V多的脉冲,那么信号的正向过冲允许值应该是3.6V还是3.9V(电源范围3~3.6V)还是5V多的那个值?:( @- d8 P8 ^' T0 _
电平*时间的这种约束的芯片比较少,通常可以按照这个来约束,一般DDR会这样说的。
4 m0 l, {( H5 M8 t. s- V0 L6 {+ L) w" H4 G: W
那么提供给SDRAM的时钟和CPU的时钟是什么关系呢?两者之间有延时吗?
0 U- e. \1 V& w0 Z:这个给SDRAM的时钟,通常是CPU倍频得到的,就是CPU的系统时钟过一个PLL得到的。
/ v4 h- |& |$ P# R) }( n! G
: |  H- q1 _+ U8 C& P% B, w6 b" Z- s3 d " j, Q) v3 G. C0 D
用HyperLynx仿真得到时钟信号驱动端的波形里能看出来Tco吗?: 不能看出来,这个是做信号质量,不是时序分析。* A1 P# ~/ V$ R  I$ l( J; K" r
$ ]. ~1 L7 [; S/ R# l, F
3 ?" H5 ?  E8 x
驱动端到接收端的Tflight多少才是合格的呢?这个看你的时钟和数据的关系。
1 S; @/ H( I# m6 {5 F
8 M) X% f, e" }- n& X% f. U   J6 n# Y7 D% m' z5 n
数据总线和地址总线的延时多少才是合格呢?是要建立时间裕量和保持时间裕量大于0就可以吗? :这个你要仔细看手册,就是的D触发器采样的基本原理。余量可以等于0.
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