晶振两根线走线那个更优，为什么？

zhangjunxuan21 · 发表于 2014-8-20 11:38

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如图所示有两种方式的走线，有个客户支持走方式2最短走线，我个人支持方式1 耦合抗干扰，大家说说你们这个两根线是怎么走的

感觉不是振荡器都随便做包个地好像就那样了

defir · 发表于 2014-8-22 12:15

这段文字能说明问题吧？

Tonyjje · 发表于 2015-6-15 14:44

晶振信号的性质本身就不是差分信号，一般情况下没有必要要做差分处理。

zhangjunxuan21 · 发表于 2015-4-8 09:45

看大家这么热烈的讨论改问题，分享一份厂家推荐晶振的layout指导内容，虽说没有说明哪种方式更好，但是依然有些可以借鉴的地方，大家可以分享更好的资料，希望该贴有个比较专业的回答

willyeing · 发表于 2014-9-2 12:07

晶振2个pin的信号相差180度，所以要类差分线处理最好。走线要短。线宽没有多少要求。

yaoyanzhen · 发表于 2014-8-22 10:02

学习了！谢谢！

祭司 · 发表于 2014-8-20 18:08

本来就已经那么短了,你们那客户就是太拿自己当人看了,出来得瑟得瑟

eddiemoon · 发表于 2014-8-20 17:49

我不只很懂，但是觉得2方案好点吧，你说的耦合抗干扰本身就有问题，时钟本身就是噪声源，何来抗干扰之说，一般查分信号线才需要抗干扰，其实我看两种都可以工作，但是2比较好一点。

wistful555 · 发表于 2017-11-1 10:20

学习了。。。

lihaidexihongsh · 发表于 2017-8-18 17:27

TI 板子，AM437X_SK_EVM_3K009_REV1_2A,晶振布线，差分走线，然后顶层，邻层分割GND

芦苇飘_epOTM · 发表于 2017-7-12 11:39

学习啦

chenxiumei · 发表于 2017-3-31 11:18

必须留名，我是 jacky

1057773277 · 发表于 2016-3-15 00:14

学习了！谢谢！

myl593799546 · 发表于 2015-10-15 15:29

myeda_365 发表于 2015-6-11 17:51
9 k: W* ?, N: J$ f一楼一楼看下来，没有最终结论的，有条件可以实验一下最有说服力了。一致观点就是要尽量短，远离干扰，有源 ...

是啊，这里没看到layout版主来指导一下

zly8629481 · 发表于 2015-6-17 18:50

crystal，oscillator，傻傻分不清楚。

sushouchai@sina · 发表于 2015-6-16 09:07

感谢分享

LX0105 · 发表于 2015-6-15 11:31

好贴！

3dworld · 发表于 2015-6-12 11:59

wgp0241 发表于 2015-6-12 09:25
' D1 `# d2 g( v5 H9 O9 g我一般是采取折中的从晶振到电容直拉，从电容到ic走类差分

哈哈，还是你这个答复简单明了啊。

wgp0241 · 发表于 2015-6-12 09:25

我一般是采取折中的从晶振到电容直拉，从电容到ic走类差分

yaoq123456 · 发表于 2015-6-11 22:32

之前一直走第一种方式

myeda_365 · 发表于 2015-6-11 17:51

一楼一楼看下来，没有最终结论的，有条件可以实验一下最有说服力了。一致观点就是要尽量短，远离干扰，有源的，电源保持干净做好滤波。

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