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21D · 发表于 2014-8-7 12:21

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电源层3v3 的shape和GND的via 看上去已经短路了，这样在实际的做板的过程中有问题么？个人觉得没问题，因为GND via 有anti pad，所以shape在那个地方应该是被挖掉了吧？

Kae · 发表于 2014-8-7 13:14

电源层是正片的话这样是短路的，负片应该是没问题的

yangjinxing521 · 发表于 2014-8-7 13:18

改成动态就行了

kevin890505 · 发表于 2014-8-7 14:06

.........如果你的网络表示是没问题的，当然也应该是没问题的，那么大的DRC错误，那就是短路了撒。
如果要用静态的铜皮，也应该在PCB处理完成后再从动态转为静态，而且PCB完成后一定一定一定一定要检查status里面的项目，全绿才可以发板，当然有时候由于结构其他原因允许存在几个确定没问题的DRC。但是你这个图里面的绝对是不允许的