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allegro 16.2 在win7里导入网表的问题!

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发表于 2011-4-23 12:40 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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烦请有人给指导一下!
4 t+ j  h5 Q! _7 J3 ?9 r# }在原理图中DEC与生成NET LIST 都没有报错!  V; u8 z5 o7 L
小弟在这先行谢谢各位!
5 \7 R9 {& {2 @$ G# |如图:
, w5 F4 f1 Z1 G# z
; K5 A7 N0 R+ K4 d+ X

import logic netlist errors.JPG (52.67 KB, 下载次数: 4)

import logic netlist errors.JPG
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发表于 2013-8-22 23:02 | 只看该作者
已解决,是导入logic的时候最后Import directory路径设置不对,应该把路径设置到netlist所在的路径,也就原理图文件夹下allegro的路径。

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发表于 2013-8-22 22:28 | 只看该作者
还是没有解决。

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 楼主| 发表于 2011-4-25 09:09 | 只看该作者
本人已解决!

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发表于 2011-4-25 12:19 | 只看该作者
我的还不行,导入PCB,在勾选放置元件到板上,却看不到元件,等于放空气一样!~麻烦详细指点一下!

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 楼主| 发表于 2011-4-25 12:39 | 只看该作者
你可是把你的错误发上来看看好吧,我也是初学,我们一起搞,兴许都能够解决的!

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发表于 2011-5-1 14:05 | 只看该作者
Cadence Design Systems, Inc. netrev 16.0 Fri Apr 29 11:35:19 2011
* W2 i& p  a. h# _- T(C) Copyright 2002 Cadence Design Systems, Inc.
$ U7 d: L- z* `7 T+ N9 Y4 d7 O------ Directives ------6 @* I- e$ D! \- s
RIPUP_ETCH FALSE;
& Y$ ^% o4 k! |6 i$ ]RIPUP_SYMBOLS ALWAYS;$ W3 ^, e6 U8 T0 K. U, j, u) I
Missing symbol has error FALSE;
& k! V% ~& [5 SSCHEMATIC_DIRECTORY 'Z:/project/907/A1';& \& ~& m# M2 m- t, A1 O7 t
BOARD_DIRECTORY '';
# I9 J) f2 o7 o7 _. sOLD_BOARD_NAME '907.brd';% s0 N+ r, y! F2 g- S+ e! N
NEW_BOARD_NAME '907.brd';
: ]6 O9 J9 ]) p6 YCmdLine: netrev -$ -i Z:/project/907/A1'  -y 1  -z Z:/project/907/A1' /#Taaaaaa02688.tmp
* g* \, ]3 O& ^( _' R0 t: d4 {------ Preparing to read pst files ------- k- D+ c$ A* Z3 D6 i+ O
: I3 Y5 ~0 u& q
#1   ERROR(24) File not found9 _& u; F$ y( _+ t
     Packager files not found
, z* z4 Q7 m9 J9 c0 v" z#2   ERROR(102) Run stopped because errors were detected2 {/ i5 ]# c, M) N) X- A
netrev run on Apr 29 11:35:19 20110 f  ]& E* C& x! H3 R
   COMPILE 'logic'2 _( s( h2 f- _) e6 L$ y
   CHECK_PIN_NAMES OFF
6 C+ u& y5 O3 W; Q  Z   CROSS_REFERENCE OFF  u8 E8 ]8 w" v! A9 i- ]( R
   FEEDBACK OFF
8 _+ V8 S/ Z$ q   INCREMENTAL OFF5 k2 @4 o5 G1 j5 p0 n# ]
   INTERFACE_TYPE PHYSICAL0 i& I, ?, B; v/ K+ S
   MAX_ERRORS 500
& m1 D1 n8 N* n5 w: k& h4 t* G1 G! P- g   MERGE_MINIMUM 5
& k8 G# j" x9 H. L5 L   NET_NAME_CHARS '#%&()*+-./:=>?@[]^_`|'
1 C4 t. u1 Z$ @$ Q# \" y, H   NET_NAME_LENGTH 24
; A" s6 y( e0 f+ F+ C% @   OVERSIGHTS ON
& l+ n" }  V& F8 c) b/ g% d5 d   REPLACE_CHECK OFF
. I4 q7 f6 g% X( o* u   SINGLE_NODE_NETS ON
6 }4 t" i6 y" F8 }2 F; t   SPLIT_MINIMUM 0
9 d8 X  Q2 m/ l/ a" V   SUPPRESS   20; D4 J  b7 k  b
   WARNINGS ON4 Y" ^. H/ u2 _* r
  2 errors detected/ P/ I* ]& k) e: O
No oversight detected
) T* p* M! b; b, `. c8 T, \No warning detected6 \  |7 l7 W* a9 x8 \
cpu time      0:00:293 y) G- X4 c! S3 n# y6 w$ O) i
elapsed time  0:00:00
/ o% U4 I' t- b0 C6 B8 \( k, d3 {/ S! z4 F6 w
你好,上面是我将网表导入allegro时出错,情形和楼主的一样,到现在还没找到原因,希望楼主指点一下,谢谢!& j+ m, _3 p& w9 |0 }0 c
封装是我自己做的,PAD和PSM路径也都设置好了,就是网表无法导入allegro.

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 楼主| 发表于 2011-5-3 10:11 | 只看该作者
1、输出网表时有没有错;9 J; U5 d1 }' w- Z& s- ]6 w
2、输入网表时一错误,在file\viewlog里仔细查看;) e  N& f5 l% l6 A- Q
3、在TOOL里放置时,能否看到元件个数;* c! q- O1 K( d* [9 |3 n
4、在手动放置的时候,如出现问题,请查看输入命令窗口的提示。
+ g4 |5 @& i& o, ^8 Y+ |! b- _我就是这么做的!

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发表于 2011-6-8 18:27 | 只看该作者
请问楼主,如何解决的,你的Cadence在Win7下可以仿真吗??

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发表于 2011-6-8 19:23 | 只看该作者
这种问题如何解决。按照你说的方法去检查了。导入网络还是0原件,封装路径设置OK

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发表于 2011-11-15 10:37 | 只看该作者
求这个问题的解决方法。。。。谢谢。。。。

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发表于 2011-11-24 12:08 | 只看该作者
需要以管理员身份运行程序就可以

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发表于 2011-11-24 13:08 | 只看该作者
六楼的封装没有找到,看看是不是封装的路径不对,或者封装的焊盘不对,,又或是封装改名了之类的

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发表于 2012-6-19 23:45 | 只看该作者
封装的路径,封装的焊盘,封装命名不能用这些字符'#%&()*+-./:=>?@[]^_`|'( N( t:

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发表于 2012-6-19 23:52 | 只看该作者
可以强行导入看看,没有FLASH的过孔元件是放置不出来的,全部停在库里

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发表于 2012-11-26 15:33 | 只看该作者
你这个问题是怎么解决的呢?我的问题和你一样

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发表于 2012-11-26 16:02 | 只看该作者
请问下楼主的问题是怎么解决的呀烦请有人给指导一下!
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