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锁存器问题

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yuanle1013

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发表于 2013-6-7 20:25 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1、设计电路图如图所示；PC4以及PC6-9均为I/O口；& Y+ j4 Z; B, |, a* a1 ?0 i5 b0 P: Z: x4 `
2、测试中采用以下两种方式，Q0~Q4均输出4.5V；2 e# v! n' M+ g
    PC4（I/O）输出高电平选通锁存器，PC6~PC9均输出高电平，锁存器数据透传，输出均为1（此时为2.0V左右）' M8 p2 w$ m5 A& V& U
    第一种，采用万用表探测nOE引脚电压，Q0~Q4输出电压为4.5V左右；1 S( ^% g8 E9 b
    第二种，复位IC（PC4以及PC6~9复位后均默认输出0），Q0~Q4输出电压为4.5V左右；
5 k$ x2 F% Z0 I# l6 A( L3、大侠们，能帮小弟解释一下这两种情况么

锁存器.jpg (77.69 KB, 下载次数: 0)

锁存器.jpg
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yuanle1013

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 楼主| 发表于 2013-6-7 20:26 | 只看该作者
更正一下，是Q0~Q3这四个引脚输出为4.5V。Q4都没接{:soso_e113:}

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 楼主| 发表于 2013-6-8 10:54 | 只看该作者
有没有人晓得捏

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wangshilei

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发表于 2013-6-8 11:03 | 只看该作者
你输出有上拉也下拉是什么意思

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yuanle1013

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 楼主| 发表于 2013-6-9 08:23 | 只看该作者
wangshilei 发表于 2013-6-8 11:03
8 j1 J0 g- {' P5 D' A. \. B  ]你输出有上拉也下拉是什么意思
# r1 v2 d- i! t
下拉电阻是预留调试用的，跟那个问题没多大关系吧

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