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用allegro快2年了,积累的一些问题,与大家共勉
( M ~3 G. v' X9 P g& `7 m1,铺shape后最好当时要修好,要不然最后会修死人,而且不一定每个都修道,(曾经出过N多viod的shape,被骂,从此牢记)4 l0 u! q: `# b2 m4 H
2,导入outliine以后,删除idf_owner的属性,要不然根据outline做的anti-etch,soldmask,panel等在重新导入emn后会全部飞掉。! f/ E; @/ y. ~$ Z4 \! R
3,在subdrawingBGA或者IC之类的零件的时候,我们show element做的list会包含诸如U1.CI,U1.R11等pin脚的属性,在用list导入零件的时候会将所有C1,R11之类的零件全部导入。解决的办法是将list吃到excel,筛选出只有RefDes的list,
- Y( M2 p6 o* u2 V6 v4,移动零件的时候,鼠线不见了,勾选Ripup etch或者全部不选可以解决这个问题
3 n, M5 `5 j8 K/ E/ Q; b5,在用move/mirror geomerty的时候勾选userpick,不然达不到mirror的目的,
. m. H! D2 Z5 Z- L6,在gnd做anti-etch时候选用45°角画anti-etch,即使他是方形的,如果用90°画,最后铺出的shape在拐角的地方也会是90°4 z( }0 l9 A h, H6 Y; s
7,排文字的时候需要要用到字母,为了避免使用过程中重复使用,最好将字母一字排开,再一个一个使用,不过最后记得要把版外没用的字母删除。特别记住这些文字在bottom层的时候要mirror( _. T" |8 \1 Z7 {6 m% s9 S/ c3 K
8,在CM设置了neck mode,但是实际走却没有,检查在设置physical type的时候结尾是否是数字
4 f0 S3 f( f2 Y$ ]8 x9,内层普通最好不要动态静态变来变去,应为有时候铺出一个带viod的shape,变成动态的时候就不受anti-etch控制,能和viod中的shape多近他就会靠多近,虽然不影响出图,但是不轨范
) C9 u. m' P7 p* I+ O( I10,在个人环境变量的file-management下建立相关的文件夹,会使各种类型的文件管理很方便,但是有时候需要相关的log文档与board file在同意文件夹,需要手动取出。
2 [2 R. O" m! u5 l11,在rename中,勾选rename all components,则强制rename所有零件(hard_locate除外),如果不够选,则只有rename 带有auto_rename属性的零件+ P9 s0 X- [8 `' F
12.allegro文件不能有空格或者汉字,否则打开的是空版,如果存在小数点,可以打开board file,但是可能在打开CM或者SigXplorer的时候弹出错误,而且弹出的错误千奇百怪,让你无法追溯源头。
+ G( `& E8 n# ~9 G* v! b, W13,用quick place调出零件的时候,零件摆到一般可能不动了,库也是正确的,可以考虑是不是plotoutline太小了,画大点试试。 D# s. E! y# L# U3 Z! ]4 @* s% a* ~
14,shape/edit boundary可以editshape的所有boundary,而不仅仅是最外面的boundary。 |
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