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DDR中的A0~A13需要等长吗

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发表于 2014-11-4 13:08 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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DDR中的(1)D0~D7(2)D8~D15(3)D16~D23(4)D24~D31
3 O$ G, K+ x' ?2 G这四组要做等长6 T7 B6 _1 T. \% Y# l) k
但是A0~A13需要等长吗  Layout guide里面都没写耶
, [% ~! H, m1 `) Q9 G- T  O. ]) l
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发表于 2014-11-14 16:48 | 只看该作者
需要等长处理,误差200-400mil

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发表于 2014-11-13 19:23 | 只看该作者
A0~A13 和控制线BA0 BA1 等 需要做等长处理的

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发表于 2014-11-4 13:51 | 只看该作者
地址线一般不要求等长,9 h) }. X+ Y: V) k! V. D

% w8 F+ Y' Y2 N当然也有需要等长的,得具体情况具体分析

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听党指挥,能打胜仗,作风优良

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发表于 2014-11-4 15:21 | 只看该作者
第几代DDR呢,如果CPU支持时序调整能力,软件可以控制, ddr3连数据都不需要等长,如果等长 误差也是比较大的 看下spec的时序要求就可以知道,

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发表于 2015-1-29 15:02 | 只看该作者
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发表于 2015-1-29 16:46 | 只看该作者
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