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DDR2的CLK的cross point问题

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初级新手(9)

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发表于 2016-7-28 20:11 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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DDR2的CLK的cross point超标了,请问各位大神如何解决?
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初级新手(9)

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 楼主| 发表于 2016-7-28 20:12 | 只看该作者
cross point偏高,请问如何解决,更改并联的电容可以么?是什么原理。

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发表于 2016-8-10 08:56 | 只看该作者
是什么原理。

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发表于 2016-8-18 15:54 | 只看该作者
本帖最后由 kobeismygod 于 2016-8-22 17:35 编辑
, |4 m* |: e1 _' v5 O+ G, c! `* Q0 W
% ]/ o* X2 u: Y7 u' A+ ecrossover电压偏高可能是你N和P端有相位差导致,也可能是你N,P两端的驱动强度不一致挥着负载mismatch较大,导致rising time不一致。另外,你说并联电容是什么意思?

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发表于 2016-8-30 19:19 | 只看该作者
走线间距加大,并联的电容换个阻值小点,应该可以改善!
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发表于 2016-9-13 11:23 | 只看该作者
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发表于 2016-11-14 15:41 | 只看该作者
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