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请问SDRAM时钟线的宽度比数据地址线宽会不会引起阻抗不匹配?谢谢

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发表于 2008-9-24 00:57 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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看到一些设计中的sdram的时钟线比数据和地址线宽,数据地址线控制在50欧姆," M' P1 ~: E: e( D6 p
那么时钟线的阻抗就会小于50欧姆,这样对时钟线的信号质量的影响到底是好还是坏呢?) e$ E" O6 |( E2 Y5 T
, Q" _8 a7 P% |4 h, k& V
谢谢。
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发表于 2008-9-24 08:37 | 只看该作者
阻抗匹配是对于单个网络来说的。2 R/ r; l9 q  m* Q* M/ _) q
可以参考下特征阻抗的公式,阻抗不仅与线宽相关。
- ~, n9 K. ]6 ?; t+ U9 R1 j5 N' Q
如果从趋肤效应来讲,时钟的线宽比较大有利于降低损耗。
sagarmatha

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 楼主| 发表于 2008-9-24 11:00 | 只看该作者
原帖由 forevercgh 于 2008-9-24 08:37 发表 * p, ?8 z& F7 s- y1 w$ k
阻抗匹配是对于单个网络来说的。  r, c9 Z4 P  D3 T  H& [
可以参考下特征阻抗的公式,阻抗不仅与线宽相关。
% f% O* c, e, R+ g9 [# M' D: W
8 B. x/ D; j# Z; |+ w如果从趋肤效应来讲,时钟的线宽比较大有利于降低损耗。

2 \$ }# p0 ]! t1 v+ i1 I& ~$ E; D( }( e
我的意思是说,数据地址线上50欧姆阻抗是和芯片输入输出阻抗匹配的
! }' \8 _/ K1 J: n5 E! v: y( I时钟线线宽变宽,阻抗降低,是不是会引起时钟线和芯片的输入输出阻抗不匹配。
: c$ H- K7 ~# \7 k" U5 z* Y- A" l1 [* q, y
这个意思很难理解吗?

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发表于 2008-9-25 09:03 | 只看该作者
时钟buffer和数据线buffer是不同的。
sagarmatha

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发表于 2008-9-25 09:26 | 只看该作者

如果可以,数据也可以低于50ohm,时钟阻抗低了更好

原帖由 matice 于 2008-9-24 11:00 发表
: h4 n7 y# g6 z: f4 ~, Y5 _, Z& }( `+ T$ F: t

% ~2 f8 ]  h# Y) |3 G我的意思是说,数据地址线上50欧姆阻抗是和芯片输入输出阻抗匹配的
" M0 I( b& I( z$ r时钟线线宽变宽,阻抗降低,是不是会引起时钟线和芯片的输入输出阻抗不匹配。8 g1 E+ K  r+ d; k; [6 f
$ s% Y4 x' f" k: ^: n
这个意思很难理解吗?
- I5 Q- A7 i, i3 H9 ]
阻抗是个范围,可能是封闭区间,也可能是个半闭区间,跟其余因素也有关系。
% b5 E6 Z$ @6 N$ A$ X+ l3 h( m% o. z+ @3 K. v5 X3 \
你说的这种情况没有关系,是对的,你就这样做吧。

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发表于 2008-9-26 12:44 | 只看该作者
传输线阻抗是在频率下的一个范围,时钟通常100M,数据基本就是200M,所以你的物理约束在50欧姆,但是在不同频率下测出来的阻抗是不同的;既然你加宽了时钟线的宽度,其实在反射上问题不大,但是在工程制作上感觉你是不是增加了成本了呢?
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