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请教大家下，5片DDR2布线时怎么处理

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发表于 2016-2-17 20:39 | 只看该作者回帖奖励

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如题，我自己在实际中没有做过5片DDR2的设计，但是看到过两个实例设计。一种是采用一片作为节点，另外四片对称来设计；另外一种设计是正常布局，多余的那一片从第一个分支点布线过去等长处理。因为没有具体了解到这两个设计的调试结果，所以不知道具体该采用哪种设计方式，发出来咨询下大家。
另，顺便也请教下六片DDR2布局布线应该怎么处理，以前有一次听讲座的时候听到演讲人自述六片DDR2设计出来满足要求还可以超频，所以顺带请教哈。

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发表于 2016-2-18 08:28 | 只看该作者

楼主所说的第一种和第二种其实是同一种，只是作为节点或第一个分支点接到单独的一片时分支的长短不一样。从信号完整性来说，这里的分支越短越好。

点评

那么在做等长的时候DQS和CLK长度误差有要求，CLK和其他地址、控制类信号也有长度误差要求，当一片作为节点的时候这个等长很难去控制了，尤其作为节点这一片的所有地址、控制、时钟信号全部是公用部分？详情回复发表于 2016-2-21 10:10

万能的版主，那你说的这种情况属于fly-by么？貌似没怎么见过这种设计。详情回复发表于 2016-2-18 14:43

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发表于 2016-2-18 14:43 | 只看该作者

dzkcool 发表于 2016-2-18 08:28" T- v1 s5 s/ e) O" Z
楼主所说的第一种和第二种其实是同一种，只是作为节点或第一个分支点接到单独的一片时分支的长短不一样。从 ...

万能的版主，那你说的这种情况属于fly-by么？貌似没怎么见过这种设计。

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发表于 2016-2-18 18:45 | 只看该作者

DDR2是T型拓扑。

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楼主| 发表于 2016-2-21 10:10 | 只看该作者

dzkcool 发表于 2016-2-18 08:28+ }9 @5 o! ~9 y9 x) Z
楼主所说的第一种和第二种其实是同一种，只是作为节点或第一个分支点接到单独的一片时分支的长短不一样。从 ...

那么在做等长的时候DQS和CLK长度误差有要求，CLK和其他地址、控制类信号也有长度误差要求，当一片作为节点的时候这个等长很难去控制了，尤其作为节点这一片的所有地址、控制、时钟信号全部是公用部分？

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发表于 2016-2-22 13:16 | 只看该作者

按点到点控制即可。

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发表于 2016-2-23 20:35 | 只看该作者

DDR2是T型拓扑。

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