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[HyperLynx] 芯片引脚的电阻在高低电平时会变化么？

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发表于 2014-12-19 11:01 | 只看该作者回帖奖励

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在看芯片的spice模型的时候芯片某输出引脚在高点电平的时候电阻会有差别，这是为什么？
那芯片某引脚的输出电阻该如何确定呢？

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发表于 2014-12-19 11:16 | 只看该作者

PN结会变，它自然就变

新年伊始，稳中求胜

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楼主| 发表于 2014-12-19 14:30 | 只看该作者

slew time是什么意思？是指信号上升沿么？

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发表于 2014-12-19 16:21 | 只看该作者

你可以理解成电平转换响应时间

新年伊始，稳中求胜

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