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[仿真讨论] 小发现:阻抗随频率增加不一定会减小

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发表于 2013-10-8 17:43 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 qingdalj 于 2013-10-8 17:46 编辑
8 w6 v# y# d$ {$ y7 L$ y$ p+ ]( O! Z: U
       许多人都在讲随着频率的升高,传输线的特征阻抗会减小,我也一直这么认为。之前虽然有些疑问,但苦于无法验证自己的想法。用过polar的人应该都见过与下面类似的结果,相信很多人也是基于此得出的结论吧。+ d7 ^  Y+ n, b  F3 F/ P

7 q, I4 f3 l7 R, ]+ f       随着频率的升高,传输线电感会减小,而对于大多数PCB材料在频率升高时它的介电常数也会减小,从而导致传输线的有效电容也会减小。电感和电容都发生了变化,这使的我们不好判断阻抗的变化趋势了。
9 c+ f: `- ?( i8 p0 V    这里选取一种PCB材料的PP,它的参数如下图:6 K% s9 {+ v3 c$ R4 L) g9 Y0 I4 ]7 O

2 t7 y7 }- t- \       首先根据上述参数调整叠构,使得差分对阻抗约为90欧姆,如下图:
9 ?5 h# R0 N/ w8 J: {* B - J8 |$ h. N5 h, G0 Q+ s
       然后,将介质材料的介电常数按上面数据设置为分段形式:/ j7 Y( \. q8 i6 c0 U; x" d! u/ Q" z

1 v: D; F" t* x" N% {5 p3 `/ K       然后点击calculate,得到如下结果:- m" |' h5 y2 ^- [9 Y
5 y6 w3 M! v& G- A" l
       这里给出不设置分段介电常数情况下的结果方便大家对比:$ T) w: @* ?9 H$ A, Y* u5 Q

' D4 @+ V( D# i5 v1 {1 N" l) u( p/ ~
       现象描述:(1)介电常数分段情况下,在1GHz以内阻抗随频率增加而减小;1GHz以上阻抗随频率增加而增加(变化幅度较小),最终趋向稳定。
, B4 ?% S8 t& x1 v" j              (2)介电常数固定的情况下,传输线阻抗随频率增加而减小,最终趋向稳定。
: k+ [. \3 w$ {0 V% l6 k5 a" Y' e# h4 c
    原因分析:对传输线阻抗产生影响的因素为电感和电容,电感减小导致阻抗减小(假设电容不变),电容减小导致阻抗增加(假设电感不变)(1)介电常数分段情况下,1GHz以内介电常数没有变化,仅电感对阻抗产生了影响;1GHz以上电感和电容都减小,共同影响了传输线阻抗。(2)介电常数固定的情况下,阻抗只受电感变化影响,电感持续减小导致阻抗持续减小。
. I  q4 q# q1 D- k5 l3 }( Z0 \/ j! p" `
    结论:频率升高,传输线的阻抗不一定会减小,可能会增加,也可能在不断波动。这里是特例,当然不能认为频率升高阻抗就增加了。* ?) {* U; [- Q( z7 Y, Q

4 g  E! v7 |: X附:
' e" F7 a; v5 c4 o介电常数分段情况下,电容和电感的变化如下:+ ?  Q( B# y) K8 e" K+ m
8 W+ l. n2 U+ R! ~- ~
& s$ ^* M8 v1 w% s
介电常数固定情况下,电容和电感的变化如下:
. N$ W# C. X- B. K0 @+ b 5 `6 K) s. ^; W5 d0 r9 D
9 t; }' b3 b6 @! _6 S( K
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发表于 2013-10-9 14:42 | 只看该作者
谢谢楼主的分析与分享!!
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