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allegro 16.2 在win7里导入网表的问题!

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发表于 2011-4-23 12:40 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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烦请有人给指导一下!! ^2 a1 n% {2 L, C
在原理图中DEC与生成NET LIST 都没有报错!# O6 f. W. }* D+ ]5 N
小弟在这先行谢谢各位!
2 W* c3 h  c! p' G6 z如图:9 Y+ O' U. M- J! [0 h
  Q0 a6 i; b7 l) S/ L( G

import logic netlist errors.JPG (52.67 KB, 下载次数: 4)

import logic netlist errors.JPG
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发表于 2013-8-22 23:02 | 只看该作者
已解决,是导入logic的时候最后Import directory路径设置不对,应该把路径设置到netlist所在的路径,也就原理图文件夹下allegro的路径。

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发表于 2013-8-22 22:28 | 只看该作者
还是没有解决。

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 楼主| 发表于 2011-4-25 09:09 | 只看该作者
本人已解决!

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发表于 2011-4-25 12:19 | 只看该作者
我的还不行,导入PCB,在勾选放置元件到板上,却看不到元件,等于放空气一样!~麻烦详细指点一下!

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 楼主| 发表于 2011-4-25 12:39 | 只看该作者
你可是把你的错误发上来看看好吧,我也是初学,我们一起搞,兴许都能够解决的!

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发表于 2011-5-1 14:05 | 只看该作者
Cadence Design Systems, Inc. netrev 16.0 Fri Apr 29 11:35:19 2011
9 d8 q: r2 @0 n(C) Copyright 2002 Cadence Design Systems, Inc., s, C# [2 T$ u- [" ?! p
------ Directives ------
# p, U0 p7 A& t4 }9 h0 g# v" _5 YRIPUP_ETCH FALSE;
) Q: L. c) U8 U- i7 W. }5 C, w1 kRIPUP_SYMBOLS ALWAYS;
# L6 j& B7 v( F! G: ?9 ?Missing symbol has error FALSE;
, d' W' f6 V3 M( YSCHEMATIC_DIRECTORY 'Z:/project/907/A1';' l$ c0 c- {) g8 M8 V2 |2 |9 S7 X
BOARD_DIRECTORY '';8 g1 Z4 l" B5 u9 [+ G( D
OLD_BOARD_NAME '907.brd';
6 z# H4 Z8 e/ oNEW_BOARD_NAME '907.brd';
  K$ R/ f( @( F) R- p! ~CmdLine: netrev -$ -i Z:/project/907/A1'  -y 1  -z Z:/project/907/A1' /#Taaaaaa02688.tmp
' d7 a9 W$ l/ z% J------ Preparing to read pst files ------
" _: o5 k7 t/ y8 E  c! \
; k- W& y  Q, P( b" `, u#1   ERROR(24) File not found8 ^! _. f  L' c& m) u. J7 D
     Packager files not found
% U3 q3 ]$ A" s. [3 z+ @2 V  \/ |$ A#2   ERROR(102) Run stopped because errors were detected' |3 J8 f8 ]: X! \, X
netrev run on Apr 29 11:35:19 2011- k% O1 _/ L( j) W
   COMPILE 'logic'
- P! V$ ]/ C3 ?$ A( x% E5 f   CHECK_PIN_NAMES OFF
) u: y* z- m7 y+ s$ O! L' ~   CROSS_REFERENCE OFF, d7 E4 i- D; r
   FEEDBACK OFF
: ?- f5 H7 C! s8 o1 ~4 Q$ G1 B   INCREMENTAL OFF
3 y. F2 Y7 o" T: U3 P   INTERFACE_TYPE PHYSICAL6 ^! w, n3 K" j2 j
   MAX_ERRORS 500: v8 Y& m0 s: B" n
   MERGE_MINIMUM 5, Y3 G* R0 ?2 C$ v0 u
   NET_NAME_CHARS '#%&()*+-./:=>?@[]^_`|', S8 W- g/ ~( V# T; M) m
   NET_NAME_LENGTH 24; B5 w, }: L5 T6 f7 w: i
   OVERSIGHTS ON
# G1 y- M4 A$ K/ z   REPLACE_CHECK OFF
; X: e7 A) q" v% s   SINGLE_NODE_NETS ON
. Q& O! X: }2 d0 \, z   SPLIT_MINIMUM 0
% X7 k, d' l. ]! [5 A7 D   SUPPRESS   206 r  d; U5 Y; @8 n4 `
   WARNINGS ON/ E+ y; H; q5 S
  2 errors detected, S+ @7 |& r  H6 l+ e+ X6 t
No oversight detected
( x2 z5 a7 N) ?7 ANo warning detected( c" X# @+ U: D( J0 i+ z
cpu time      0:00:290 g; k' \. T1 _1 \
elapsed time  0:00:00
% [7 i! Q  o" L" V! g* S$ }& g. \* z+ X# f7 Z
你好,上面是我将网表导入allegro时出错,情形和楼主的一样,到现在还没找到原因,希望楼主指点一下,谢谢!
: H( V# P( x. o! ~; ]8 J7 i封装是我自己做的,PAD和PSM路径也都设置好了,就是网表无法导入allegro.

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 楼主| 发表于 2011-5-3 10:11 | 只看该作者
1、输出网表时有没有错;
  O( D9 e& |; ~$ ^2、输入网表时一错误,在file\viewlog里仔细查看;: A! p* B( K0 L' h, |6 I! x! P
3、在TOOL里放置时,能否看到元件个数;1 |; g! N3 c# E" o& t
4、在手动放置的时候,如出现问题,请查看输入命令窗口的提示。
3 d; a) f0 V7 f0 b5 d& B我就是这么做的!

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发表于 2011-6-8 18:27 | 只看该作者
请问楼主,如何解决的,你的Cadence在Win7下可以仿真吗??

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发表于 2011-6-8 19:23 | 只看该作者
这种问题如何解决。按照你说的方法去检查了。导入网络还是0原件,封装路径设置OK

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发表于 2011-11-15 10:37 | 只看该作者
求这个问题的解决方法。。。。谢谢。。。。

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发表于 2011-11-24 12:08 | 只看该作者
需要以管理员身份运行程序就可以

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发表于 2011-11-24 13:08 | 只看该作者
六楼的封装没有找到,看看是不是封装的路径不对,或者封装的焊盘不对,,又或是封装改名了之类的

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发表于 2012-6-19 23:45 | 只看该作者
封装的路径,封装的焊盘,封装命名不能用这些字符'#%&()*+-./:=>?@[]^_`|'( N( t:

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发表于 2012-6-19 23:52 | 只看该作者
可以强行导入看看,没有FLASH的过孔元件是放置不出来的,全部停在库里

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发表于 2012-11-26 15:33 | 只看该作者
你这个问题是怎么解决的呢?我的问题和你一样

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发表于 2012-11-26 16:02 | 只看该作者
请问下楼主的问题是怎么解决的呀烦请有人给指导一下!, M4 P" \& g1 C/ G2 W) a

: W6 g) r& B8 }( H# j! {6 [
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