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发表于 2012-7-31 11:21 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 jinshaomin 于 2012-7-31 13:29 编辑
4 i, U) F3 V# N. Y. v! [* z3 ?! t1 [
我在连线的时候,只要是从top层出的线全部会出错,就是那种倒8的
' ^6 Y6 ]7 N$ L+ b# C) n8 |  t9 F, j0 Z0 I6 n" `. H1 B

/ y) t* O1 v3 q我用的是allegro 16.3版本
6 X- H: R5 h8 {) w! ~. [+ y: n' N" j: q' r  H

6 d& D: D& I2 Z这是我连的PCB板,初学者,希望大家指出不足。。。
2 Q+ {* \7 j% W0 s  t& E3 d+ D: U

ASTRO_PCIE2PCI_120719.rar

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发表于 2012-7-31 11:31 | 只看该作者
drc显示什么错误?你确定网表导入了?

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 楼主| 发表于 2012-7-31 11:33 | 只看该作者
左P右L,不知道这样描述恰当否?

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发表于 2012-7-31 11:35 | 只看该作者
应该是封装库做得有问题,检查一下!

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发表于 2012-7-31 11:48 | 只看该作者
大哥,你要了解DRC错误的标示符,P/L是Pin to Line的错误比如 Line to SMD Pin; Line to test Pin;Line to Thru Pin;Mechanical Pin Antipad to Cline等等。。。* p; K1 ^' _% ?
你先Measure下Line to SMD Pin的距离,然后你在CM里面将Line to Pin的距离设置下就可以了,比如你测量的是6mil, 这样你在CM里面最小距离设为4MIl就不会报错了。。。

4.JPG (24.69 KB, 下载次数: 1)

4.JPG

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 楼主| 发表于 2012-7-31 11:52 | 只看该作者
没有解决,我发现无论是哪个引脚,都会出错!

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吃错.jpg

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发表于 2012-7-31 12:05 | 只看该作者
建议楼主把文件上传,注明版本
6 K" V# m3 E4 `8 p/ b; [! Q这样版本匹配的高手就可以准确定位问题了

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发表于 2012-7-31 12:20 | 只看该作者
把.BRD文件传下吧。。。

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发表于 2012-7-31 12:29 | 只看该作者
你这个明显是走线不在管脚中心啊。建议:拉线时在option中将pin勾上。再试一下。

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每个板子都不简单。

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 楼主| 发表于 2012-7-31 13:18 | 只看该作者
嗯,各位还需要原理图吗?7 ]3 E/ R! a/ V6 X, l: i8 C' _+ K

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发表于 2012-7-31 14:00 | 只看该作者
走线的时候右边find里面选上pin  不然不会自动抓住pin脚

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发表于 2012-7-31 15:08 | 只看该作者
应该是如楼上所说的原因,我另外还遇到一种情况就是:铺完GND铜发现连线都没问题,但是删除GND铜的时候就发现原来有些链接地的线就报错,尽管这些线是经过过孔到各层地的,很奇怪,后来把线删了,重新布又ok了。

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发表于 2012-7-31 16:44 | 只看该作者
盗版软件及软件自身的BUG。

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发表于 2012-7-31 22:11 | 只看该作者
.....4 E$ O+ X' g" W9 l+ W5 Q
刚打开brd文件想不到楼主这样最基本的错误都没看出来。。。既然做了P/L错误了,肯定是Pin 和Line的错误哦,你按Shift+F3进行Slide时。。。没发现走线也偏移了。。。。如果你连上焊盘了,尽行修线的时候,trace是围绕焊盘中心旋转的,,,
2 c, r* ?7 r! v) _# G& [/ Z% ?. _" J

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发表于 2012-7-31 22:15 | 只看该作者
jinshaomin 发表于 2012-7-31 11:52
! E4 B- T3 A6 g8 _+ e' [没有解决,我发现无论是哪个引脚,都会出错!
" n; T+ Z' [7 V7 m, l/ }
走线和焊盘不是同一网络
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