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CADENCE16.5出现的问题

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发表于 2012-7-5 10:24 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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请问下,我用OrCad Capture软件,选择了 A/D那项,我根据HANDBOOK,采用BOTTOM-UP画了一个原理图。但生成BOM时,或者导入PCB时却没有UP的SCH的元件内容,还有up图不能放探针仿真。为什么呢?

Cadence-Allegro.zip

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 楼主| 发表于 2012-7-6 10:41 | 只看该作者
晕,就没人帮忙解决下,帮助新人吗

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 楼主| 发表于 2012-7-8 22:55 | 只看该作者
唉,连个会的人都没

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"學會了" 就簡單了.

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发表于 2012-7-9 14:40 | 只看该作者
參考檔案  (我有修改你的電路圖)+ k, e9 ^  @* i% [4 l
另外建議命名不要用中文字

Cadence-Pspice.rar

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 楼主| 发表于 2012-7-11 09:42 | 只看该作者
jacklee_47pn 发表于 2012-7-9 14:40 6 b+ {3 R0 m- ^0 m
參考檔案  (我有修改你的電路圖)
# [( I) g: T+ O  _+ x另外建議命名不要用中文字

5 M% s9 {1 h  c0 r8 ]1 |7 o& {0 W版主非常感谢您的帮助!您发过来的文件的确可以用。可是是UP-BOTTOM,而不是BONTTOM-UP

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"學會了" 就簡單了.

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发表于 2012-7-11 11:19 | 只看该作者
畫電路圖可以是 UP-BOTTOM 或是 BONTTOM-UP 的方式。
5 V( B+ [0 T2 z5 d1 z1 o$ Q4 R仿真卻只能用 UP-BOTTOM 的方式。

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 楼主| 发表于 2012-7-11 16:28 | 只看该作者
jacklee_47pn 发表于 2012-7-11 11:19 0 W# h9 J$ J6 J8 `
畫電路圖可以是 UP-BOTTOM 或是 BONTTOM-UP 的方式。
2 x; d, K, B% G& j仿真卻只能用 UP-BOTTOM 的方式。

2 l  W& e; `( M3 D# A' O噢!原来这样的,谢谢!

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发表于 2012-7-13 08:25 | 只看该作者
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