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allegro 中盲埋孔如何设置?

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发表于 2008-8-14 13:24 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
same net 时 via1-2 和via2-7 pad 和pad 2mil 安全距离, diff net 需要 6mil 的安全距离。
$ @1 O3 \% l' l: e6 q7 D' v0 b; E) W% ]3 v0 C( |1 q1 W/ l

- S! N8 d, |2 W4 qspacing rule  ---> min bb via gap  上面还有个 SAME NET (ON/  OFF)( X4 t! I! I- u2 s8 A. @; V6 S2 q
physical rule ----> max bb via stagger
; L- S, r) t( |8 C# \以上两个选项是否是决定 盲埋孔的设置?& y+ ]6 X6 P% ]+ H& X# B

/ m* `4 K2 O9 T该如何设置。 这个问题搞了好久,没找到方法。
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发表于 2008-8-14 14:56 | 只看该作者
MIN BB VIA GAP 盲埋孔的最小距離) {6 i, k' S. g
MIN BBVIA STAGGER 埋孔最小错开距离。% C  X5 Z. @9 `* z6 G
MAX BBVIA STAGGER 埋孔最大错开距离。6 b- W1 B5 W2 A/ X+ u4 `
SAME NET (ON/  OFF) 关掉的话,同一NET的DRC不会检查。3 v- |# ~% V  N
设置MIN BBVIA STAGGER 属性,可以控制Minimum Blind/Buried Via的间距。不过一般还是使用VIA to VIA SPACE属性控制。
谁画出这天地 又画下我和你

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 楼主| 发表于 2008-8-15 11:33 | 只看该作者
SAME NET (ON/  OFF) 关掉的话,同一NET的DRC不会检查。----------- 这项已实现。
2 B/ j9 }% |( l7 [; ~+ j& r2 p! \6 o( f: O
下面三项我设什么都没什么用, 还是以 VIA TO VIA SPACE 为主。
0 _: C* z; F- V. l  yMIN BB VIA GAP 盲埋孔的最小距離PCB论坛! u# Y- v7 J+ W 3 X设了。----------设了不起----------设了不起作用
" x. }& r1 Q1 x5 L) u8 ]' RMIN BBVIA STAGGER 埋孔最小错开距离。----------设了不起作用
0 o! U7 g/ R" S. X( ZMAX BBVIA STAGGER 埋孔最大错开距离。, W! O% @3 M7 x  f* m7 S# ----------设了不起作用
1 _9 F. x2 M) k, Z4 U7 t2 p. y+ m# z$ l( u/ ]: G( f
: T! A: t( R! I6 c+ H6 F  l
设置MIN BBVIA STAGGER 属性,可以控制Minimum Blind/Buried Via的间距。--------意思明白, 但是设了不起作用啊 + b* v4 K3 A8 m; \
# N8 I/ C: w5 ?9 a
以上三项如何实现 ?  譬如我同net  VIA TO VIA  只需 4MIL , 不同net VIA TO VIA  要5mil  . 式了N  多次。 还是没起作用。+ ~9 G6 d  B( D: M1 o2 f/ U0 e

5 O2 @& ?5 L, A4 h5 }8 [' f, a' r0 V* ?1 L
[ 本帖最后由 osakau 于 2008-8-15 11:34 编辑 ]

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发表于 2011-5-23 13:07 | 只看该作者
高手们呀,在PAD DESIGNER中是如何创建盲埋孔的呀!谢谢!
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