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PCB检查布线99.87%,找不到未布线net

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发表于 2018-4-19 16:04 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
- M& G7 Z3 V% j8 T; A( l/ |

2 B$ w5 Q$ R6 |& V& V: v; V/ G; S2 o问题描述:6 J) U. M1 b3 Q8 M0 ?- b4 w
1.PCB检查如上图。软件提示未连接net均是死铜皮块。但是死铜皮左边是X=9669,Y=5339,坐标位置均为我PCB不能坐标的外部。所以不清楚为何会这样报错。PCB外确定无任何铜皮块。' J5 U) |3 O/ h( e1 F' Z
2.完成99.87%,找不到未布线net。
! Y, L; P" \7 v( S% J, u
2 h* j! s1 z  P8 g
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 楼主| 发表于 2018-4-20 16:07 | 只看该作者
yihafewu 发表于 2018-4-20 14:15' i; {3 r; e, ]7 M" K5 }
找一个报错的封装,连同周围的元件和走线,复制,新建一个PCB,进行特殊粘贴-保持网络名,再drc看看。2 Q) i. U$ a! r* K) k) d
如 ...
' F, E) M+ }/ v1 k8 U  _
问题解决了。新建PCB,复制过来检测100%、但是复制过来的时候内电层分割的铜皮net有丢失,自己全部重新定义了一下。但是S1S2S3层铜皮我发现更新不起作用。如图:
4 _6 s5 B* s" x  O6 N+ k, T" t- e ,外部铜皮轮廓会显示,手动不能更新。大神是否知道是何缘故。如果这个能解决,我就在新的PCB里再检查检查投板。
4 {3 Z4 Y7 m# K' C$ {

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 楼主| 发表于 2018-4-20 11:51 | 只看该作者
yihafewu 发表于 2018-4-20 09:17
/ |9 I3 |9 b" q( |新建一个PCB,层叠设置一样,把图拷过去试试。

$ k3 U+ h( ]. N" p& v- \4 C1.检查规则:
* j* c; k" S+ v" i8 c' l0 ] $ Y8 ^6 z2 \5 z0 E7 {2 n4 U
2.检查结果:
5 x+ b  r. |+ N
8 u1 @; {" |; S* |可以看出没有出现net未连。但是检测板子信息如下:/ Z! n1 }' N1 ~: C5 I  T
3.还有两个net未连接。把板子所有东西都隐藏也没发现有飞线。
, }  E. Z. C$ [* t' f) ?
$ y$ D6 P% J  ?
6 F1 P5 V8 E' L- L8 c

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 楼主| 发表于 2018-4-20 16:28 | 只看该作者
yihafewu 发表于 2018-4-20 16:16
( X9 T# T* S" ds1s2s3是正片层?这些铜皮是手工放置的polygon吧?
* c' W  I: j9 W1 P4 K) b( u& y如果是,切换到相应层,那么双击它,在这个属性对话框 ...
$ g. Q, {% e6 d% k+ U' I% M3 C
正片手动放的铜皮,在16里边怎么样也不行。我把所有设置都回复默认设置也不行。我有用AD9打开发现可以跟新了。所以现在问题彻底解决了。

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发表于 2018-4-20 08:09 | 只看该作者
本帖最后由 yihafewu 于 2018-4-20 08:49 编辑
: I4 m. o  i8 J$ [# x; z# r; n+ m8 c% Y
切换到G1层,看看GND网络是否存在孤岛(没有与其他GND铜皮连在一起的孤立铜皮)。8 F) Z( B% p, k# ^5 @
还有P层的DSP的几个电源网络。  A4 i4 k! a- \7 ]
; |% T" v  E: \& u* B8 |

点评

G1层,很明显没有孤岛。 [attachimg]137396[/attachimg] P层:很明显也没有。 [attachimg]137397[/attachimg]  详情 回复 发表于 2018-4-20 08:49

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 楼主| 发表于 2018-4-20 08:49 | 只看该作者
yihafewu 发表于 2018-4-20 08:09' T" G% f9 M) |6 P2 x( h
切换到G1层,看看GND网络是否存在孤岛(没有与其他GND铜皮连在一起的孤立铜皮)。0 _6 D8 Z  z# P$ y- Y. c6 o, t, }
还有P层的DSP的几个电源 ...
  S. B  o. G; {& ?/ W1 N
/ L! S, b1 t( S) N2 R" y
G1层,很明显没有孤岛。0 Y! a9 H5 H! Q  [4 o& P

7 _: I, d$ }/ D0 [, q" \P层:很明显也没有。
+ s- d; h! `1 m) |; A * k3 y5 b" s1 @- L. S; g
  O5 m& ^9 n$ W( ]' u0 J

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发表于 2018-4-20 08:56 | 只看该作者
兄得,你再仔细看看,有孤岛啊,你的两个图里都有啊。$ L/ m! s" H8 q& _, ?
我的电脑是加密过的,没法截图给你。
3 v3 B# q. H8 F9 y比如电源那里,你高亮的部分,中上,靠左,五个过孔处。你在孔比较密集的地方找。

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[attachimg]137398[/attachimg] 没有啊。都是十多年老司机了。这个真把我难住了。  详情 回复 发表于 2018-4-20 09:04

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发表于 2018-4-20 09:00 | 只看该作者
preferences->system->navigation,在highlight methods的那个标尺,移到靠近close处,你双击messages的时候会定位到目标处

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 楼主| 发表于 2018-4-20 09:04 | 只看该作者
yihafewu 发表于 2018-4-20 08:56/ j8 g# I8 S1 ?; B/ P$ V7 \
兄得,你再仔细看看,有孤岛啊,你的两个图里都有啊。2 h& ~. P8 Z  S8 x
我的电脑是加密过的,没法截图给你。0 W$ l6 ~, S6 e9 `$ y5 d4 Z
比如电源那里 ...

) B# N! V4 y7 E. e) y+ }
4 r; e0 i8 W9 S) I没有啊。都是十多年老司机了。这个真把我难住了。
$ O( |# P. M- s- x

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发表于 2018-4-20 09:11 | 只看该作者
看看能看到不
" D( e' w( y2 b0 \

IMG_2483.PNG (1.15 MB, 下载次数: 2)

IMG_2483.PNG

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发表于 2018-4-20 09:17 | 只看该作者
新建一个PCB,层叠设置一样,把图拷过去试试。

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1.检查规则: [attachimg]137416[/attachimg] 2.检查结果: [attachimg]137417[/attachimg] 可以看出没有出现net未连。但是检测板子信息如下: 3.还有两个net未连接。把板子所有东西都隐藏也没发现有飞线。 [a  详情 回复 发表于 2018-4-20 11:51
解决了。我板子上连接器的焊盘有点大。我在P跟G1,G2层焊盘边缘放了一个圆做隔离,软件检测到园内是一篇孤铜。其实不影响电气特性。因为PCB生产过程中焊盘的铜壁厚就把内电层的孤岛覆盖了。  详情 回复 发表于 2018-4-20 11:25

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发表于 2018-4-20 11:00 | 只看该作者
一般打孔不规范的,或者建库不规范的,用负片就要注意

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 楼主| 发表于 2018-4-20 11:25 | 只看该作者
yihafewu 发表于 2018-4-20 09:17; _% o0 E$ U. W7 {4 P; `
新建一个PCB,层叠设置一样,把图拷过去试试。

5 N3 Z- y- B+ O  a% B% E解决了。我板子上连接器的焊盘有点大。我在P跟G1,G2层焊盘边缘放了一个圆做隔离,软件检测到园内是一篇孤铜。其实不影响电气特性。因为PCB生产过程中焊盘的铜壁厚就把内电层的孤岛覆盖了。
, A' M$ d# q' e  @  H

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发表于 2018-4-20 13:09 | 只看该作者
你把Clearance的检查关掉再DRC看看,你的错误总数已经达到5000了,这个值应该是你设置的最大错误数吧。

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[attachimg]137421[/attachimg] 无net的pin我挨个全看了。没有问题。但是布线还是不是100%  详情 回复 发表于 2018-4-20 14:00

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 楼主| 发表于 2018-4-20 14:00 | 只看该作者
yihafewu 发表于 2018-4-20 13:09! a! h4 @) n8 X0 B3 r! J
你把Clearance的检查关掉再DRC看看,你的错误总数已经达到5000了,这个值应该是你设置的最大错误数吧。
% j  ^% n% y7 e+ |2 f; z1 X

, J2 j7 q3 I7 q+ k: n* q4 _无net的pin我挨个全看了。没有问题。但是布线还是不是100%: H8 q& }6 J( k" j& o% }/ L; w

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发表于 2018-4-20 14:15 | 只看该作者
找一个报错的封装,连同周围的元件和走线,复制,新建一个PCB,进行特殊粘贴-保持网络名,再drc看看。6 Y+ i8 T: C5 |0 ^& d5 B
如果你的PCB不涉及保密的话,可以上传上来看看。

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问题解决了。新建PCB,复制过来检测100%、但是复制过来的时候内电层分割的铜皮net有丢失,自己全部重新定义了一下。但是S1S2S3层铜皮我发现更新不起作用。如图: [attachimg]137430[/attachimg],外部铜皮轮廓会显  详情 回复 发表于 2018-4-20 16:07
看私信消息。  详情 回复 发表于 2018-4-20 14:26

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 楼主| 发表于 2018-4-20 14:26 | 只看该作者
yihafewu 发表于 2018-4-20 14:158 e' e* e( @4 [2 K2 J/ t
找一个报错的封装,连同周围的元件和走线,复制,新建一个PCB,进行特殊粘贴-保持网络名,再drc看看。  S& \1 I5 `  g6 t' A
如 ...
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