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PCB检查布线99.87%,找不到未布线net

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发表于 2018-4-19 16:04 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x
! s+ h5 b6 @; @1 A3 z; `

  f: \8 n' Z, I" W8 C问题描述:
& S" r  W6 {, p9 q( n5 e! Z1.PCB检查如上图。软件提示未连接net均是死铜皮块。但是死铜皮左边是X=9669,Y=5339,坐标位置均为我PCB不能坐标的外部。所以不清楚为何会这样报错。PCB外确定无任何铜皮块。' C! e0 ^8 q! L* S1 `* q
2.完成99.87%,找不到未布线net。
6 l) G9 S* ^5 Q* h) Z) `9 u# ]# W3 w7 ~2 z) h7 |+ P, C& j
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 楼主| 发表于 2018-4-20 16:07 | 只看该作者
yihafewu 发表于 2018-4-20 14:15' u; ?3 }: ~/ ~; a5 Z6 c: z: x3 e
找一个报错的封装,连同周围的元件和走线,复制,新建一个PCB,进行特殊粘贴-保持网络名,再drc看看。
: ?$ n( k* i% N0 i0 m; {如 ...
2 h. M1 F/ _9 G4 M1 X
问题解决了。新建PCB,复制过来检测100%、但是复制过来的时候内电层分割的铜皮net有丢失,自己全部重新定义了一下。但是S1S2S3层铜皮我发现更新不起作用。如图:
4 g  V9 t$ H  g9 C* ]5 b ,外部铜皮轮廓会显示,手动不能更新。大神是否知道是何缘故。如果这个能解决,我就在新的PCB里再检查检查投板。
$ r2 ]% y  y7 k

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 楼主| 发表于 2018-4-20 11:51 | 只看该作者
yihafewu 发表于 2018-4-20 09:17* w8 H5 u/ o8 h" A, b
新建一个PCB,层叠设置一样,把图拷过去试试。
8 o7 h3 l. n, W. m7 H' ]
1.检查规则:
5 n' J+ J9 V' O1 j* |9 \% [+ S2 Z
$ X: r( _0 [4 ]" B9 v5 W! h/ K2.检查结果:1 a3 J+ a$ U0 ~3 J. x  [

) i# z7 V# V1 J可以看出没有出现net未连。但是检测板子信息如下:5 T9 i) n, x4 \/ ?7 J
3.还有两个net未连接。把板子所有东西都隐藏也没发现有飞线。+ ^9 a4 `1 _% b  _& C( I7 M; _+ z

" a' P9 [! [( @2 `4 S& u5 F0 |& H9 L- s% |/ J+ a! Q' a  p

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 楼主| 发表于 2018-4-20 16:28 | 只看该作者
yihafewu 发表于 2018-4-20 16:16" z1 R# b. r4 ^, ~
s1s2s3是正片层?这些铜皮是手工放置的polygon吧?
9 h1 H" H6 k/ W如果是,切换到相应层,那么双击它,在这个属性对话框 ...

$ U' x0 W% ~( e3 `) Y, d正片手动放的铜皮,在16里边怎么样也不行。我把所有设置都回复默认设置也不行。我有用AD9打开发现可以跟新了。所以现在问题彻底解决了。

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发表于 2018-4-20 08:09 | 只看该作者
本帖最后由 yihafewu 于 2018-4-20 08:49 编辑 / K) m& c/ f) k5 L: ]. j9 ^9 c7 V0 a
/ i; g. w2 ~0 {- d
切换到G1层,看看GND网络是否存在孤岛(没有与其他GND铜皮连在一起的孤立铜皮)。5 y6 S3 N) {7 a6 H0 _6 v
还有P层的DSP的几个电源网络。# g: `7 ~% ^- o# \+ s1 S3 @

4 G$ a/ H. r5 N5 }# E- O3 V

点评

G1层,很明显没有孤岛。 [attachimg]137396[/attachimg] P层:很明显也没有。 [attachimg]137397[/attachimg]  详情 回复 发表于 2018-4-20 08:49

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 楼主| 发表于 2018-4-20 08:49 | 只看该作者
yihafewu 发表于 2018-4-20 08:09
( E$ x8 `: E$ u2 E9 L5 T" j切换到G1层,看看GND网络是否存在孤岛(没有与其他GND铜皮连在一起的孤立铜皮)。
, Y$ B/ o6 x" T& M# W还有P层的DSP的几个电源 ...
5 g* m# L+ `/ P
( S5 O. j) L2 B4 _: j* h4 O- z0 u
G1层,很明显没有孤岛。; G* z& D& W& l+ \

! O  T5 W1 s& p7 q# ?P层:很明显也没有。' s. D0 C- M# D5 [3 G& M( _

3 o& m$ L9 w1 F7 c5 v% o) @; c4 o/ I) d+ P7 ^8 z% S

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发表于 2018-4-20 08:56 | 只看该作者
兄得,你再仔细看看,有孤岛啊,你的两个图里都有啊。- J5 W' d: w, r! \
我的电脑是加密过的,没法截图给你。0 c( }, O) F- _$ e( L
比如电源那里,你高亮的部分,中上,靠左,五个过孔处。你在孔比较密集的地方找。

点评

[attachimg]137398[/attachimg] 没有啊。都是十多年老司机了。这个真把我难住了。  详情 回复 发表于 2018-4-20 09:04

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发表于 2018-4-20 09:00 | 只看该作者
preferences->system->navigation,在highlight methods的那个标尺,移到靠近close处,你双击messages的时候会定位到目标处

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 楼主| 发表于 2018-4-20 09:04 | 只看该作者
yihafewu 发表于 2018-4-20 08:56; Z/ Y. c9 ?: P9 x
兄得,你再仔细看看,有孤岛啊,你的两个图里都有啊。3 c% C8 d4 ?7 K
我的电脑是加密过的,没法截图给你。( w$ g5 t2 L: V4 s9 u( w
比如电源那里 ...

& a2 b: l2 q( ?2 ~- o- f
" n$ j* K9 o$ K) H3 p' C! p9 |没有啊。都是十多年老司机了。这个真把我难住了。7 h& y& e5 C& }0 m  l& X

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发表于 2018-4-20 09:11 | 只看该作者
看看能看到不
* k8 ?, u5 g: E4 {: H2 I' f  I8 L1 J

IMG_2483.PNG (1.15 MB, 下载次数: 2)

IMG_2483.PNG

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发表于 2018-4-20 09:17 | 只看该作者
新建一个PCB,层叠设置一样,把图拷过去试试。

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1.检查规则: [attachimg]137416[/attachimg] 2.检查结果: [attachimg]137417[/attachimg] 可以看出没有出现net未连。但是检测板子信息如下: 3.还有两个net未连接。把板子所有东西都隐藏也没发现有飞线。 [a  详情 回复 发表于 2018-4-20 11:51
解决了。我板子上连接器的焊盘有点大。我在P跟G1,G2层焊盘边缘放了一个圆做隔离,软件检测到园内是一篇孤铜。其实不影响电气特性。因为PCB生产过程中焊盘的铜壁厚就把内电层的孤岛覆盖了。  详情 回复 发表于 2018-4-20 11:25

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发表于 2018-4-20 11:00 | 只看该作者
一般打孔不规范的,或者建库不规范的,用负片就要注意

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 楼主| 发表于 2018-4-20 11:25 | 只看该作者
yihafewu 发表于 2018-4-20 09:170 A9 O% {. _1 z1 u8 w# S: V4 G
新建一个PCB,层叠设置一样,把图拷过去试试。
2 \/ P$ {' A) o
解决了。我板子上连接器的焊盘有点大。我在P跟G1,G2层焊盘边缘放了一个圆做隔离,软件检测到园内是一篇孤铜。其实不影响电气特性。因为PCB生产过程中焊盘的铜壁厚就把内电层的孤岛覆盖了。, ~, ]" O; O7 `- r1 x9 x( f/ {

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发表于 2018-4-20 13:09 | 只看该作者
你把Clearance的检查关掉再DRC看看,你的错误总数已经达到5000了,这个值应该是你设置的最大错误数吧。

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[attachimg]137421[/attachimg] 无net的pin我挨个全看了。没有问题。但是布线还是不是100%  详情 回复 发表于 2018-4-20 14:00

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 楼主| 发表于 2018-4-20 14:00 | 只看该作者
yihafewu 发表于 2018-4-20 13:09
/ I# _) X" a3 r0 M你把Clearance的检查关掉再DRC看看,你的错误总数已经达到5000了,这个值应该是你设置的最大错误数吧。

2 ^) w' T: j7 Y: f2 E  | 0 c' Y  ]: x" I0 `/ E
无net的pin我挨个全看了。没有问题。但是布线还是不是100%
  E/ T0 ~9 ]- k

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发表于 2018-4-20 14:15 | 只看该作者
找一个报错的封装,连同周围的元件和走线,复制,新建一个PCB,进行特殊粘贴-保持网络名,再drc看看。4 {5 L/ Q+ I" d9 D* q. |
如果你的PCB不涉及保密的话,可以上传上来看看。

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问题解决了。新建PCB,复制过来检测100%、但是复制过来的时候内电层分割的铜皮net有丢失,自己全部重新定义了一下。但是S1S2S3层铜皮我发现更新不起作用。如图: [attachimg]137430[/attachimg],外部铜皮轮廓会显  详情 回复 发表于 2018-4-20 16:07
看私信消息。  详情 回复 发表于 2018-4-20 14:26

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 楼主| 发表于 2018-4-20 14:26 | 只看该作者
yihafewu 发表于 2018-4-20 14:159 c6 C7 }) I- |, [5 ?% g
找一个报错的封装,连同周围的元件和走线,复制,新建一个PCB,进行特殊粘贴-保持网络名,再drc看看。
3 X2 m( u2 p6 V$ `如 ...
  u$ Q2 M6 j6 h* }: `
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