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2017年7月19日公益PCB评审报告节选

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发表于 2017-7-20 08:51 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.  音频模拟线加粗走类差分.5 H, K0 e3 [, o& x5 A. Z

& t& c9 b1 @( D0 k
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发表于 2017-7-25 09:28 | 只看该作者
junieya 发表于 2017-7-24 16:32
1 V, l- H" {# C! T请问这条如何理解? pcb小白求教
3 F. D0 J: l- Y& Y8 x9 G9 d
1.平面铜只有一个VIA,肯定的说这块铜没有作用.
0 K% u+ `& @* V3 e( l: h2.电源被VIA隔小了,电源通路太细.
; E( p" m2 Y; Y9 [0 S: L/ I. j

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发表于 2017-7-24 16:32 | 只看该作者
EDA365QA 发表于 2017-7-20 08:58
; |: I5 b1 p. o2 S5 Y10.  平面铜只有一个VIA,电源被VIA隔小了.
4 S- n% i. N) Y( r
请问这条如何理解? pcb小白求教
5 H% S. t; x- B0 s% O

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pcb
1.平面铜只有一个VIA,肯定的说这块铜没有作用. 2.电源被VIA隔小了,电源通路太细.[/backcolor]  详情 回复 发表于 2017-7-25 09:28

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 楼主| 发表于 2017-7-20 08:56 | 只看该作者
7.  天线部分加粗控50OHM,陶瓷天下要挖空按DATASHEET处理.
3 l# z# V/ Z( D2 [8 l- N' y+ w ) z/ f7 J. Q/ i$ k7 M

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 楼主| 发表于 2017-7-20 08:52 | 只看该作者
2.  信号线应走阻抗线.
0 Y% }/ Y6 z6 M/ g7 X0 j! p+ o : I6 [/ {- c+ n6 X/ ]6 k

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 楼主| 发表于 2017-7-20 08:53 | 只看该作者
3.  ESD应靠近接口.
( w9 x/ I: i: a; _; s( X$ [ 5 D1 |6 s) r. j1 B' |

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 楼主| 发表于 2017-7-20 08:54 | 只看该作者
4.  电源PIN脚加宽.4 _" H- Z5 G9 q) a

, `" r' [! c! d  \

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 楼主| 发表于 2017-7-20 08:55 | 只看该作者
5.  带变压器的网口下挖空处理.
( q; ~9 R8 _. L) ^ : C1 k+ z/ |- V7 W! k

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 楼主| 发表于 2017-7-20 08:55 | 只看该作者
6.  晶体电容不要放后面出现残端.
, ]9 @, k8 E0 C  i & a% a3 e2 f; T1 a6 w' T1 B

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啥意思?没看懂  详情 回复 发表于 2017-11-4 11:27

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 楼主| 发表于 2017-7-20 08:57 | 只看该作者
8.  升压电路应缩小回流路径.; ~" M/ c; ?) Y6 b3 _' v/ u

; w' a  Z# z% v& C; `% M

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 楼主| 发表于 2017-7-20 08:57 | 只看该作者
9.  有线在挖空区./ x7 b3 Y, E! f: z; j

4 r$ X$ ]% |( m0 r% }

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 楼主| 发表于 2017-7-20 08:58 | 只看该作者
10.  平面铜只有一个VIA,电源被VIA隔小了.
5 j- N  |- A7 \
% ~# ^( e* q+ k9 m. T" d: B$ {

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请问这条如何理解? pcb小白求教  详情 回复 发表于 2017-7-24 16:32

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发表于 2017-7-20 17:47 | 只看该作者
厉害,啥时候才能有QA的水平啊) h! t' s! i" i; @+ P& {* r, S- @

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发表于 2017-7-21 08:43 | 只看该作者
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