2017年9月21日QA检查报告节选

EDA365QA · 发表于 2017-9-22 09:04

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1.铜有尖角，线在分割上

EDA365QA · 发表于 2017-9-22 09:05

4.平面太长有跨分割

小千 · 发表于 2017-9-30 15:55

EDA365QA 发表于 2017-9-22 09:07" Q7 |: a D* Y2 z
12.不建议在电感内部大孔穿线

我认为这个高速线这种走法是最好的处理，请问有没有其他好的处理方式？

EDA365QA · 发表于 2017-9-22 09:05

5.分割修改到阻容器件中心过，减少走线跨分割

EDA365QA · 发表于 2017-9-22 09:04

2.两个电源夹一个信号层可以优化。

EDA365QA · 发表于 2017-9-22 09:04

3.器件中间多防焊，建议修改封装删除此防焊。

EDA365QA · 发表于 2017-9-22 09:05

6.双口RAM有部分线没有等长

EDA365QA · 发表于 2017-9-22 09:05

7.VTT电源加宽

EDA365QA · 发表于 2017-9-22 09:05

8.器件位号确实

EDA365QA · 发表于 2017-9-22 09:06

9.光耦前后隔离处理

EDA365QA · 发表于 2017-9-22 09:06

10.USB没有参考平面

EDA365QA · 发表于 2017-9-22 09:07

11.贴片阻容器件中间不建议穿无关的走线

EDA365QA · 发表于 2017-9-22 09:07

12.不建议在电感内部大孔穿线

Haiting32451 · 发表于 2017-9-22 11:06

谢谢分享

guhanzuiying · 发表于 2017-9-22 12:44

wx_SHOh21dw · 发表于 2017-9-23 20:31

:hug:

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