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ddr3等长问题

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发表于 2017-9-2 21:14 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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1.fly-by拓扑的ddr3的dqs跟其对应的clk需要等长否,如需等长,等长做到多少?(如颗粒1的dqs1根其对应的时钟(控制器-颗粒1)
: C5 S& I# Z$ l; D/ ?2.一个控制的两个通道,两个通道的clk是否需要对应等长,就是控制到两个通道对应的颗粒的那段clk,如需要等长做到多少?
8 R/ X) b; d7 p' E# k2 `9 X- g
4 e7 r0 v: O4 v9 `# Q. k
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发表于 2017-9-3 07:49 | 只看该作者
1,支持flyby基本意味着控制器支持write leveling,dqs与clk无等长要求,但两者的时间差会有一个范围要求

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150ps  详情 回复 发表于 2017-9-4 09:35

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发表于 2017-9-4 09:35 | 只看该作者
xxzouzhichao 发表于 2017-9-3 07:49# a5 L# r& m0 U+ c: B2 ^& W# E
1,支持flyby基本意味着控制器支持write leveling,dqs与clk无等长要求,但两者的时间差会有一个范围要求

5 W7 b: \" F0 T. u150ps
, ^5 d3 L1 C8 j, w

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具体换算到mil怎么换算呢  详情 回复 发表于 2017-10-20 14:34

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发表于 2017-9-5 18:53 | 只看该作者
我冒泡来解释一下:3 q9 F7 V2 y1 m0 e2 M" I* A
1、tDQSCK,这个指标在SCB15H1G这个datasheet中看到(-225,225)ps@1600,(-195,195)@1866,南亚NT5CB128M16HP要求(-225,225)ps@1333,布线需要综合考虑实际跑多少的频率,还有兼容不同颗粒的要求,取一个保守值最好,能做到+/-100ps以内最好
5 T3 c) E8 _2 W/ s0 [; B4 ]# w  K2、flyby的拓扑结构,不需要走等长,这个靠初始化序列校验来保证。但要保证tDQSCLK在规范之内。
5 u: D% G$ x& D( N/ A" F3 ?0 o- O# d/ l

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你好,有点不太明白的地方想问一下,这个±150ps,这个指标是时间么,那么这个时间如何来控制呢?我理解的是走线长度的等长就是控制时间的一致性,那么这个150ps这个时间在长度上应该如何计算呢?  详情 回复 发表于 2017-9-6 10:12

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发表于 2017-9-6 10:12 | 只看该作者
hagelee 发表于 2017-9-5 18:53; d4 [& ^! ]% @; A( t
我冒泡来解释一下:4 f% W* U9 d& F7 s, R% M7 i
1、tDQSCK,这个指标在SCB15H1G这个datasheet中看到(-225,225)ps@1600,(-195,19 ...
1 |8 l8 @/ L' @5 _1 w' ]" x
你好,有点不太明白的地方想问一下,这个±150ps,这个指标是时间么,那么这个时间如何来控制呢?我理解的是走线长度的等长就是控制时间的一致性,那么这个150ps这个时间在长度上应该如何计算呢?
9 f, K+ U1 c# f5 l) X; K3 }8 I: f

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一个ps 6mil ,150ps ,900mil  详情 回复 发表于 2017-9-6 11:17

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发表于 2017-9-6 10:43 | 只看该作者
控制等长的目的也是为了保证timing的余量;走线和延迟的计算公式 V=C/sqrt(Er) ' }5 w8 H# }/ y
1.内层周围介质均匀,Er取4.2-4.5,C光速约12inch/ns,计算后为V=166ps/inch;
( n4 }/ ?' {6 n+ c2.表层由于暴露在空气中,Er小于4,传输速度比内层快,大约 140ps/inch;
' J- ]1 e9 |% u# u0 K考虑到温度,电压,颗粒的差异,预留一定的余量可以避免问题的产生,我认为能控制在+/-1inch之内,基本能够保证时序的要求了。% x8 J& U4 h0 q! w* ~; J( i- _

. S( M# O! T1 m' a$ B5 F# F还有一种情况是板子结构特殊,布板确实无法做到1inch范围之内,可以考虑通过绕线增加1个ck的周期;这个主要是跟芯片设计的DDR PHY有很大关系,当然这个需要厂家确认。
3 I6 ?3 A5 x& U9 e, m0 d' k

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发表于 2017-9-6 11:17 | 只看该作者
cewtf 发表于 2017-9-6 10:12
8 J& e# H, \' D  y. f; L你好,有点不太明白的地方想问一下,这个±150ps,这个指标是时间么,那么这个时间如何来控制呢?我理解 ...
8 w0 O: M2 S% y. K9 n4 {
一个ps  6mil   ,150ps   ,900mil+ ~3 ]% c7 D% a; j7 K! `+ ?

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 楼主| 发表于 2017-9-6 20:52 来自手机 | 只看该作者
各位,我那个项目的控制器不支持读写平衡,导致我走的fly-by拓扑的ddr3跑不起来,现在我打算改成t形拓扑,dqs跟时钟是不是是要完全等长呢,只有一个clk

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位宽多少?  详情 回复 发表于 2017-9-8 18:08

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发表于 2017-9-8 16:57 | 只看该作者
dqs与数据做等长,clk走t型,地址线走t型做等长

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发表于 2017-9-8 18:08 | 只看该作者
ann_wz 发表于 2017-9-6 20:52; l$ {; B! f" r. L
各位,我那个项目的控制器不支持读写平衡,导致我走的fly-by拓扑的ddr3跑不起来,现在我打算改成t形拓扑,d ...
' o3 J! d9 m7 j) Z4 t, w
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 楼主| 发表于 2017-9-9 07:47 来自手机 | 只看该作者
8片+ecc 72位数据,跑800m速率

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居然还有这么蛋疼的内存控制器,也是醉了,板子画大一点,慢慢绕时序吧,估计800Mhz(1600bps)是跑不下了  详情 回复 发表于 2017-9-9 21:11

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发表于 2017-9-9 21:11 | 只看该作者
ann_wz 发表于 2017-9-9 07:47+ P) b8 g8 Q; X/ i3 O
8片+ecc 72位数据,跑800m速率

+ c& \! |2 D, T. U( ]6 U居然还有这么蛋疼的内存控制器,也是醉了,板子画大一点,慢慢绕时序吧,估计800Mhz(1600bps)是跑不下了: e3 y/ v9 j3 o0 S

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chen.che.ch.c. 发表于 2017-9-4 09:35) r  j) Z! _2 k; W* x( n
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1 m8 L7 O' C, Q. R  w$ P# v具体换算到mil怎么换算呢& T) {9 l# r" ^9 F! T( V5 t9 U
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