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【悬赏】仿真波形分析!

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发表于 2008-9-9 14:53 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
5E币
哪位大哥能帮忙简单分析一下这个波形,小弟刚开始学allegro,不是太懂。; M$ v' y! l1 ~  A. U
拓扑图是一个滤波电路,用的仿真工具是SigXplorer,查看波形用的是SigWave。+ R6 g% u( T; X% D
其中时钟周期是PULSE 2MHZ,J1是驱动,J2是接收。做的是信号完整性仿真的反射仿真。$ p. S3 [2 d3 W0 H
小弟不清楚为啥它俩的波形是一高一低,差距太大,还有从图中还能分析到哪些信息啊。
" ~6 O4 \; q( |8 |3 S7 X; I( l: p补充:在做反射参数设置时,发现不管我选择单调性测量还是噪声容限测量或者是其他,为啥波形都显示一样啊?  |( q! n$ \* ~
请大哥们不吝赐教。
+ O; F0 T+ U2 E小弟谢了!

wave.PNG (10.85 KB, 下载次数: 14)

这是仿真波形图

这是仿真波形图

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这是拓扑图

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我谈几点个人的看法: 1,楼主其实提出了一个很好的问题,那就是,低速信号也存在信号完整性问题,因为现在很多低速信号,上升沿很快。而有些规范,如I2C,对上升沿等有要求。 2,一高一低很好解释,那就是在驱动端有串联电阻,输出电压被分压,我怀疑楼主在提取拓扑前,没有正确设置叠层,使得提取出来的传输线阻抗只有30几欧姆,一般像此类信号,走4mil或5mil,阻抗通常会到50欧姆以上。如果是这样的话,你在接收端得到的波形 ...
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发表于 2008-9-9 14:53 | 只看该作者
我谈几点个人的看法:, q- N: z- F; W) K
1,楼主其实提出了一个很好的问题,那就是,低速信号也存在信号完整性问题,因为现在很多低速信号,上升沿很快。而有些规范,如I2C,对上升沿等有要求。1 N6 V' T1 a( z" l- B
2,一高一低很好解释,那就是在驱动端有串联电阻,输出电压被分压,我怀疑楼主在提取拓扑前,没有正确设置叠层,使得提取出来的传输线阻抗只有30几欧姆,一般像此类信号,走4mil或5mil,阻抗通常会到50欧姆以上。如果是这样的话,你在接收端得到的波形电平应该会到3V左右。
% s5 m3 [1 f3 E3,还可以看到,上升沿从驱动端到接收端,衰减了很多(注意X轴标尺是us)。
: O$ z# ~# O+ M9 C; T4,至于为什么波形都一样,我对SQ不熟,我猜测,不管选什么测量,仿真的拓扑,模型是一样的,波形当然一样,只是仿真后测量报告会有所区别。

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 楼主| 发表于 2008-9-9 15:00 | 只看该作者
不知道为啥,图形没有显示全,要是看不到,麻烦大家下载了看,如果问题解决了,我会给大哥加威望的!谢谢了。

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 楼主| 发表于 2008-9-10 08:41 | 只看该作者
原帖由 tianya 于 2008-9-9 22:47 发表 ; h' `. i3 i# \) W! ?
我谈几点个人的看法:
" F2 C' l: O6 k; b# L, r: w1,楼主其实提出了一个很好的问题,那就是,低速信号也存在信号完整性问题,因为现在很多低速信号,上升沿很快。而有些规范,如I2C,对上升沿等有要求。- S3 C8 r. F, ~  f4 P2 n1 o
2,一高一低很好解释,那就是在驱动端 ...

0 p" L! |+ C/ T* W你好,你的意思我基本理解了,您能告诉我一下,比如为何会出现衰减,是在哪里设置,还有是不是有(震铃)震荡产生啊,还有过冲等,它们又是如何消除/降低的,谢谢您了。

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发表于 2008-9-10 09:30 | 只看该作者
抄一段话在这里:
" f' g6 i  E; ^$ B- c“当信号沿着实际有损传输线传播时,高频分量的幅度减小而低频分量的幅度保持不变。由于这种选择性的衰减,信号的带宽降低。随着信号带宽的降低,信号的上升沿会增长。正式这与频率有关的损耗使得上升沿退化”
4 ~9 C' O7 ]1 n这样应该会比较容易理解吧,并不是设置的问题。
/ |2 ^/ P( c; [# S; p8 L0 L5 ^震荡由阻抗不匹配造成,是否有过冲,你可以去跟器件的数据手册比较看看。
Allen 该用户已被删除
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发表于 2008-9-10 11:23 | 只看该作者
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发表于 2008-9-10 12:05 | 只看该作者
楼主可以放大一下输出波形的边沿,看看上升时间多少。
+ |1 b7 e( ]: ^/ HSQ的TLSIM在仿真时,激励的上升时间由模型的RAMP确定。也可以直接看看IBIS的ramp数据。从图中可以看到输出端波形上升沿很快。
' T. b, ^1 n0 j: E9 i) g  \7 QAllen给出了高速信号的定义,不过在这里上升时间并不能简单的说是周期的几分之几,而应该由器件决定,只是趋势当然是速度越快,上升时间越小。

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 楼主| 发表于 2008-9-10 12:10 | 只看该作者
Allen版主,谢谢您的建议。我这段时间正在努力看仿真,也理解了您上次给我提的建议,知道了自己的错误。谢谢,呵呵。  ?4 W9 x; B; m1 w, j6 c: Z
针对您的回复,我有几个问题还想请教:" [2 x; p1 l* |0 c6 d5 z3 S: G
1.激励的大小受什么因素影响(这个2M的激励是我随便加的)。% e1 ?& E& Y1 o- d8 F
2.“传输线最长的为400mil,传输延时约0.07ns”这个是如何计算的。) L5 R) R, c1 d, U
3.仿真如何得到信号在频域的影响(我真正的目的就是想在频域里对电路进行仿真)。/ I; T% Z- p3 C& P7 S# [
希望您能帮帮我,谢谢Allen。

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 楼主| 发表于 2008-9-10 12:12 | 只看该作者
谢谢tianya ,你的回复帮助了我好多问题!

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 楼主| 发表于 2008-9-10 12:14 | 只看该作者
是不是只能给一个人(悬赏)积分啊?1 `# `- }  e5 @. p
我还想给Allen,呵呵
Allen 该用户已被删除
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发表于 2008-9-10 13:43 | 只看该作者
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 楼主| 发表于 2008-9-10 14:37 | 只看该作者
原帖由 Allen 于 2008-9-10 13:43 发表
3 [: C! t4 `# s9 q9 q(1)上升时间取周期的1/10是经验值,是在没有器件资料的情况下为了方便估算而设。
" `2 o! @: I: ?. q(2)激励的大小只跟信号源自己有关,你可能想问输出的大小吧,你这里的输出大小主要跟电路的衰减系数及传输线损耗有关,但后者在 ...

, M6 Q/ z# c$ Y3 e 谢谢Allen,我受教了,继续努力学习!!!
9 a+ Q% v* W0 e; B4 z% f不知道在SigXplorer中能不能进行频域仿真啊(我只知道在Sigwave中可以选择FFT模式显示,这是不是就是传说中的频域仿真)?8 g* T; Y/ R- e" w9 f4 g/ G/ t2 L
祝EDA365论坛网越办越好!!!% W) M$ X- H  X$ [/ p4 j' M/ U1 |- @/ P
# Y# J0 l* W. Y: \- L
[ 本帖最后由 meijingguoyu 于 2008-9-10 14:39 编辑 ]
Allen 该用户已被删除
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发表于 2008-9-10 16:27 | 只看该作者
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 楼主| 发表于 2008-9-10 16:59 | 只看该作者
原帖由 Allen 于 2008-9-10 16:27 发表
8 @2 k7 }; f3 }7 v; @: q1 C& M; YSigXplorer不能做频域仿真,FFT是基于时域仿真的结果变换所得,没有意义。

  r/ c9 X3 t! q. h) J哦 学习了,今天收获很大,谢谢大家,谢谢EDA365

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发表于 2008-9-27 10:32 | 只看该作者
很有收获!
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