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2D line 如元件外框 為什麼設于all layer ? 期待大家討論關注..

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发表于 2008-8-29 18:56 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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情況說明:
$ y9 e. U, b- d' {! A我在DECAL DEIT環境下分別在primary component layer & silkscreen top & all layer 用2d line畫元件邊線.后保存為part type. " e+ S$ T) K$ @6 i
調入pcb layout后,經板層色彩設置后,三個邊線均正常顯示.(當然,在silkscreen top上的邊線顯示為黃色,其餘兩個邊線顯示則一致為灰色).但在導出cam時,我只應用默認設置導出.發現在cam中打開后,唯獨不見primary component layer的邊線顯示.." U4 N6 \. m: g& i! r
經本人苦思冥想,終于知道為何...原來在cam輸出設置時,不可應用默認設置(我指的是如果你的邊線設在了top layer的話).在select items中設置primary component side的items on primary 要勾選outlines一項,如此作previw便可發現設置在primary component layer的元件邊線終於露出了可愛的面目.如下所示:
/ w, P" i& D, o8 {  B5 k' J2 _
9 O8 Y, |( h# G$ ]以上只是自己摸索出的一些設置,但可惜的是只是解決了具體的問題,卻無法總結出真正的原由....
9 g+ }" ?$ t& q: {9 G% E於是便不可避免地產生了以下問題,希望版主可以指點一二.....- c9 T+ o/ d7 |5 l4 V
2D line 如元件外框 為什麼設于top layer ?設于all layer為什麼也是在layout中可以顯示的?
+ ]* W4 G7 u0 e. J1 D! k兩者有區別嗎?
3 A2 w6 m2 U! ^. n' y為什麼又可以設於silkscreen layer? 1 o4 q6 t( K# r# k. ~( c) i
且以上三种設置均是可以輸出gerber的?
* {. o0 D1 }: ]7 y5 }它們各自的分工究竟是怎樣的?
$ }/ a5 z" \( J以上菜鳥問題,還請高人指點.謝謝.0 z$ U/ H) F5 q- t% X" ]

" H7 a7 _, R% M[ 本帖最后由 stqw1987 于 2008-8-29 20:36 编辑 ]
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发表于 2008-8-29 20:12 | 只看该作者
元件外框建议设于all layer6 r6 V0 h+ N3 p# l/ B
. ^4 I; p' a6 w. ]9 C
之所以不设在screen或top,是因为出丝印层的gerber时,系统默认是all layer.. @$ h6 o; M; F7 ^" n

' S* o! p) }0 X0 w1 H  b当然,你也可以设在screnn或top层,但是出gerber时要添加进来.
- [9 q' m( l& P9 j+ ~6 v. L4 Q+ D5 v
建议:做元件封装时外框统一设置在同一层。
专业服务:(价格面议)
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发表于 2008-9-2 10:02 | 只看该作者
https://www.eda365.com/viewthread.php?tid=4756&page=1#pid40952
# e3 E) `; I, K% O' h! o5 q7 o3 K* F10#,希望对LZ理解有所帮助。
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 楼主| 发表于 2008-9-2 21:46 | 只看该作者
我看了,不過覺得不知所以然....1 [8 o* V2 Q) @; Q# }+ `+ }  M
這不,在導入時也碰到了各那個LZ一樣的問題,可是我的這個可能更難一點啊....+ r9 t: ^; }7 _! `' z! a
https://www.eda365.com/thread-10203-1-1.html
/ T; j! |+ H7 D* h# |& z還請高人指點.
% y7 B" |) L  R& J6 X6 f  E3 u2 E7 H8 t! P2 n* ^6 i' a; w
[ 本帖最后由 stqw1987 于 2008-9-2 21:48 编辑 ]
Not necessarily to be strong , but to feel strong!

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发表于 2008-9-3 09:29 | 只看该作者
Original posted by stqw1987 at 2008-9-2 21:46
+ [; t, N6 Z+ H- j; G我看了,不過覺得不知所以然....
/ T# S9 C* _" G5 a這不,在導入時也碰到了各那個LZ一樣的問題,可是我的這個可能更難一點啊....
5 U8 U; |* s' e& phttps://www.eda365.com/thread-10203-1-1.html
: ^! ?. N9 i1 h7 @* x' k還請高人指點.
! r+ U% C6 V5 _% \3 ?' b2 E$ E$ ^8 [
[ 本帖最后由 stqw1987 于 2008-9-2 21: ...

/ A* Y) W, J1 M( K$ u: a0 X可能是我表达问题,哈哈,如果实在看不明白,咱们可以通过邮件慢慢讨论,我的邮箱请见签名档。
  L6 S4 g1 S9 `, R- T; v" d难怪有这么多人在问这问题最近,唉。。。。。
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发表于 2008-9-3 17:42 | 只看该作者
元件外框设为ALL LAYER层,就说明在任何一层,外框都能显示出来,而元件封装本身有个属性,TOP/BOTTOM,而外框是属于元件封装的,所以元件封装在哪层,也就跟着是哪层了。 总之就是将外框设为ALL LAYER层的好处就是外框始终是与封装在同一层。不知我的理解正确与否。

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发表于 2008-9-6 15:44 | 只看该作者
正确!就是如果在封装里标注字符如:1脚orVCC等就会在DRC时出错的。

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发表于 2008-9-6 19:14 | 只看该作者
怎么是繁体字呢

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发表于 2008-9-6 22:54 | 只看该作者
个人认为这个比较灵活    也就自已灵活处理
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