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请教SDRAM等长布线?

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发表于 2009-4-28 22:46 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
现在布线布到SDRAM了$ j5 ~2 C/ e  ]2 S
想请教下:
+ j( B1 Q$ k* l8 [; @, r0 e1:数据线、地址线、控制线 哪一组对等长要求比较严格呀?
1 L; m  j$ p+ s" D) ~$ }6 i2:数据线、地址线、控制线、时钟线 布线的长短关系式怎么样的呀?) c0 m7 ?' z1 A1 p) z& Q
3:DSP到两个SDRAM的数据线 地址线 控制线是在各个SDRAM处等长呀还是两个SDRAM处都要求等长呀?
, V7 a9 n; o. m* Z% z0 q    比如D0、D1到SDRAM1,D2、D3到SDRAM2,这样的话是D0、D1相等呀还是要求D0、D1、D2、D3都必须要相等呀?
3 L- A) A" z# z8 P( B    那么地址线 时钟线 控制线也和数据线的要求一样吗?
# S: p/ A7 `7 I' X- r4:在走线中间加的匹配电阻应该记入等长线里面吗?该如何计算?4 f/ g( ^8 t$ F* R" G9 t
5:等长线是引脚到引脚间的长度吗?
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林嘉欣,我稀罕你!!

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 楼主| 发表于 2009-4-28 22:47 | 只看该作者
关于这点有太多的疑问了4 l) r7 _- \" r+ q
希望大家多多指点- a9 F$ o" m+ }
谢谢  s8 a, Z9 e0 N6 h: y" q
讲的越详细越好) b& Z" z8 M5 j6 t8 i
谢谢
林嘉欣,我稀罕你!!

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发表于 2009-4-29 09:14 | 只看该作者
有太多的疑问,感觉你没有理解芯片的工作方式,建议你还是先学习一下芯片的时序图,要不等你调试的时候也很郁闷。

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 楼主| 发表于 2009-4-29 09:39 | 只看该作者
有太多的疑问,感觉你没有理解芯片的工作方式,建议你还是先学习一下芯片的时序图,要不等你调试的时候也很郁闷。* @4 ^4 o9 m% `& p/ t7 a
liqiangln 发表于 2009-4-29 09:14
0 N+ E9 h- }. _& l4 i
谢谢
4 Q' E) D# K/ q( g* V$ k" n能不能说的详细点呢
林嘉欣,我稀罕你!!

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发表于 2009-4-29 14:52 | 只看该作者
本帖最后由 _hhh_ 于 2009-4-29 14:53 编辑
6 d0 }* H% ]  v6 r( A7 ~% S. y6 G. T  i* K4 B4 J
SDRAM不需要考虑等长问题,除非你的走线特别长(>4000mil)。别把问题复杂化。而且千万不要认为涉及到高速数字信号就是等长问题!

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 楼主| 发表于 2009-4-29 15:10 | 只看该作者
SDRAM不需要考虑等长问题,除非你的走线特别长(>4000mil)。别把问题复杂化。而且千万不要认为涉及到高速数字信号就是等长问题!
; y# N6 n/ N! u# K0 J" Q_hhh_ 发表于 2009-4-29 14:52
) _1 x4 {$ M8 Z# `0 r" U3 g
所有的走线都不考虑等长吗?
林嘉欣,我稀罕你!!
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