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请问SDRAM时钟线的宽度比数据地址线宽会不会引起阻抗不匹配?谢谢

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发表于 2008-9-24 00:57 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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看到一些设计中的sdram的时钟线比数据和地址线宽,数据地址线控制在50欧姆,9 L! f/ i' S6 N
那么时钟线的阻抗就会小于50欧姆,这样对时钟线的信号质量的影响到底是好还是坏呢?8 D/ p2 V6 x: T* z* Z# `) S

& c) B  k$ W. J谢谢。
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发表于 2008-9-24 08:37 | 只看该作者
阻抗匹配是对于单个网络来说的。
5 O; x  u8 g* i. D7 w  W" {0 u- f可以参考下特征阻抗的公式,阻抗不仅与线宽相关。
$ z* ]5 C4 i" h2 R$ l6 x/ h( }1 C- w: U" x; K" u
如果从趋肤效应来讲,时钟的线宽比较大有利于降低损耗。
sagarmatha

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 楼主| 发表于 2008-9-24 11:00 | 只看该作者
原帖由 forevercgh 于 2008-9-24 08:37 发表
) B) ?$ \, @9 q' E% D7 Q* Z2 J1 `阻抗匹配是对于单个网络来说的。
8 I! y5 ]) Y: I0 q! J% Q可以参考下特征阻抗的公式,阻抗不仅与线宽相关。. x3 O: e' J, M: @

% p5 O+ |6 A8 o- g: C如果从趋肤效应来讲,时钟的线宽比较大有利于降低损耗。
* [1 O: j+ R: U) h% B/ o

/ j5 N8 o) ^) ^) X2 ^9 \我的意思是说,数据地址线上50欧姆阻抗是和芯片输入输出阻抗匹配的
2 w5 z& d" }: O! ^2 B0 t时钟线线宽变宽,阻抗降低,是不是会引起时钟线和芯片的输入输出阻抗不匹配。
0 s8 t% l9 B. C9 |- D; X* X4 l) {9 `8 x! m
这个意思很难理解吗?

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发表于 2008-9-25 09:03 | 只看该作者
时钟buffer和数据线buffer是不同的。
sagarmatha

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发表于 2008-9-25 09:26 | 只看该作者

如果可以,数据也可以低于50ohm,时钟阻抗低了更好

原帖由 matice 于 2008-9-24 11:00 发表 * O" S, t& N" P* B; }
- Z: v* Q, T) S7 l% h

- I+ V1 c7 D8 M1 M4 x" Y# B2 t我的意思是说,数据地址线上50欧姆阻抗是和芯片输入输出阻抗匹配的/ t2 z5 r" r: z, {6 ]/ @, S3 C
时钟线线宽变宽,阻抗降低,是不是会引起时钟线和芯片的输入输出阻抗不匹配。
1 K3 E2 M) c8 Q  M3 z! O8 j2 ?% X6 y
这个意思很难理解吗?
* r. M( d3 H  l8 G/ a
阻抗是个范围,可能是封闭区间,也可能是个半闭区间,跟其余因素也有关系。6 F' X6 z" L( W" Q) r
2 B; U/ N2 e* R' L4 e! l1 F/ }* E
你说的这种情况没有关系,是对的,你就这样做吧。

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发表于 2008-9-26 12:44 | 只看该作者
传输线阻抗是在频率下的一个范围,时钟通常100M,数据基本就是200M,所以你的物理约束在50欧姆,但是在不同频率下测出来的阻抗是不同的;既然你加宽了时钟线的宽度,其实在反射上问题不大,但是在工程制作上感觉你是不是增加了成本了呢?
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