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2017年7月19日公益PCB评审报告节选

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发表于 2017-7-20 08:51 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.  音频模拟线加粗走类差分.
9 y# N8 g. h' S# Z
4 K* a. s' i7 ^! G1 F9 d; R! _
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发表于 2017-7-25 09:28 | 只看该作者
junieya 发表于 2017-7-24 16:322 V: V0 w' o2 c9 a% R
请问这条如何理解? pcb小白求教
7 J9 u/ N% B$ C+ j# G
1.平面铜只有一个VIA,肯定的说这块铜没有作用.
* [$ m3 Y! B$ _, |2.电源被VIA隔小了,电源通路太细.
6 R4 u6 t. l4 q& W) Q$ }( y! `

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发表于 2017-7-24 16:32 | 只看该作者
EDA365QA 发表于 2017-7-20 08:58; K" w" ?( |: x6 G0 N# x4 c
10.  平面铜只有一个VIA,电源被VIA隔小了.
0 Y0 Z+ x1 Y) X+ A
请问这条如何理解? pcb小白求教
# m0 I3 y; z/ g. z2 s& Y- Q

点评

pcb
1.平面铜只有一个VIA,肯定的说这块铜没有作用. 2.电源被VIA隔小了,电源通路太细.[/backcolor]  详情 回复 发表于 2017-7-25 09:28

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 楼主| 发表于 2017-7-20 08:56 | 只看该作者
7.  天线部分加粗控50OHM,陶瓷天下要挖空按DATASHEET处理.7 a* [( Y1 u  ?

* J5 W: H( O9 T5 g0 S& V

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 楼主| 发表于 2017-7-20 08:52 | 只看该作者
2.  信号线应走阻抗线.! f( g$ y' b( O9 e% v: D
; v4 Y. f( W0 n$ G4 c" c4 c

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 楼主| 发表于 2017-7-20 08:53 | 只看该作者
3.  ESD应靠近接口.
% X" c* o" l& X2 m) J8 Y
  v' ]0 i8 `6 H$ L$ P

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 楼主| 发表于 2017-7-20 08:54 | 只看该作者
4.  电源PIN脚加宽.
2 e$ H' w- B$ s0 S$ \# S
4 U6 w5 _3 n& O; @$ ?& v6 a$ x

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 楼主| 发表于 2017-7-20 08:55 | 只看该作者
5.  带变压器的网口下挖空处理.
, O" |+ r: E& u8 n
4 Z: x; Q) l+ A& {$ L

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 楼主| 发表于 2017-7-20 08:55 | 只看该作者
6.  晶体电容不要放后面出现残端.6 d- s# A0 M4 f! M! H
: h) h0 {, A7 r

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啥意思?没看懂  详情 回复 发表于 2017-11-4 11:27

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 楼主| 发表于 2017-7-20 08:57 | 只看该作者
8.  升压电路应缩小回流路径.
% W3 s! h0 p$ c* y
& M+ F( x8 l$ \2 G( x4 v1 t

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 楼主| 发表于 2017-7-20 08:57 | 只看该作者
9.  有线在挖空区.
- z, [9 P- e/ T* W: P
$ e5 `% P) T7 g8 J

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 楼主| 发表于 2017-7-20 08:58 | 只看该作者
10.  平面铜只有一个VIA,电源被VIA隔小了.6 Z' B/ U$ N# `* |
3 U% A( L" V6 R8 \  Z, n4 v6 A

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请问这条如何理解? pcb小白求教  详情 回复 发表于 2017-7-24 16:32

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发表于 2017-7-20 11:31 | 只看该作者
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发表于 2017-7-20 16:46 | 只看该作者

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发表于 2017-7-20 17:47 | 只看该作者
厉害,啥时候才能有QA的水平啊
9 M+ {3 ~4 |4 l% |: j! [7 y" ~: O* u

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发表于 2017-7-21 08:43 | 只看该作者
赞,学习了

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