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2017年8月24日公益PCB评审报告节选

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发表于 2017-8-25 08:31 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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1.  参考层不一致.
+ ]. }4 i$ p& |& b4 c- ]- T7 Q2 E & h& }) b& K7 e7 d/ O4 P6 ?
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 楼主| 发表于 2017-8-25 08:32 | 只看该作者
4.  网口中心抽头加粗,还有一根黄色的没接通开路.$ P) L- H& q. d

( U% J+ [. X) C7 r9 I- m, X4 E* ]

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 楼主| 发表于 2017-8-25 08:36 | 只看该作者
10.  天线隔层参考下有走线,参考面不完整.0 F' h9 S/ s/ |* z& i7 r9 M+ Q

1 i5 w4 q+ Y8 M+ H

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发表于 2017-8-28 08:37 | 只看该作者
6688hyc 发表于 2017-8-26 09:03
; ?3 i3 L% U4 T+ e( n1 }) [/ H0 r顺便问一下 clock匹配为什么要在末端?
9 B$ }- w6 D3 h( d
为了不产生反射.
$ R) s1 M5 T, j% z: S" A

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 楼主| 发表于 2017-8-25 08:31 | 只看该作者
2.  电容处尽量加VIA.8 c3 ~8 n1 R$ G$ |9 U+ s

' g6 H' z; k( `# B& F

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 楼主| 发表于 2017-8-25 08:32 | 只看该作者
3.  电源VIA没用上.
; a1 ^/ h6 X5 O0 |5 A
# e! o( T& [. e6 a7 `  m

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 楼主| 发表于 2017-8-25 08:33 | 只看该作者
5.  有线跨分割.
$ ?2 S. B& e. _6 I# ]6 V' w+ M
9 d$ ?" [) |: `% l6 O" P

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 楼主| 发表于 2017-8-25 08:33 | 只看该作者
6.  器件没钢网.% b# }+ p! a  t; z3 }4 a
, d) L7 ~/ k, p" X( N

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 楼主| 发表于 2017-8-25 08:34 | 只看该作者
7.  电源要加粗.+ q. B6 J9 W3 j9 ~: `" Q, o! g

# b. r* E* ?  z( c0 a- V

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 楼主| 发表于 2017-8-25 08:34 | 只看该作者
8.  模拟线加粗.9 w2 I0 o7 Z8 {) V

$ {- \: {+ ]. G/ R

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 楼主| 发表于 2017-8-25 08:35 | 只看该作者
9.  CLK匹配应在末端,差分要多耦合.
) D. s8 f) \8 l5 F9 p$ n 3 a6 f* f' u2 t9 f6 v

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发表于 2017-8-25 08:56 | 只看该作者
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发表于 2017-8-25 09:16 | 只看该作者

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发表于 2017-8-25 16:28 | 只看该作者
很棒- m) s& n4 T2 H" E& `

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发表于 2017-8-26 09:02 | 只看该作者
给力 我的哥

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发表于 2017-8-26 09:03 | 只看该作者
顺便问一下 clock匹配为什么要在末端?

点评

pcb
为了不产生反射.  详情 回复 发表于 2017-8-28 08:37
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