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发表于 2008-3-31 15:00 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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x
我刚刚开始学习ALLEGRO 有很多不懂的,象大家请教下!
- d; [: _3 R0 X7 U8 k& B5 a2 B" q# I
! x- P9 `8 \; U* R     1,就是对于已有的独立两个原理图,我怎么做才能把他们变成层次形原理图?!
9 Y/ Y5 g1 J) Q( ~1 l2 h8 p. w! `0 v     2,在ALLEGRO中我们的原理图器件他的电源和地默认的都是VCC和GND,而且是隐藏的这在使用时很不方便,有没有其他的方法修改下那?
( P0 \9 X/ B5 L+ k% T# x    3,在画PCB时我们怎么改变过孔?

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发表于 2008-3-31 15:51 | 只看该作者
1、不是很清楚( n$ f& _- Y4 g( C; \8 P( z+ d) {
2、把它显示出来 ;   要不就添加个网络应该可以吧  。   像这样 在弄个电容
! S6 O$ Q8 ^/ h$ g- f# H2 ?- V) W4 x" `9 {( F2 G
3、添加多个孔,走线时用那个就选那个
( @6 o0 X( E$ B" D( F: V" l        & J* x* U, c0 m. Z( e8 X

  Z3 Z$ ~* ~( i: Y5 z8 l1 i或者给NET赋个属性 / S3 {8 @- p" r6 ]9 N: _
      
7 i+ K5 O$ E5 X, u6 a* K0 s$ x# g1 X7 t) U8 W6 I" A
5 C" F( b' \& w2 E9 r
, {, \; G" x7 A
如果是另外全部替换孔的 可以这样
8 m* X8 w0 S7 x  \( E5 b  S ' g9 n+ ]8 T8 z
7 p! \% ?! }2 G$ f$ J

) Q" K+ {1 ~" q; D 其它的不懂了   收工

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3#
发表于 2008-3-31 15:53 | 只看该作者
2,网络重复命名也许会带来错误吧?

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发表于 2008-3-31 16:06 | 只看该作者
原帖由 tnttnp 于 2008-3-31 15:53 发表 $ u! W; k5 w9 u" q; b; D* q
2,网络重复命名也许会带来错误吧?
: W( ?/ t' m! c: m

/ Q% Y3 M) @- e, N* N" z我看有人这么做的,     不过网表中网络名都是VCC ,  应该有个优先级的吧  ,不知道是不是这样???

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发表于 2008-3-31 17:05 | 只看该作者

不管有没有优先级

在同条网路上给两个名字连谈都不值得谈,因为没意义;

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发表于 2008-4-1 08:37 | 只看该作者
原帖由 panhaojie 于 2008-3-31 17:05 发表
& y9 D' @  r3 _9 l2 \在同条网路上给两个名字连谈都不值得谈,因为没意义;

7 ]1 P7 B6 `- L/ m0 l5 R' }4 \0 K# j7 M! i6 e
哦~      
% K2 s8 ?# _- H6 j/ y' l/ t7 {$ [那对于只用到其中一个逻辑门而只画出门电路的器件   怎么连VCC 呢?
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