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第9章 DDRx仿真 ---问题与答疑

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发表于 2018-1-12 08:42 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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第9章  DDRx仿真 ---问题与答疑
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发表于 2018-2-8 20:51 | 只看该作者
大家好,请教一个问题,我在进行ddr仿真的时候,操作到书中P241,“3.添加模型”,执行完【Auto Pin Mapping】,点击【ok】按钮之后出现提示框”NO POWER PIN CONNECTTED . SELECT ONE POWER PIN AT LEAST“。不太清楚哪个环节出了问题,应该在哪里添加power pin。

无标题.jpg (515.31 KB, 下载次数: 2)

无标题.jpg

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已经找到原因,默认的电源设定是错误的,需要设定bus group完成的最后一步手动修改。不知道其它人是不是这样,我修改之后就可以了。  详情 回复 发表于 2018-5-17 22:02
我也是出现同样的问题,auto pin mapping之后点击ok按钮出现no power pin connected; 现在停止走不动了,有出现此异常的工程文件,哪位大师有空帮忙解决一下,谢谢  详情 回复 发表于 2018-5-10 22:26
请问下,ddr仿真的时候VRM设置那步是如何增加VRM component的?  详情 回复 发表于 2018-2-28 23:15
我也是到这里出现了这个问题,没有找到原因,就没有进行下去。  详情 回复 发表于 2018-2-9 14:48
这个会自动识别的,看看会不会是电源设置有问题?  详情 回复 发表于 2018-2-9 09:51

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发表于 2018-1-31 16:47 | 只看该作者
第245页,图9-63,按照文字说明,仿真选择地址控制组信号和一组数据信号分析,图9-63实际勾选的是地址信号和时钟信号。

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看的好仔细啊  详情 回复 发表于 2018-1-31 17:38

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发表于 2018-2-8 15:03 | 只看该作者
阡陌 发表于 2018-2-7 12:35
1、使用SYSTEM SI进行仿真时,这个参数如何设置,有什么参考依据?
2、目前仿真的是LPDDR3的眼图,仿真出 ...

1\时序可以看数据手册要求
2\仿真和实测不一样很难说是什么原因的吧,得看具体环境和条件,例如有些板DDR我们看到加的测试点是在线上的,具体位置是不确定的,实测时候有可能收发都是点的同一个点??或者把过孔刮开靠近芯片测试的,但是有些信号是表层拉出来很长一段打孔的,这时候这个孔是在中间的,都有可能

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发表于 2018-1-22 16:11 | 只看该作者
本章DDR仿真,用的是speed2000,拿到了对应的案例spd了,controller和对应颗粒的IBIS模型能不能提供呢。再就是speed2000仿真,怎么考虑PKG的影响?

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发表于 2018-1-24 13:39 | 只看该作者
模型上也可以加封装信息的吧,R  L  C设置进去?
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发表于 2018-1-24 16:40 | 只看该作者
你好, 请问在SYSTEM SI中加载PKG时,供应提供的S参数部分如截图,一个PIN对用两个DIE,在互联是应该如何操作?直接一个PIN连接两个DIE吗?谢谢。

Snipaste_2018-01-24_16-38-31.jpg (67.95 KB, 下载次数: 1)

Snipaste_2018-01-24_16-38-31.jpg

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发表于 2018-1-24 18:08 | 只看该作者
是这样子吧??

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是一颗MEM有两个DIE,两个DIE还有一部分信号是共用的,所以分成两个不太合适吧,所以这里不清楚怎么操作。  详情 回复 发表于 2018-1-24 18:45
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发表于 2018-1-24 18:45 | 只看该作者
GHOST 发表于 2018-1-24 18:08
是这样子吧??

是一颗MEM有两个DIE,两个DIE还有一部分信号是共用的,所以分成两个不太合适吧,所以这里不清楚怎么操作。

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共用的也有PORT的吧?像上面图中的DQS0,是否可以这样子理解:一个MEM里面集成了2颗DDR颗粒?  详情 回复 发表于 2018-1-25 10:14

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发表于 2018-1-25 10:14 | 只看该作者
阡陌 发表于 2018-1-24 18:45
是一颗MEM有两个DIE,两个DIE还有一部分信号是共用的,所以分成两个不太合适吧,所以这里不清楚怎么操作。 ...

共用的也有PORT的吧?像上面图中的DQS0,是否可以这样子理解:一个MEM里面集成了2颗DDR颗粒?
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发表于 2018-1-25 16:30 | 只看该作者
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发表于 2018-1-31 17:38 | 只看该作者
mingzhesong 发表于 2018-1-31 16:47
第245页,图9-63,按照文字说明,仿真选择地址控制组信号和一组数据信号分析,图9-63实际勾选的是地址信号 ...

看的好仔细啊

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发表于 2018-2-7 12:35 | 只看该作者
1、使用SYSTEM SI进行仿真时,这个参数如何设置,有什么参考依据?
2、目前仿真的是LPDDR3的眼图,仿真出来裕量很大,和供应商提供测试报告差距很大,不清楚是什么环节的问题,有没有用SYSTEM SI仿真DDR的,可以一起交流一下。

1.jpg (65.28 KB, 下载次数: 1)

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1\时序可以看数据手册要求 2\仿真和实测不一样很难说是什么原因的吧,得看具体环境和条件,例如有些板DDR我们看到加的测试点是在线上的,具体位置是不确定的,实测时候有可能收发都是点的同一个点??或者把过孔刮  详情 回复 发表于 2018-2-8 15:03

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发表于 2018-2-8 23:29 | 只看该作者
本帖最后由 lature 于 2018-2-8 23:31 编辑

DDR 仿真中失败,是什么原因?如图

无标题.png (8.44 KB, 下载次数: 1)

无标题.png

无标去题.png (13.63 KB, 下载次数: 2)

无标去题.png

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一样的现象,保存参数后没有修过网络等参数,还是有这个提示,同问?  详情 回复 发表于 2018-5-23 12:45
是不是中途修改了什么设置?按照提示修正一下在跑跑看?  详情 回复 发表于 2018-2-9 09:52

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发表于 2018-2-9 09:51 | 只看该作者
lpc_2138 发表于 2018-2-8 20:51
大家好,请教一个问题,我在进行ddr仿真的时候,操作到书中P241,“3.添加模型”,执行完【Auto Pin Mappi ...

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