DDR4减小信号延迟时间，是增加还是减小DK值

tencome · 发表于 2017-1-6 08:14

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DDR4设计时，如果要减小信号延迟时间，在布线不变的情况下，是增加基板的DK值还是减小DK值？？？

banrx · 发表于 2017-1-6 14:32

传输速度约等于C/（sqrt（dk）），所以减小延迟，增大dk

banrx · 发表于 2017-1-6 14:33

banrx 发表于 2017-1-6 14:32- ]% p% O9 s8 {. y' l
传输速度约等于C/（sqrt（dk）），所以减小延迟，增大dk

失误写错了减小dk

tencome · 发表于 2017-1-11 09:50

banrx 发表于 2017-1-6 14:33% i' [6 i4 _5 d1 P4 g9 b
失误写错了减小dk

这个公式是经验公式？

减少延迟，就增加DK吧。

banrx · 发表于 2017-1-11 10:18

tencome 发表于 2017-1-11 09:50
: w* w% Y* b5 R! l这个公式是经验公式？, e( h0 o: F& ^& f2 L

8 m( o" q8 D1 Q# d减少延迟，就增加DK吧。

对啊经验公式减小传输延迟不就是要增大传输速率吗，减小dk吧

denny_9 · 发表于 2017-3-24 16:20

dk越小，带来信号在介质中传输速率变大。

icy88 · 发表于 2017-3-29 17:19

这个是一个比较复杂的问题，如果是从理论上存数学的分析的话，延时减小，相应dk也减小，信号传输速度变快，但是对于同一个设计，不能仅仅的只改变介质来解决，因为改变介质后其他设计不变的话会带来更多的信号完整性问题，这样实际的延时可能由于信号完整性问题反而增加，纯粹提醒下

shirdon · 发表于 2017-4-6 17:43

了解微带线和带状线的区别就知道了，应该减小DK，信号传输速率才快

JOING · 发表于 2017-4-9 10:27

减小DK值，传播速度增加，延时减小

alienware · 发表于 2018-1-15 13:25

:):):):):):)

zxc0717 · 发表于 2018-7-16 18:39

嗯，是的

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