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求《IC封装基础与工程设计实例》第4章的每一小节的工程保存文件

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发表于 2015-5-28 21:32 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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请问能提供《IC封装基础与工程设计实例》第4章的每一小节的工程保存文件吗?我照着书本,还是完成不了。3 p; A6 s: J( s* p
比如:* y. n: P( L& A9 x* b
2 L3 ?# [! T; Z) g

; w7 a4 Q8 v4 U4.12节怎么摆放都有DRC;4 m4 H& \/ O  d; e7 v+ s) U
4.15调整不好交叉鼠线;, b, G6 E# G. {& w! ]  n3 n
...." _8 x; F: A" P7 `) i( [; y- ]
(可能我太笨了)0 c; F$ j, a$ M7 I6 I4 s# u; [

+ W: A# o' a- V/ R
. M$ T( M  W% s* o& w( d, o
无法进行下一步,特请高人发布一下文件,谢谢!( o  m- ^$ ^) C  k2 a
  s3 Y* E3 J5 @7 a  d% J$ d
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 楼主| 发表于 2015-5-29 10:33 | 只看该作者
4.12节的VSS的Bond Wire 有必要连接到die flag的Bond Guide Line上吗?4.13节的图4-56怎么没显示?

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可以不用放置在die flag, 有位置就可以咯。  详情 回复 发表于 2015-7-22 16:55

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发表于 2015-7-22 16:53 | 只看该作者
DRC可能使DIE pin之间的间距小于你的约束值, 交叉鼠线存在不代表就不好呀,鼠线是直线路径显示,不要太在意。

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发表于 2015-7-22 16:55 | 只看该作者
jason1937 发表于 2015-5-29 10:33
* |( k* V; Z* `* W# a& t& {7 f2 g4.12节的VSS的Bond Wire 有必要连接到die flag的Bond Guide Line上吗?4.13节的图4-56怎么没显示?
7 S: Q$ q2 f; B! u
可以不用放置在die flag, 有位置就可以咯。) T) q0 r7 t- m7 ?' L" Q

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发表于 2016-5-9 23:44 | 只看该作者
同求

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发表于 2016-12-24 10:14 | 只看该作者
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