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PCB检查布线99.87%,找不到未布线net

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发表于 2018-4-19 16:04 | 只看该作者 |只看大图 回帖奖励 |倒序浏览 |阅读模式

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x

3 z5 A6 u! u. g. |
6 B, r: B; b+ I5 t4 z% o问题描述:
% y) [3 y2 a/ K- A' m  ]% ]( p9 \0 Q* X1.PCB检查如上图。软件提示未连接net均是死铜皮块。但是死铜皮左边是X=9669,Y=5339,坐标位置均为我PCB不能坐标的外部。所以不清楚为何会这样报错。PCB外确定无任何铜皮块。
  w3 Z6 n# ~, g" `3 W6 _8 K2.完成99.87%,找不到未布线net。% o0 u5 G: O* @8 g8 [; [
6 L5 p5 Z* O2 S- W
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 楼主| 发表于 2018-4-20 16:07 | 只看该作者
yihafewu 发表于 2018-4-20 14:156 |6 ?+ Q* M7 }" H8 K0 j2 Z$ c1 `
找一个报错的封装,连同周围的元件和走线,复制,新建一个PCB,进行特殊粘贴-保持网络名,再drc看看。
' S! c6 m8 i( o0 h( u如 ...

2 m- V( a; U$ g% D问题解决了。新建PCB,复制过来检测100%、但是复制过来的时候内电层分割的铜皮net有丢失,自己全部重新定义了一下。但是S1S2S3层铜皮我发现更新不起作用。如图:
/ C3 l6 j; n, T" R" a  w. u ,外部铜皮轮廓会显示,手动不能更新。大神是否知道是何缘故。如果这个能解决,我就在新的PCB里再检查检查投板。
3 ?: M' n- n7 E% i8 P4 l

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 楼主| 发表于 2018-4-20 11:51 | 只看该作者
yihafewu 发表于 2018-4-20 09:17: E, r! u( ?7 J& y4 k( V$ ]
新建一个PCB,层叠设置一样,把图拷过去试试。

0 ^# Z3 J7 \9 n+ o% W3 B3 j1.检查规则:
7 j+ b1 @  U) V! p6 K. E2 d
; e2 s+ J4 X' l' N& M7 q$ x2.检查结果:: I" D8 k0 c: Z7 G& Q
* C  n, C) R- |& `
可以看出没有出现net未连。但是检测板子信息如下:/ o+ r/ o7 {+ Q! t9 `
3.还有两个net未连接。把板子所有东西都隐藏也没发现有飞线。( x4 x5 Y0 v% Q0 f( P

  c& f8 j' l: E
. F  W1 d! w- c1 p, h) M

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 楼主| 发表于 2018-4-20 16:28 | 只看该作者
yihafewu 发表于 2018-4-20 16:16
! G0 v( N* F" l9 c% ks1s2s3是正片层?这些铜皮是手工放置的polygon吧?
0 V$ Y% Q! N, Z! {如果是,切换到相应层,那么双击它,在这个属性对话框 ...

2 n7 S3 W  b9 Y' c  z& E: {正片手动放的铜皮,在16里边怎么样也不行。我把所有设置都回复默认设置也不行。我有用AD9打开发现可以跟新了。所以现在问题彻底解决了。

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发表于 2018-4-20 08:09 | 只看该作者
本帖最后由 yihafewu 于 2018-4-20 08:49 编辑 2 f( t6 B1 |! s4 P+ `- F( K3 Z
% o7 w' w" b. s& u
切换到G1层,看看GND网络是否存在孤岛(没有与其他GND铜皮连在一起的孤立铜皮)。
  ~% m& u( v# Z( `还有P层的DSP的几个电源网络。! r6 l2 f3 e2 h" I, ~7 F  H
5 s% w- q6 u, S- g2 K# [

点评

G1层,很明显没有孤岛。 [attachimg]137396[/attachimg] P层:很明显也没有。 [attachimg]137397[/attachimg]  详情 回复 发表于 2018-4-20 08:49

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 楼主| 发表于 2018-4-20 08:49 | 只看该作者
yihafewu 发表于 2018-4-20 08:09
: c/ Y8 T' q/ c% _" o2 J, n6 n切换到G1层,看看GND网络是否存在孤岛(没有与其他GND铜皮连在一起的孤立铜皮)。
' }  x. ?* g: J( m还有P层的DSP的几个电源 ...

. ^4 h, F. D9 {  O+ _% Z
- k3 j5 W2 V: I- c/ \0 N( E" ZG1层,很明显没有孤岛。
* h8 P! J0 N8 \4 u2 O  N, Q5 K - e- w. G! q0 f7 V
P层:很明显也没有。
3 \- u2 d( z- b8 D$ t 4 F, s$ I$ h8 y# t' M
6 I8 ^4 R+ \2 G) p  b! k; k1 t

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发表于 2018-4-20 08:56 | 只看该作者
兄得,你再仔细看看,有孤岛啊,你的两个图里都有啊。5 @* g4 J! C7 a2 a1 J: P
我的电脑是加密过的,没法截图给你。7 B$ E' b7 H2 Y! h3 L9 ^
比如电源那里,你高亮的部分,中上,靠左,五个过孔处。你在孔比较密集的地方找。

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[attachimg]137398[/attachimg] 没有啊。都是十多年老司机了。这个真把我难住了。  详情 回复 发表于 2018-4-20 09:04

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发表于 2018-4-20 09:00 | 只看该作者
preferences->system->navigation,在highlight methods的那个标尺,移到靠近close处,你双击messages的时候会定位到目标处

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 楼主| 发表于 2018-4-20 09:04 | 只看该作者
yihafewu 发表于 2018-4-20 08:56' a1 }% t) K+ u2 K
兄得,你再仔细看看,有孤岛啊,你的两个图里都有啊。
% c8 `' u0 B" K, \4 K4 H8 d我的电脑是加密过的,没法截图给你。
0 X" e) M' W7 F1 r3 g; ?$ I3 y! i比如电源那里 ...

2 H/ I% J* r+ D- ^' x' @0 o$ { . S; f/ M' C1 x8 @
没有啊。都是十多年老司机了。这个真把我难住了。
, m6 l) A$ [7 e7 F

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发表于 2018-4-20 09:11 | 只看该作者
看看能看到不8 G( k) o0 x0 `* Y5 _) k# x+ n

IMG_2483.PNG (1.15 MB, 下载次数: 2)

IMG_2483.PNG

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发表于 2018-4-20 09:17 | 只看该作者
新建一个PCB,层叠设置一样,把图拷过去试试。

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1.检查规则: [attachimg]137416[/attachimg] 2.检查结果: [attachimg]137417[/attachimg] 可以看出没有出现net未连。但是检测板子信息如下: 3.还有两个net未连接。把板子所有东西都隐藏也没发现有飞线。 [a  详情 回复 发表于 2018-4-20 11:51
解决了。我板子上连接器的焊盘有点大。我在P跟G1,G2层焊盘边缘放了一个圆做隔离,软件检测到园内是一篇孤铜。其实不影响电气特性。因为PCB生产过程中焊盘的铜壁厚就把内电层的孤岛覆盖了。  详情 回复 发表于 2018-4-20 11:25

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发表于 2018-4-20 11:00 | 只看该作者
一般打孔不规范的,或者建库不规范的,用负片就要注意

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 楼主| 发表于 2018-4-20 11:25 | 只看该作者
yihafewu 发表于 2018-4-20 09:170 I* N- `; n: Y# E5 W
新建一个PCB,层叠设置一样,把图拷过去试试。
5 |2 T/ y7 _, t9 C3 [
解决了。我板子上连接器的焊盘有点大。我在P跟G1,G2层焊盘边缘放了一个圆做隔离,软件检测到园内是一篇孤铜。其实不影响电气特性。因为PCB生产过程中焊盘的铜壁厚就把内电层的孤岛覆盖了。% `: f. C( _( l8 i0 e; S

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发表于 2018-4-20 13:09 | 只看该作者
你把Clearance的检查关掉再DRC看看,你的错误总数已经达到5000了,这个值应该是你设置的最大错误数吧。

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[attachimg]137421[/attachimg] 无net的pin我挨个全看了。没有问题。但是布线还是不是100%  详情 回复 发表于 2018-4-20 14:00

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 楼主| 发表于 2018-4-20 14:00 | 只看该作者
yihafewu 发表于 2018-4-20 13:09
( m+ ]  ~/ z+ k你把Clearance的检查关掉再DRC看看,你的错误总数已经达到5000了,这个值应该是你设置的最大错误数吧。
; ?7 ?8 c" A: T' [9 K' {% u. L
/ _" X% [1 F9 p" o% Z$ x2 q
无net的pin我挨个全看了。没有问题。但是布线还是不是100%2 d& H/ V( D+ G& D$ _9 A4 a! V

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发表于 2018-4-20 14:15 | 只看该作者
找一个报错的封装,连同周围的元件和走线,复制,新建一个PCB,进行特殊粘贴-保持网络名,再drc看看。( w+ i: Y, L6 L/ Q" E
如果你的PCB不涉及保密的话,可以上传上来看看。

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问题解决了。新建PCB,复制过来检测100%、但是复制过来的时候内电层分割的铜皮net有丢失,自己全部重新定义了一下。但是S1S2S3层铜皮我发现更新不起作用。如图: [attachimg]137430[/attachimg],外部铜皮轮廓会显  详情 回复 发表于 2018-4-20 16:07
看私信消息。  详情 回复 发表于 2018-4-20 14:26

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 楼主| 发表于 2018-4-20 14:26 | 只看该作者
yihafewu 发表于 2018-4-20 14:15# @+ @5 W, r6 a; F6 }; f
找一个报错的封装,连同周围的元件和走线,复制,新建一个PCB,进行特殊粘贴-保持网络名,再drc看看。9 h# t" Z7 T) @
如 ...
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