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楼主: lcl987512
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关于塞过孔和测试点的问题

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发表于 2011-9-9 16:13 | 只看该作者
顶  顶!!!!!!!!!!!!!!!!!!

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发表于 2011-9-9 16:14 | 只看该作者
neon 发表于 2011-8-15 17:00
& f# q" ^% ]( O, j7 w: ^$ c5 R顶顶顶顶,又学了一招。
2 T: z- l) ?( M# Y% l% t# d& K
顶 ! !

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发表于 2011-9-9 17:05 | 只看该作者
deargds 发表于 2008-8-24 21:57
: S1 ^8 g  m) N/ c建VIA PAD时不建SOLDER MASK层就可以了。

! I: S6 l# x$ c3 V6 }: }出gerber的时候,为什么要塞过孔,测试点,不明白楼主的意思,求讲解啊{:soso_e100:}

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发表于 2011-11-26 22:36 | 只看该作者
两种方法:1 :普通via的via pad不建soldermask,测点via建soldermask, b! Y: n! O. N% C
          2 :通过修改gerber资料,将gerber中除了测点via的soldermask留下,其他普通via的soldermask去掉

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发表于 2013-3-12 16:55 | 只看该作者
学习了,刚出一个小板子的时候板子上的VIA都没有做塞孔处理,原来是做封装的时候加上了soldmasker,以为做插孔都需要的呢。

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发表于 2013-3-12 21:21 来自手机 | 只看该作者
13楼正解

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发表于 2013-3-13 08:30 | 只看该作者
鱼美木 发表于 2013-3-12 16:55 $ [1 {# d! m8 `
学习了,刚出一个小板子的时候板子上的VIA都没有做塞孔处理,原来是做封装的时候加上了soldmasker,以为做插 ...

% t# Y3 n" x; ]$ z0 s  J0 E9 S Generic_Allegro_Footprint_Library_Development_Specification.pdf (54.89 KB, 下载次数: 46) % _- M# R* L8 @; Y* c, Y& l& X
给你一手册,自己看

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发表于 2013-3-13 08:39 | 只看该作者
路过~

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发表于 2013-3-13 09:01 | 只看该作者
谢谢啦!

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发表于 2013-3-20 14:00 | 只看该作者
我也
  q* p- u2 G3 e' b3 C: B& S% e顶一顶顶顶

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发表于 2013-3-27 22:38 | 只看该作者
测试点不多可以用笨方法,board geometry soldermask用shap开窗

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发表于 2015-3-20 11:29 | 只看该作者
感谢高手们的指导,谢谢。
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