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电巢直播8月计划
楼主: wangjing
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发表于 2012-11-8 17:59 | 只看该作者
多谢!学习了

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77#
发表于 2012-11-8 18:12 | 只看该作者
谢谢楼主的无私分享,我现在正在学习DDR3,要是能够得到楼主的brd原文件的更好!我的邮箱是:455537509@qq.com   谢谢!

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发表于 2012-11-8 18:17 | 只看该作者
不道德,发。。。

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发表于 2012-11-9 08:56 | 只看该作者
wangjing 发表于 2012-11-7 13:27
9 ^2 {1 F$ B  X! A6 |5 W% M" N9 [数据线和时钟线做等长,每片地址线等长。数据线和地址线不要求

  v/ S' X" }2 S% l$ f7 H  G( `数据线 跟时钟线等长 没搞错吧

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发表于 2012-11-9 09:09 | 只看该作者
研究研究,xinlai.nudt@gmail.com,谢谢楼主!

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发表于 2012-11-9 10:28 | 只看该作者
984673847@qq.com.  谢谢,

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 楼主| 发表于 2012-11-9 10:59 | 只看该作者
wplian2188 发表于 2012-11-8 18:12
# s- x# ?* o  Q! U* v谢谢楼主的无私分享,我现在正在学习DDR3,要是能够得到楼主的brd原文件的更好!我的邮箱是:   谢谢!
! F3 E; @% E7 |% W& e
已上传ddr3部分的brd文件

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发表于 2012-11-9 13:30 | 只看该作者
chenyuyu 发表于 2012-11-8 16:06
$ D* z7 g; Q7 \8 a6 Jddr3?
- O7 ]# _# c; B: U9 \  R+ T
LGA1366!X58主板!

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 楼主| 发表于 2012-11-9 14:07 | 只看该作者
DIA3BLO 发表于 2012-11-9 13:30 ; \. p9 K, V# u) R1 _: X
LGA1366!X58主板!

- ~  w1 G0 Z6 Z! P7 l3 u% `' d是TI8168

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发表于 2012-11-9 14:13 | 只看该作者
本帖最后由 vincent_xiao 于 2012-11-9 14:14 编辑 6 O# b4 x: v0 `4 p) Y( s! J9 @: V9 C
  C, }9 F; o/ n) W+ v
6层同样布局类型的DDR3,上传来给大家看看.接受评议~~~{:soso__8961432591078930798_3:} ) t, _3 t( A! c- x5 H. o! G+ x

1 j( P# `+ D; B$ p

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 楼主| 发表于 2012-11-9 14:21 | 只看该作者
vincent_xiao 发表于 2012-11-9 14:13
+ ^5 K3 V9 t* d$ K% g0 B% k$ }6层同样布局类型的DDR3,上传来给大家看看.接受评议~~~

3 k7 p7 p7 B* Q$ ~7 rT型?

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发表于 2012-11-9 14:25 | 只看该作者
359354215@qq.com谢谢楼主

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发表于 2012-11-9 14:33 | 只看该作者
wangjing 发表于 2012-11-9 14:21
8 C+ E" }# V' C  m  DT型?

1 H( Z5 [; J. G7 E4片SDRAM,每二片时钟各自独立,ADD是4片互连,所以采用T型方式走线方式比较好做等长,有没更好的建议.....

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 楼主| 发表于 2012-11-9 14:54 | 只看该作者
vincent_xiao 发表于 2012-11-9 14:33
: p7 z6 G* z- R0 P5 R4片SDRAM,每二片时钟各自独立,ADD是4片互连,所以采用T型方式走线方式比较好做等长,有没更好的建议.... ...
+ u9 X& R2 t2 n0 N$ ]3 _
那并联终端电阻是两边都放了?

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发表于 2012-11-9 15:00 | 只看该作者
wangjing 发表于 2012-11-9 14:54 " ]/ d2 ^6 z: `/ l4 E
那并联终端电阻是两边都放了?

" ^5 K# h; z6 h没有用到并联终端电阻。好像DDR3大多都是不加并联终端电阻的吧,DDR2就要求一定要的。
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