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电巢直播8月计划
楼主: matice
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前几天看了一个ddr的pcb布线,感觉很不规范,不过居然是厂家推荐的

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发表于 2008-9-23 17:26 | 只看该作者
登场桑主要市委了 信号完整性考虑  产品关键要看在恶劣工况的工作情况比如高温60  湿度90%  这样的环境你的产品还能常识见闻顶工作吗

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发表于 2008-10-30 09:33 | 只看该作者
我认为最好安装规范来做。

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发表于 2008-11-2 11:09 | 只看该作者
还是要看实际效果的!!

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发表于 2008-11-9 13:50 | 只看该作者
规范在那里?
- M) ~! q' H4 e; X; Y- a! V呵呵!

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发表于 2009-1-15 09:30 | 只看该作者
我是来学习的

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发表于 2009-2-24 10:16 | 只看该作者
成本和等长有什么关系?为了省几个匹配电阻的钱?也可用等长把匹配电阻做掉,但不意味着不做等长阿。/ U* H8 V5 d& L3 l+ N+ [4 ?! w
cmos 发表于 2008-6-13 10:28
8 N) c3 [9 r# a& {' V" S
做了阻抗控制,PCB制板成本就上去了。

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发表于 2009-2-25 11:46 | 只看该作者
规范不是一成不变的,技术的更新规范也会随之更新

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发表于 2009-3-4 15:36 | 只看该作者
作了阻抗匹配成本就上去了,请问如果只用等长线,而不考虑阻抗匹配,对120MHz的DDR会有多大的影响?

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发表于 2009-3-4 15:37 | 只看该作者
21# routon
1 {" }9 i  q2 f& p, w! F! N( a  k# @7 f' t9 m* `/ B
作了阻抗匹配成本就上去了,请问如果只用等长线,而不考虑阻抗匹配,对120MHz的DDR会有多大的影响?

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发表于 2009-4-10 13:13 | 只看该作者
要不楼主可以看看freescale提供的资料

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发表于 2009-8-6 10:16 | 只看该作者
5# cmos ) s! R5 l( h" E2 Y) C+ {
说的在理也!!!!!
看你那小样!小样怎了,也要撑起一片天!!

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发表于 2009-8-11 13:47 | 只看该作者
进来学习的,呵呵

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发表于 2009-8-21 23:28 | 只看该作者
1 没有匹配
2 u' _/ A: U3 _2 没有严格差分: V5 L! \* R  t+ [5 d1 g
3 没有严格等长,没有蛇形线。. w* c7 R0 g. Z$ K; a- y
4 菊花链拓扑
4 H" y$ Z: H; V9 x, N( n
' l0 l# {! F: {: C还是处理器的厂家给的参考布线,大家讨论一下,这也行吗?
! W# H/ M3 m% r  P$ Jmatice 发表于 2008-6-4 10:22
0 m8 Z9 w- e- @  q
1. ddr有on die termination,如果芯片可以容忍阻抗不匹配造成的反射,没必要在板上做匹配4 |( x1 a7 T  R: `
2.松耦合没问题+ K: V! N, Y7 I" D+ P; p( `
3.完全没必要等长2 \/ ?$ i& |3 b4 T: \9 q
4.完全可以用

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发表于 2011-8-17 09:56 | 只看该作者
我现在也做这样的案子,各种芯片的要求不一样吧1 U% ~8 X4 T7 y

$ ~" q$ c$ ^% U

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发表于 2011-8-17 09:56 | 只看该作者
我现在也做这样的案子,各种芯片的要求不一样吧, K3 o3 F4 T( [

9 r+ l- _4 V9 [* J1 ?  W! o5 Z
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