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电巢直播8月计划
楼主: alooha
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高速数字电路中的终端匹配技术!

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发表于 2010-9-8 15:19 | 只看该作者
图片上的计算公式看不到,楼主可以提供么?

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发表于 2011-1-27 14:32 | 只看该作者
努力学习模电

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发表于 2011-2-18 20:19 | 只看该作者
讲得很好,收藏了

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发表于 2011-2-19 19:01 | 只看该作者
谢谢分享!!

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发表于 2011-2-28 19:23 | 只看该作者
多谢分享,有用!

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发表于 2011-3-10 16:45 | 只看该作者
难懂呀

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发表于 2011-3-10 22:15 | 只看该作者
这个好像有一个专门的文章介绍匹配的,大家也可以上网找找,我不记得在哪里有了

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发表于 2011-5-6 19:13 | 只看该作者
很好的帖子,学习了!

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发表于 2011-5-24 18:24 | 只看该作者
学习了

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发表于 2011-5-29 17:47 | 只看该作者
讲的非常易懂透彻,好东西!$ P: t# C  D9 H2 N( z; l9 ~

4 R  n4 r8 }, J1 u! Q' w

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发表于 2011-6-9 19:59 | 只看该作者
《而在接收端,由于传输线阻抗和接收器阻抗的不匹配,通常情况下接收器的输出阻抗更高,这会导致大约同样幅度值信号的反射,这称之为附加的信号波形。》这是串行终端匹配技术提到的?这个有点理解不了,哪位高手给解释下$ c2 |  A! N! g

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发表于 2011-6-14 21:04 | 只看该作者
不知道多负载的情况下,一般怎样端接,如菊花链、星型的。

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发表于 2011-6-23 16:36 | 只看该作者
CaesarWong 发表于 2011-6-14 21:04
! ]# o. ^  X. _/ Q) R; d7 @不知道多负载的情况下,一般怎样端接,如菊花链、星型的。
# f8 G) Q& w- y
同问!" W- m8 Q( u9 l$ [9 I* R/ X  D

( _9 m' M: S3 T  A如果为了信号完整性(比如为了信号不反射)而在终端加匹配电阻一般是50欧到地,但是我看到某芯片如下的FAQ,怎么理解?; K6 P% @' ^( \. c/ I8 G0 t
Q: To avoidreflections, how do I have to terminate the LVTTL and LVPECL signals?
0 {5 p6 {1 Q. t& \3 [& R+ j* O6 x

6 Y7 q% [" w: D' y
A:  LVPECL: via 50 Ohm to VECL = 1.25V, LVTTL: 51 k against GND

1 [) U  R1 T* n" l5 f( H# S; Z: Q

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发表于 2011-7-7 08:50 | 只看该作者
描述得不错。

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发表于 2011-7-20 12:11 | 只看该作者
回复 alooha 的帖子
4 r* I  v2 ]8 n( W& a! m7 n
& N  a7 h# }* Z7 t很好的资料!多谢分享!
2 c; E$ z2 ^: P. N% S3 ^9 M; t) e) @
[url=https://www.eda365.com/thread-19-1-1.html][/url]9 G/ [% O* [8 `7 i; b7 v: h. A- m
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